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제 1 클럭 신호(Clock signal)를 생성하는 제 1 오실레이터;제 2 클럭 신호를 생성하는 제 2 오실레이터; 및상기 제 1 및 제 2 오실레이터는 서로 동일한 구조로 구성되되, 복수 개의 반전 증폭기의 2차원 또는 3차원의 프랙탈 구조(fractal structure)로 구성되며,상기 제 1 오실레이터 상의 제 1 노드와, 상기 제 1 노드와 동위상인 제 2 오실레이터 상의 제 2 노드를 연결하는 클럭 버스 라인(Clock Bus line)을 포함하고,상기 제 1 및 제 2 링오실레이터는 각각 서로 다른 2개의 칩의 발진기로 각각 사용되며, 상기 클럭 버스 라인은, 상기 제 1오실레이터의 제 1 내지 제 3 꼭지점 노드와, 상기 제 1내지 제 3꼭지점 노드와 각각 동위상인 상기 제 2오실레이터의 제 4 내지 제 6 꼭지점 노드를 각각 연결하는 제 1 내지 제 3 클럭 버스 라인을 포함함으로써, 상기 2개의 칩에 공급되는 전압의 차이가 발생하더라도 상기 3개의 클럭 버스 라인의 연결에 의해 상기 제1 오실레이터와 상기 제 2 오실레이터가 동일한 주파수 및 위상으로 발진하도록 동기화하는 것을 특징으로 하는,발진기 시스템
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제 1 항에 있어서,상기 프랙탈 구조는 반도체 칩상에 서로 120°의 위상차를 갖도록 세 개의 노드를 포함하여 이루어진 환상발진기 형태의 구조를 기본 단위(unit)으로 하는 것을 특징으로 하는,발진기 시스템
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제 2 항에 있어서,상기 기본 단위의 상기 세 개의 노드는 제 1 내지 제 3 반전 증폭기에 의해 삼각형 형태를 형성되는 것을 특징으로 하는,발진기 시스템
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제 3 항에 있어서,상기 세 개의 노드는,상기 제 1 반전 증폭기의 입력단과 상기 제 3 반전 증폭기의 출력단이 연결되어 형성하는 제 1 노드,상기 제 2 반전 증폭기의 입력단과 상기 제 1 반전 증폭기의 출력단이 연결되어 형성하는 제 2 노드, 및상기 제 3 반전 증폭기의 입력단과 상기 제 2 반전 증폭기의 출력단이 연결되어 형성하는 제 3 노드로 구성되는,발진기 시스템
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제 2 항에 있어서,상기 프랙탈 구조는,세 개의 노드가 삼각형 형태로 형성되는 복수 개의 기본 단위가 2차원 또는 3차원으로 반복적으로 연결되는 것을 특징으로 하는,발진기 시스템
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제 5 항에 있어서,상기 프랙탈 구조에 있어서 기본 단위의 개수는,첫째항이 1이고 공차가 1인 등차수열의 합으로 형성되는 것을 특징으로 하는,발진기 시스템
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제 6 항에 있어서,상기 기본 단위의 개수는,이고, n은 정수인 것을 특징으로 하는,발진기 시스템
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제 5 항에 있어서, 상기 프랙탈 구조는,제 1 내지 제 3 기본 단위를 포함하고,상기 제 1 기본 단위의 노드와 상기 제 2 기본 단위의 노드가 연결되어 제 4 노드를 형성하고,상기 제 2 기본 단위의 노드와 상기 제 3 기본 단위의 노드가 연결되어 제 5 노드를 형성하며,상기 제 3 기본 단위의 노드와 상기 제 1 기본 단위의 노드가 연결되어 제 6 노드를 형성하는 것을 특징으로 하는,발진기 시스템
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9
제 1 항에 있어서,상기 제 1 및 제 2 오실레이터는 동일한 주파수 및 동일한 위상을 갖는 것을 특징으로 하는,발진기 시스템
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10
제 1 항에 있어서,상기 프랙탈 구조는 전체로서 삼각형 형상을 형성하는 것을 특징으로 하는,발진기 시스템
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제 10 항에 있어서,상기 프랙탈 구조는 형성하는 제 1 및 제 2 링오실레이터는 각각 30개의 반전 증폭기로 구성되는 것을 특징으로 하는,발진기 시스템
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삭제
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제 1 항에 있어서,상기 서로 다른 2개의 칩은 적어도 세 개의 클럭 버스 라인에 의해서 연결되는 것을 특징으로 하는,발진기 시스템
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제 1 항에 있어서,상기 제 1 및 제 2 링오실레이터는 CMOS(Complementary metal-oxide-semiconductor)로 레이아웃 되는 것을 특징으로 하는,발진기 시스템
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제 1 항에 있어서,상기 제 1 및 제 2 링오실레이터의 구조는 홀수 개의 반전 증폭기가 직렬로 연결된 형태인 것을 특징으로 하는,발진기 시스템
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