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광대역 출력을 갖는 이완 발진기 회로 구조

  • 기술번호 : KST2019002194
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명에 따른 이완 발진기(relaxation oscillator)는, 트랜지스터의 드레인에 연결된 전류 DAC (Current Digital-to-Analog Converter); 상기 트랜지스터의 소스와 접지 사이에 연결된 커패시터(C1); 상기 커패시터와 입력이 연결되고, 입력 전압(VC1)이 입력 트랜지스터(M1)의 임계 전압(Vth, M1)보다 큰 경우 동작하도록 구성된 비교기(Slicer); 및 상기 비교기로부터 출력(out)을 입력으로 피드백하고, 초기화 신호에 해당하는 출력(rst)이 제2 트랜지스터를 통해 상기 소스로 입력되는 논리회로를 포함하고, 낮은 속도에서부터 빠른 속도까지의 클럭을 생성해 낼 수 있으며, 특히 낮은 주파수 대역의 클럭에 대해서 안정성 있는 주파수 출력을 나타낸다.
Int. CL H03K 3/0231 (2006.01.01) H03K 3/011 (2006.01.01)
CPC H03K 3/0231(2013.01) H03K 3/0231(2013.01)
출원번호/일자 1020170112805 (2017.09.04)
출원인 국방과학연구소
등록번호/일자
공개번호/일자 10-2019-0026275 (2019.03.13) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2017.09.04)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 국방과학연구소 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김재하 대한민국 서울특별시 용산구
2 정성엽 대한민국 서울특별시 관악구

대리인

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번호 이름 국적 주소
1 박장원 대한민국 서울특별시 강남구 강남대로 ***, *층~*층 (논현동, 비너스빌딩)(박장원특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 국방과학연구소 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2017.09.04 수리 (Accepted) 1-1-2017-0858346-17
2 선행기술조사의뢰서
Request for Prior Art Search
2018.06.12 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2018.08.07 수리 (Accepted) 9-1-2018-0039760-51
4 의견제출통지서
Notification of reason for refusal
2018.09.14 발송처리완료 (Completion of Transmission) 9-5-2018-0630250-23
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2018.11.13 수리 (Accepted) 1-1-2018-1128121-32
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2018.11.13 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-1128122-88
7 최후의견제출통지서
Notification of reason for final refusal
2019.02.14 발송처리완료 (Completion of Transmission) 9-5-2019-0110748-30
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2019.02.28 수리 (Accepted) 1-1-2019-0214741-81
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2019.02.28 보정승인 (Acceptance of amendment) 1-1-2019-0214752-83
10 등록결정서
Decision to grant
2019.03.15 발송처리완료 (Completion of Transmission) 9-5-2019-0192504-18
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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이완 발진기(relaxation oscillator)에 있어서,트랜지스터의 드레인에 연결된 전류 DAC (Current Digital-to-Analog Converter);상기 트랜지스터의 소스와 접지 사이에 연결된 커패시터(C1);입력 트랜지스터(M1)를 구비하는 비교기(Slicer) - 상기 커패시터와 상기 비교기의 입력이 연결되고, 상기 비교기는 상기 입력의 입력 전압(VC1)이 입력 트랜지스터(M1)의 임계 전압(Vth, M1)보다 큰 경우 동작하도록 구성됨 - ; 및상기 비교기로부터 출력(out)을 피드백 받는 논리회로 - 상기 비교기로부터의 출력(out)이 상기 논리회로의 입력으로 피드백되고, 초기화 신호에 해당하는 상기 논리회로의 출력(rst)이 상기 출력(rst)에 연결된 제2 트랜지스터를 통해 상기 제2 트랜지스터의 드레인이 상기 전류 DAC에 연결된 트랜지스터의 소스로 입력됨 - 를 포함하는, 이완 발진기
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제 1항에 있어서, 상기 비교기(Slicer)는,상기 커패시터 양 단의 전압(VC1)이 게이트 단자에 인가되도록 구성된 상기 입력 트랜지스터(M1); 소스 단자가 상기 입력 트랜지스터(M1)의 소스 단자와 병렬로 연결되도록 구성되고, 게이트 단자가 직렬 형태의 다수의 제2 논리 회로를 통해 상기 비교기의 출력 단자와 연결되도록 구성된 제2 입력 트랜지스터; 및게이트 단자가 상기 입력 트랜지스터(M1)의 드레인 단자와 병렬로 연결되도록 구성된 제3 입력 트렌지스터를 포함하는, 이완 발진기
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제 2항에 있어서, 상기 비교기(Slicer)는,드레인 단자가 상기 제2 입력 트랜지스터의 게이트 단자와 상기 다수의 제2 논리 회로의 입력 단자와 함께 연결되도록 구성된 제1 리셋 트랜지스터;드레인 단자가 상기 입력 트랜지스터(M1)의 소스 단자와 직렬로 연결되도록 구성된 제2 리셋 트랜지스터;소스 단자가 상기 입력 트랜지스터(M1)의 드레인 단자와 직렬로 연결되도록 구성된 제3 리셋 트랜지스터; 및소스 단자가 상기 제3 입력 트렌지스터의 드레인 단자와 직렬로 연결되도록 구성된 제4 리셋 트랜지스터를 포함하는, 이완 발진기
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제 1항에 있어서, 상기 비교기(Slicer)는 상기 비교기의 외부에서 입력되는 기준 전류원(IREF)를 사용하는 것을 특징으로 하는, 이완 발진기
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.