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서로 다른 홀 사이즈로 형성된 수직 채널 구조를 포함하는 3차원 플래시 메모리 소자 및 그 제조 방법

  • 기술번호 : KST2019006455
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 서로 다른 홀 사이즈로 형성된 수직 채널 구조를 포함하는 3차원 플래시 메모리 소자 및 그 제조 방법에 관한 것으로서, 수직 셀 그룹별로 서로 다른 홀 사이즈(Hole size)를 포함하는 구조를 형성하여 100단 이상의 고단 3차원 플래시 메모리 아키텍처에서 안정적인 수직 채널층을 형성시킬 수 있다.
Int. CL H01L 27/11556 (2017.01.01) H01L 27/11524 (2017.01.01) H01L 27/11529 (2017.01.01) H01L 29/788 (2006.01.01)
CPC H01L 27/11556(2013.01) H01L 27/11556(2013.01) H01L 27/11556(2013.01) H01L 27/11556(2013.01)
출원번호/일자 1020170159151 (2017.11.27)
출원인 한양대학교 산학협력단
등록번호/일자 10-2024715-0000 (2019.09.18)
공개번호/일자 10-2019-0061124 (2019.06.05) 문서열기
공고번호/일자 (20190924) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2017.11.27)
심사청구항수 14

출원인

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번호 이름 국적 주소
1 한양대학교 산학협력단 대한민국 서울특별시 성동구

발명자

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번호 이름 국적 주소
1 송윤흡 경기도 성남시 분당구

대리인

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번호 이름 국적 주소
1 양성보 대한민국 서울특별시 강남구 선릉로***길 ** (논현동) 삼성빌딩 *층(피앤티특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 삼성전자 주식회사 경기도 수원시 영통구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2017.11.27 수리 (Accepted) 1-1-2017-1177083-98
2 선행기술조사의뢰서
Request for Prior Art Search
2018.06.11 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2018.08.07 수리 (Accepted) 9-1-2018-0039233-12
4 의견제출통지서
Notification of reason for refusal
2019.01.05 발송처리완료 (Completion of Transmission) 9-5-2019-0014039-58
5 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2019.03.05 수리 (Accepted) 1-1-2019-0224177-18
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2019.04.05 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2019-0350139-61
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2019.04.05 수리 (Accepted) 1-1-2019-0350138-15
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.05 수리 (Accepted) 4-1-2019-5155816-75
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.06 수리 (Accepted) 4-1-2019-5156285-09
10 등록결정서
Decision to grant
2019.08.30 발송처리완료 (Completion of Transmission) 9-5-2019-0626116-19
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
3차원 플래시 메모리(3D Flash Memory)의 3차원 소자에 있어서,적층되어 수직 셀 그룹별로 구성된 복수의 수평 전극층; 및상기 수직 셀 그룹별로 서로 다른 홀(Hole) 사이즈로 형성되며, 상기 복수의 수평 전극층에 직교되는 복수의 수직 채널층을 포함하되,상기 수직 채널층은상기 복수의 수평 전극층을 그룹화한 상부의 상기 수직 셀 그룹부터 하부의 상기 수직 셀 그룹까지 직경이 점차 줄어드는 서로 다른 홀(Hole) 사이즈로 형성되며, 하나의 그룹 내에서는 홀 사이즈가 일정하게 유지되는 것을 특징으로 하는, 3차원 소자
2 2
제1항에 있어서,상기 3차원 소자의 하부에 위치하는 수직 채널층 대비 상부에 위치하는 수직 채널층의 상기 홀 사이즈가 더 큰 것을 특징으로 하는 3차원 소자
3 3
제2항에 있어서,상기 수직 셀 그룹별로 형성된 상기 복수의 수직 채널층 각각은 서로 연결되며, 채널 물질이 홀(Hole) 내부로 필링(filling)되는 3차원 소자
4 4
제1항에 있어서,상기 수직 채널층은상기 수직 셀 그룹별로 구성된 상기 복수의 수평 전극층을 관통하는 관통홀에 형성되며, 상기 관통홀은 상기 수직 셀 그룹 마다 서로 다른 상기 홀 사이즈를 포함하는 3차원 소자
5 5
삭제
6 6
제4항에 있어서,상기 3차원 소자는상기 복수의 수평 전극층에 직교되는 상기 복수의 수직 채널층으로 지탱되는 것을 특징으로 하는 3차원 소자
7 7
제1항에 있어서,상기 수평 전극층은소자 형성 기판 상에 교대로 적층되어 형성되는 복수의 층간 절연막 및 복수의 패시베이션막 중 상기 복수의 패시베이션막을 식각하고, 패시베이션막이 식각된 셀에 도전성 물질을 증착하여 형성되는 3차원 소자
8 8
제7항에 있어서,상기 수평 전극층은상기 복수의 층간 절연막 상에서 상호간에 분리되어 형성되는 3차원 소자
9 9
삭제
10 10
3차원 플래시 메모리(3D Flash Memory)의 3차원 소자를 제조하는 방법에 있어서,적층되어 수직 셀 그룹별로 구성된 복수의 수평 전극층에 관통홀을 형성하고, 상기 관통홀의 스탠드를 형성하는 단계; 및상기 관통홀 내부로 채널 물질을 필링(filling)하여 수직 채널층을 형성하는 단계를 포함하되,상기 수직 채널층은상기 복수의 수평 전극층을 그룹화한 상부의 상기 수직 셀 그룹부터 하부의 상기 수직 셀 그룹까지 직경이 점차 줄어드는 서로 다른 홀(Hole) 사이즈로 형성되며, 하나의 그룹 내에서는 홀 사이즈가 일정하게 유지되는 것을 특징으로 하는, 제조 방법
11 11
제10항에 있어서,상기 복수의 수평 전극층에 직교되는 복수의 상기 수직 채널층으로 지탱되는 상기 3차원 소자를 형성하는 단계를 더 포함하는 제조 방법
12 12
제10항에 있어서,상기 관통홀 및 상기 관통홀의 스탠드를 형성하는 단계는 적층되어 제1 수직 셀 그룹으로 구성된 복수의 수평 전극층을 관통하는 제1 관통홀 및 상기 제1 관통홀의 스탠드를 형성하는 단계;상기 제1 수직 셀 그룹 하부에 위치하는 제2 수직 셀 그룹으로 구성된 복수의 수평 전극층을 관통하는 제2 관통홀 및 상기 제2 관통홀의 스탠드를 형성하는 단계; 및상기 제2 수직 셀 그룹 하부에 위치하는 제3 수직 셀 그룹으로 구성된 복수의 수평 전극층을 관통하는 제3 관통홀 및 상기 제3 관통홀의 스탠드를 형성하는 단계를 포함하는 제조 방법
13 13
제12항에 있어서,상기 관통홀 및 상기 관통홀의 스탠드를 형성하는 단계는 상기 제1 수직 셀 그룹, 상기 제2 수직 셀 그룹 및 상기 제3 수직 셀 그룹 각각에서, 일정한 홀(Hole) 사이즈를 유지하는 상기 제1 관통홀, 상기 제2 관통홀 및 상기 제3 관통홀을 형성하는 것을 특징으로 하는 제조 방법
14 14
제12항에 있어서,상기 3차원 소자의 하부에 위치하는 상기 제3 관통홀 대비 상부에 위치하는 상기 제1 관통홀의 홀(Hole) 사이즈가 더 큰 것을 특징으로 하는 제조 방법
15 15
제12항에 있어서,상기 수직 채널층을 형성하는 단계는서로 연결된 상기 제1 관통홀, 상기 제2 관통홀 및 상기 제3 관통홀 내부로 상기 채널 물질을 필링(filling)하여 복수의 상기 수직 채널층을 형성하는 제조 방법
16 16
제10항에 있어서,상기 복수의 수평 전극층은소자 형성 기판 상에 복수의 층간 절연막 및 복수의 패시베이션막(passivation layer)을 교대로 적층하는 단계;상기 복수의 패시베이션막을 식각하고, 상기 복수의 패시베이션막이 식각된 셀에 도전성 물질을 증착하는 단계; 및상기 복수의 층간 절연막을 식각하는 단계를 통해 형성되는 제조 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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