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채널 선택 신호에 따라 다수의 차동 입력 신호를 선택하여 출력하는 신호 입력부;상기 신호 입력부의 출력을 증폭하여 출력하는 증폭기; 및상기 증폭기의 출력을 디지털 값으로 변환하는 아날로그 디지털 변환기를 포함하되, 상기 신호 입력부는 선택된 차동 입력 신호의 극성을 제 1 쵸핑 신호에 따라 바꾸어 출력하고, 상기 아날로그 디지털 변환기는 상기 증폭기의 출력으로부터 비트 스트림을 출력하는 델타 시그마 변조기;상기 제 1 쵸핑 신호에 따라 상기 비트 스트림의 위상을 조절하여 출력하는 출력 쵸핑 회로; 및상기 출력 쵸핑 회로의 출력을 필터링하여 상기 디지털 값으로 출력하는 필터를 포함하는 반도체 장치
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청구항 1에 있어서, 상기 신호 입력부는쵸핑 스위치; 상기 채널 선택 신호 및 상기 제 1 쵸핑 신호에 따라 상기 쵸핑 스위치를 제어하는 쵸핑 스위치 제어부; 및상기 채널 선택 신호에 의해 제어되고 상기 쵸핑 스위치에 연결되는 더미 스위치를 포함하는 반도체 장치
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청구항 2에 있어서, 상기 쵸핑 스위치와 상기 더미 스위치는 각각 스위칭 소자를 포함하고, 상기 쵸핑 스위치에 포함된 스위칭 소자와 상기 더미 스위치에 포함된 스위칭 소자는 상보적으로 온오프되는 반도체 장치
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청구항 1에 있어서, 상기 증폭기는 입력 커패시터;상기 입력 커패시터의 일단과 연결되는 입력단을 구비하고 상기 입력단에 제공된 신호를 증폭하여 출력단에서 출력하는 증폭부; 및피드백 커패시터를 포함하며 상기 증폭부의 출력을 상기 입력단에 네거티브 피드백하는 제 2 피드백 회로를 포함하되,상기 증폭기의 이득은 상기 입력 커패시터와 상기 피드백 커패시터의 용량비로 결정되는 반도체 장치
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청구항 4에 있어서, 상기 증폭부는 상기 입력단이 차동 입력단이고 상기 출력단이 차동 출력단인 차동 증폭부이고,상기 입력 커패시터는 상기 차동 입력단에 연결되는 제 1 입력 커패시터와 제 2 입력 커패시터를 포함하고,상기 피드백 커패시터는 상기 차동 입력단에 연결되는 제 1 피드백 커패시터와 제 2 피드백 커패시터를 포함하며,상기 증폭기는 제 2 쵸핑 신호에 따라 상기 신호 입력부와 상기 제 1 입력 커패시터 및 상기 제 2 입력 커패시터 사이의 연결 경로를 변경하고 상기 제 2 쵸핑 신호에 따라 상기 차동 출력단과 상기 제 1 피드백 커패시터 및 상기 제 2 피드백 커패시터 사이의 연결 경로를 변경하는 쵸핑 회로를 더 포함하고,상기 증폭부는 그 내부에서 상기 제 2 쵸핑 신호에 따라 상기 차동 출력단에 제공하는 신호의 극성을 변경하는 반도체 장치
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6
청구항 5에 있어서, 상기 증폭기는 임피던스 부스팅 커패시터를 통해 상기 증폭부의 출력을 상기 입력 커패시터의 타단에 포지티브 피드백하는 제 3 피드백 회로를 포함하고,상기 임피던스 부스팅 커패시터는 상기 제 1 입력 커패시터와 연결되는 제 1 임피던스 부스팅 커패시터와 상기 제 2 입력 커패시터와 연결되는 제 2 임피던스 부스팅 커패시터를 포함하며,상기 증폭기는상기 제 2 쵸핑 신호에 따라 상기 차동 출력단과 상기 제 1 임피던스 부스팅 커패시터 및 상기 제 2 임피던스 부스팅 커패시터 사이의 연결 경로를 변경하는 쵸핑 회로를 더 포함하는 반도체 장치
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청구항 4에 있어서, 상기 증폭기는 상기 증폭부의 출력으로부터 리플 억제 신호를 생성하는 제 1 피드백 회로를 더 포함하고, 상기 증폭부는 상기 리플 억제 신호와 상기 입력단에 제공된 신호를 이용하여 증폭 동작을 수행하는 반도체 장치
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청구항 1에 있어서, 상기 제 1 쵸핑 신호의 주기는 상기 아날로그 디지털 변환기에서 디지털 변환 동작에 필요한 시간 이상으로 설정되는 반도체 장치
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청구항 1에 있어서, 상기 델타 시그마 변조기는 상기 제 1 쵸핑 신호의 반주기마다 활성화되는 리셋 신호에 따라 리셋되고, 상기 리셋 신호의 에지는 상기 제 1 쵸핑 신호의 에지와 정렬되는 반도체 장치
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청구항 1에 있어서, 상기 필터는 상기 출력 쵸핑 회로의 출력을 필터링하는 싱크 필터와 상기 싱크 필터의 출력을 필터링하여 상기 디지털 값으로 출력하는 FIR 필터를 포함하는 반도체 장치
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청구항 11에 있어서, 상기 FIR 필터는 상기 싱크 필터에서 출력되는 값들을 이동 평균하여 상기 디지털 값을 출력하는 반도체 장치
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청구항 1에 있어서, 상기 델타 시그마 변조기는 상기 증폭기의 출력 신호를 샘플링하는 제 1 커패시터와 상기 비트 스트림에 대응하는 아날로그 값을 샘플링하는 제 2 커패시터를 포함하는 샘플링부를 포함하되, 상기 아날로그 디지털 변환기의 이득은 상기 제 1 커패시터와 상기 제 2 커패시터의 용량비로 결정되는 반도체 장치
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14
청구항 13에 있어서, 상기 델타 시그마 변조기는 상기 샘플링부의 출력을 적분하는 적분 필터 및 상기 적분 필터의 출력으로부터 상기 비트 스트림을 출력하는 비교기를 더 포함하는 반도체 장치
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15
청구항 13에 있어서, 상기 비트 스트림 또는 상기 디지털 값에 따라 상기 제 1 커패시터 또는 상기 제 2 커패시터의 용량을 제어하는 용량 제어부를 더 포함하는 반도체 장치
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청구항 15에 있어서, 상기 용량 제어부는 상기 비트 스트림 또는 상기 디지털 값에 따라 상기 증폭기의 이득을 제어하는 반도체 장치
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