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수직 구조 박막 트랜지스터의 제조 방법

  • 기술번호 : KST2019019408
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 수직 구조 박막 트랜지스터의 제조 방법에 관한 것으로, 보다 상세하게는 열처리를 통하여 금속 전극의 계면을 산화시켜 게이트 절연막을 형성함으로써, 종래와 같이 게이트 절연막의 형성을 위해 별도의 절연재료가 요구되지 않으면서도 매우 얇은 절연막이 가능함과 동시에 채널 길이를 대폭 단축할 수 있는 수직 구조 박막 트랜지스터의 제조 방법에 관한 것이다.
Int. CL H01L 29/786 (2006.01.01)
CPC H01L 29/78642(2013.01) H01L 29/78642(2013.01) H01L 29/78642(2013.01)
출원번호/일자 1020180037454 (2018.03.30)
출원인 호서대학교 산학협력단
등록번호/일자
공개번호/일자 10-2019-0114551 (2019.10.10) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2018.03.30)
심사청구항수 11

출원인

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번호 이름 국적 주소
1 호서대학교 산학협력단 대한민국 충청남도 아산시

발명자

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번호 이름 국적 주소
1 배병성 경기도 수원시 팔달구
2 백영조 충청남도 아산시
3 황상호 충청남도 천안시 서북구
4 이상민 경기도 김포시 북변*로**번길

대리인

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번호 이름 국적 주소
1 조경화 대한민국 서울특별시 강남구 테헤란로**길 **, 한림빌딩 *층 (대치동)(국제특허법률사무소 미래연)

최종권리자

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번호 이름 국적 주소
1 호서대학교 산학협력단 충청남도 아산시
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2018.03.30 수리 (Accepted) 1-1-2018-0320266-79
2 선행기술조사의뢰서
Request for Prior Art Search
2018.08.09 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2018.10.12 수리 (Accepted) 9-1-2018-0053256-80
4 의견제출통지서
Notification of reason for refusal
2019.04.19 발송처리완료 (Completion of Transmission) 9-5-2019-0283572-14
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2019.06.18 수리 (Accepted) 1-1-2019-0620519-18
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2019.06.18 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2019-0620530-11
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.30 수리 (Accepted) 4-1-2019-0045360-16
8 등록결정서
Decision to grant
2019.10.04 발송처리완료 (Completion of Transmission) 9-5-2019-0721830-41
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번호 청구항
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삭제
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삭제
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기판상에 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극을 순차 적층 및 패터닝하여 형성하는 제 1 단계;상기 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극의 외측으로 산화물 반도체를 증착 및 패터닝하여 상기 금속 전극 측면에 활성층을 형성하는 제 2 단계; 및열처리를 통하여 상기 금속 전극의 계면을 산화시켜 게이트 절연막을 형성하는 제 3 단계를 포함하며, 상기 제 1 단계는,상기 기판상에 제 1 전도성 박막을 형성하는 단계;제 1 전도성 박막을 패터닝하여 제 1 산화물 전극을 형성하는 단계;상기 제 1 산화물 전극상에 금속 전극을 형성하기 위한 금속 박막을 형성하는 단계;상기 금속 박막을 패터닝하여 금속 전극을 형성하는 단계;상기 금속 전극의 상측에 제 2 전도성 박막을 형성하는 단계; 및 제 2 전도성 박막을 패터닝하여 제 2 산화물 전극을 형성하는 단계를 포함하여 이루어지는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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제 3 항에 있어서,상기 금속 박막을 형성하는 단계는, 상기 패터닝된 제 1 산화물 전극 및 노출된 기판상에 금속 박막을 증착하는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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제 3 항에 있어서,상기 제 2 전도성 박막을 형성하는 단계는, 상측으로 노출된 기판의 상측 외곽, 상기 제 1 산화물 전극의 상면 일측, 및 상기 금속 전극의 상측에 전도성 박막을 증착하여 형성하는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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기판상에 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극을 순차 적층 및 패터닝하여 형성하는 제 1 단계;상기 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극의 외측으로 산화물 반도체를 증착 및 패터닝하여 상기 금속 전극 측면에 활성층을 형성하는 제 2 단계; 및열처리를 통하여 상기 금속 전극의 계면을 산화시켜 게이트 절연막을 형성하는 제 3 단계를 포함하며,상기 제 1 단계는,상기 기판상에 제 1 전도성 박막을 형성하는 단계;제 1 전도성 박막을 패터닝하여 제 1 산화물 전극을 형성하는 단계;상기 패터닝된 제 1 산화물 전극 상에 제 1 절연막을 형성하는 단계; 상기 제 1 절연막상에 금속 전극을 형성하기 위한 금속 박막을 형성하는 단계;상기 제 1 절연막 및 금속 박막 패터닝하여 금속 전극을 형성하는 단계;상기 패터닝된 금속 전극 상에 제 2 절연막을 형성하는 단계;상기 제 2 절연막 상에 제 2 전도성 박막을 형성하는 단계; 및 제 2 전도성 박막을 패터닝하여 제 2 산화물 전극을 형성하는 단계를 포함하여 이루어지는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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제 6 항에 있어서,상기 제 1 절연막을 형성하는 단계에서는, 상기 패터닝된 제 1 산화물 전극 및 노출된 기판상에 제 1 절연막이 형성되는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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제 6 항에 있어서,상기 제 2 절연막을 형성하는 단계에서는, 상기 패터닝된 금속 전극 및 노출된 기판 상부 전체에 제 2 절연막이 형성되는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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기판상에 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극을 순차 적층 및 패터닝하여 형성하는 제 1 단계;상기 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극의 외측으로 산화물 반도체를 증착 및 패터닝하여 상기 금속 전극 측면에 활성층을 형성하는 제 2 단계; 및열처리를 통하여 상기 금속 전극의 계면을 산화시켜 게이트 절연막을 형성하는 제 3 단계를 포함하며, 상기 제 1 산화물 전극, 상기 금속 전극, 및 상기 2 산화물 전극의 형성은 기판상에 쉐도우 마스크를 배치하여 전극 패턴을 형성하는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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기판상에 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극을 순차 적층 및 패터닝하여 형성하는 제 1 단계;상기 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극의 외측으로 산화물 반도체를 증착 및 패터닝하여 상기 금속 전극 측면에 활성층을 형성하는 제 2 단계; 및열처리를 통하여 상기 금속 전극의 계면을 산화시켜 게이트 절연막을 형성하는 제 3 단계를 포함하며, 상기 제 2 단계는,외부로 노출된 상기 제 1 산화물 전극의 상면 일측, 상기 금속 전극의 일측 단부면, 및 상기 제 2 산화물 전극의 상면 및 측면 전체에 산화물 반도체를 증착하는 단계; 및상기 산화물 반도체를 패터닝하여 상기 제 1 산화물 전극의 상면 일측, 상기 금속 전극의 일측 단부면, 상기 금속 전극의 일측 단부면과 일직선을 이루는 상기 상기 제 2 산화물 전극의 일측면, 및 상기 제 2 산화물 전극의 상측면 일부에 걸쳐서 상기 활성층을 형성하는 단계를 포함하여 이루어지는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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기판상에 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극을 순차 적층 및 패터닝하여 형성하는 제 1 단계;상기 제 1 산화물 전극, 금속 전극, 및 제 2 산화물 전극의 외측으로 산화물 반도체를 증착 및 패터닝하여 상기 금속 전극 측면에 활성층을 형성하는 제 2 단계; 및열처리를 통하여 상기 금속 전극의 계면을 산화시켜 게이트 절연막을 형성하는 제 3 단계를 포함하며, 상기 제 3 단계에서는,상기 금속 전극의 전체 계면을 따라 산화되어 계면 산화에 의해 상기 금속 전극과 상기 제 1 및 2 산화물 전극 및 상기 활성층 사이에 상기 게이트 절연막이 형성되어지는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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제 11 항에 있어서,상기 열처리로 인해 산화물인 상기 제 1 및 2 산화물 전극 및 상기 활성층의 산소(O) 결합이 끊어지며, 산소(O)는 게이트 전극인 금속 전극과 결합되는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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제 11 항에 있어서,상기 계면 산화시에 상기 금속 전극에 양의 전압을 가하거나 산소분위기에서 자외선을 조사하는 것을 특징으로 하는 수직 구조 박막 트랜지스터의 제조 방법
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순번 연구부처 주관기관 연구사업 연구과제
1 한국연구재단 호서대학교 2017년도 이공학개인기초연구 한국형SGER 계면 산화를 이용한 초저소비전력 수직구조 박막 트랜지스터 및 회로 개발