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데이터와 클럭을 입력 받아 복수의 엣지 신호를 생성하는 4비트 디바이더 및 엣지 생성기; 상기 4비트 디바이더 및 엣지 생성기를 통해 생성된 상기 복수의 엣지 신호를 전달 받아 상기 데이터의 위상과 상기 클럭의 위상을 비교하여 업(up) 또는 다운(down) 신호를 발생시키는 선형 위상 검출기; 상기 선형 위상 검출기에서의 업(up) 또는 다운(down) 신호에 따라 제어 전압을 변화시키기 위한 전류를 생성하는 전하 펌프; 상기 전하 펌프로부터 입력되는 전류에 따라 전류를 소싱하거나 싱크하여 제어 전압을 변화시키는 루프 필터; 및 상기 전하 펌프 및 상기 루프 필터에 의해 변화된 제어 전압에 따라 클럭 주파수가 변화되며, 변화된 주파수를 갖는 상기 클럭을 복원하여 상기 4비트 디바이더 및 엣지 생성기로 피드백시키는 전압 제어 발진기를 포함하고, 상기 선형 위상 검출기는, 복수의 AND 게이트와 복수의 D 플립플롭을 포함하는 타임 매칭 선형 위상 검출기(Time-Matching Linear Phase Detector, TMLPD)로 이루어지며, 상기 데이터와 상기 클럭의 위상 고정 후, 업(up) 신호와 다운(down) 신호가 동시에 발생되어 리플이 발생되지 않아 저 지터 성능을 가지고, 상기 타임 매칭 선형 위상 검출기는, 상기 복수의 엣지 신호를 전달 받아 데이터의 엣지 신호(d_edge)와 클럭의 엣지 신호(c_edge)가 하이(high)인 경우, 스타트(start) 신호를 발생시키는 제1 AND 게이트; 상기 제1 AND 게이트에서 상기 스타트(start) 신호를 발생시킴에 따라 이네이블(enable, en) 신호를 발생시키는 제1 D 플립플롭; 상기 제1 D 플립플롭에서 상기 이네이블 신호를 발생시킴에 따라 각각 상기 데이터의 엣지 신호(d_edge)의 하강 엣지에 업(up) 신호를 발생시키고, 상기 클럭의 엣지 신호(c_edge)의 하강 엣지에 다운(down) 신호가 발생시키는 제2, 제3 D 플립플롭; 및 상기 업(up) 신호와 다운(down) 신호가 순차적으로 발생된 후, 리셋(reset) 신호를 발생시켜 제1, 제2, 및 제3 D 플립플롭을 리셋시키는 AND 게이트를 포함하는 업 또는 다운 펄스 타이밍 매칭을 이용한 저 지터 선형 위상 고정 루프
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제1항에 있어서,상기 4비트 디바이더는, 16번의 데이터 하강 엣지마다 카운터가 출력되는 4비트 카운터; 및 상기 4비트 카운터에서의 출력되는 카운터에 따라 온(on)되어 상기 데이터를 통과시키는 스위치를 포함하고, 상기 엣지 생성기는, 상기 데이터와 클럭을 입력 받아 상기 4비트 디바이더를 통과한 데이터의 상승 엣지마다 딜레이를 가진 신호를 발생시키는 것을 특징으로 하는 업 또는 다운 펄스 타이밍 매칭을 이용한 저 지터 선형 위상 고정 루프
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제1항에 있어서,상기 전하 펌프는, 상기 선형 위상 검출기에서의 업(up) 또는 다운(down) 신호에 따라 상기 데이터의 위상과 상기 클럭의 위상을 일치시키는 방향으로 동작되도록 상기 전압 제어 발진기의 제어 전압을 변화시키는 업 또는 다운 전류를 생성하고, 상기 루프 필터는, 상기 전하 펌프로부터 입력되는 업 또는 다운 전류에 상응하는 제어 전압을 출력하는 것을 특징으로 하는 업 또는 다운 펄스 타이밍 매칭을 이용한 저 지터 선형 위상 고정 루프
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제2항에 있어서,상기 루프 필터는, 저항 및 복수의 커패시터를 포함하고, 상기 4비트 디바이더와 상기 엣지 생성기에 의해 상승 엣지마다 딜레이를 가진 신호를 발생시켜 데이터의 속도가 16배 감소되어, 상기 저항의 사이즈는 16배 증가하고, 상기 복수의 커패시터의 사이즈는 16배 감소되어 전체적인 칩 면적이 감소되는 것을 특징으로 하는 업 또는 다운 펄스 타이밍 매칭을 이용한 저 지터 선형 위상 고정 루프
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제1항에 있어서,상기 전압 제어 발진기는, 광-대역 링-전압 제어 발진기(Ring-Voltage Control Oscillator, Ring-VCO)로 이루어지는 것을 특징으로 하는 업 또는 다운 펄스 타이밍 매칭을 이용한 저 지터 선형 위상 고정 루프
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