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게이트 페어된 제1 트랜지스터와 제2 트랜지스터를 포함하는 제1 페어드 게이트(paired gate) 회로와, 게이트 페어된 제3 트랜지스터와 제4 트랜지스터를 포함하는 제2 페어드 게이트 회로를 포함하는 제1 도전형 MOS 모디파이드 캐스코드(modified cascode) 전류 미러 회로 및게이트 페어된 제5 트랜지스터와 제6 트랜지스터를 포함하는 제3 페어드 게이트 회로와, 게이트 페어된 제7 트랜지스터와 제8 트랜지스터를 포함하는 제4 페어드 게이트 회로를 포함하는 제2 도전형 MOS 모디파이드 캐스코드(modified cascode) 전류 미러 회로를 포함하며,상기 제1 도전형 MOS 모디파이드 캐스코드(modified cascode) 전류 미러 회로와 상기 제2 도전형 MOS 모디파이드 캐스코드 전류 미러 회로는 캐스코드로 연결되며,상기 제7 트랜지스터의 소스 전극은 상기 제2 페어드 게이트 회로의 게이트 전극에 연결되어 바이어스를 제공하고, 상기 제4 트랜지스터의 소스 전극은 상기 제4 페어드 게이트 회로의 게이트 전극에 연결되어 바이어스를 제공하는 콘스탄트 트랜스 컨덕턴스 전류 소스(constant trans-conductance current source)
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제1항에 있어서, 상기 제1 페어드 게이트 회로와 상기 제2 페어드 게이트 회로는 캐스코드로 연결되고, 상기 제3 페어드 게이트 회로와 상기 제4 페어드 게이트 회로는 캐스코드로 연결된 콘스탄트 트랜스 컨덕턴스 전류 소스
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제1항에 있어서, 상기 제1 트랜지스터와 제2 트랜지스터의 게이트 전극은 상기 제4 트랜지스터의 드레인 전극에 연결되고, 상기 제5 트랜지스터와 제6 트랜지스터의 게이트 전극은 상기 제8 트랜지스터의 드레인 전극에 연결된 콘스탄트 트랜스 컨덕턴스 전류 소스
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제1항에 있어서, 상기 콘스탄트 트랜스 컨덕턴스 전류 소스는 제1 트랜지스터의 소스 전극에 연결된 전류 정합 저항(current matching resistor)을 더 포함하는 콘스탄트 트랜스 컨덕턴스 전류 소스
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게이트 페어된 제1 트랜지스터와 제2 트랜지스터를 포함하는 제1 페어드 게이트(paired gate) 회로와, 게이트 페어된 제3 트랜지스터와 제4 트랜지스터를 포함하는 제2 페어드 게이트 회로를 포함하는 제1 도전형 MOS 모디파이드 캐스코드(modified cascode) 전류 미러 회로와, 게이트 페어된 제5 트랜지스터와 제6 트랜지스터를 포함하는 제3 페어드 게이트 회로와, 게이트 페어된 제7 트랜지스터와 제8 트랜지스터를 포함하는 제4 페어드 게이트 회로를 포함하는 제2 도전형 MOS 모디파이드 캐스코드(modified cascode) 전류 미러 회로를 포함하며, 상기 제1 도전형 MOS 모디파이드 캐스코드(modified cascode) 전류 미러 회로와 상기 제2 도전형 MOS 모디파이드 캐스코드 전류 미러 회로는 캐스코드로 연결된 콘스탄트 트랜스 컨덕턴스 전류 소스; 및 차동 연산 증폭기를 포함하는 연산 증폭기로, 상기 차동 연산 증폭기는 상기 콘스탄트 트랜스 컨덕턴스 전류 소스가 제공하는 전압을 제공받아 전류를 미러링하며, 상기 제7 트랜지스터의 소스 전극은 상기 제2 페어드 게이트 회로의 게이트 전극에 연결되어 바이어스를 제공하고, 상기 제4 트랜지스터의 소스 전극은 상기 제4 페어드 게이트 회로의 게이트 전극에 연결되어 바이어스를 제공하는 연산 증폭기
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제6항에 있어서, 상기 제1 페어드 게이트 회로와 상기 제2 페어드 게이트 회로는 캐스코드로 연결되고, 상기 제3 페어드 게이트 회로와 상기 제4 페어드 게이트 회로는 캐스코드로 연결된 연산 증폭기
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제6항에 있어서, 상기 제1 트랜지스터와 제2 트랜지스터의 게이트 전극은 상기 제4 트랜지스터의 드레인 전극에 연결되고, 상기 제5 트랜지스터와 제6 트랜지스터의 게이트 전극은 상기 제8 트랜지스터의 드레인 전극에 연결된 연산 증폭기
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제6항에 있어서, 상기 콘스탄트 트랜스 컨덕턴스 전류 소스는 제4 트랜지스터의 소스 전극에 연결되어 전류 정합 저항(current matching resistor)을 더 포함하는 연산 증폭기
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