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디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기

  • 기술번호 : KST2019034618
  • 담당센터 : 대구기술혁신센터
  • 전화번호 : 053-550-1450
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기를 구현함에 있어서, 여러 번의 곱셈누적 연산을 저전력이며 병렬적으로 연산하는 기술에 관한 것이다.이를 위해, 직렬 변환기를 이용하여 다중 비트를 비트 직렬 방식으로 전송하며 여러 개의 AND 게이트를 이용하여 병렬적으로 한 비트의 곱셈을 생성하고 1진법의 디지털-아날로그 변환기를 통해 아날로그 영역에서 여러 번의 한 비트 곱셈누적 연산을 한 번에 수행한다. 상기 계산 결과를 아날로그-디지털 변환기를 통해 디지털 값으로 변환하고, 이를 해당 자릿수에 맞게 산술자리이동 후 누적하여 최종 결과를 얻는다.
Int. CL G06F 7/46 (2006.01.01) H03M 1/36 (2006.01.01)
CPC G06F 7/462(2013.01) G06F 7/462(2013.01) G06F 7/462(2013.01) G06F 7/462(2013.01)
출원번호/일자 1020160164380 (2016.12.05)
출원인 포항공과대학교 산학협력단
등록번호/일자 10-1827779-0000 (2018.02.05)
공개번호/일자
공고번호/일자 (20180209) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.12.05)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 포항공과대학교 산학협력단 대한민국 경상북도 포항시 남구

발명자

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번호 이름 국적 주소
1 심재윤 대한민국 경상북도 포항시 남구
2 손현우 대한민국 경기도 부천시 평천로 ***, **

대리인

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번호 이름 국적 주소
1 이철희 대한민국 서울특별시 강남구 삼성로***길 *, ***호 가디언국제특허법률사무소 (삼성동, 우경빌딩)

최종권리자

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번호 이름 국적 주소
1 포항공과대학교 산학협력단 경상북도 포항시 남구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2016.12.05 수리 (Accepted) 1-1-2016-1190580-94
2 의견제출통지서
Notification of reason for refusal		 2017.12.19 발송처리완료 (Completion of Transmission) 9-5-2017-0889758-76
3 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2018.01.19 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0067795-96
4 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2018.01.19 수리 (Accepted) 1-1-2018-0067796-31
5 등록결정서
Decision to grant		 2018.01.31 발송처리완료 (Completion of Transmission) 9-5-2018-0073887-20
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.11.20 수리 (Accepted) 4-1-2019-5243581-27
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.11.22 수리 (Accepted) 4-1-2019-5245997-53
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.11.25 수리 (Accepted) 4-1-2019-5247115-68
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
다중 비트를 갖는 피승수와 승수를 비트 직렬 방식으로 출력하는 직렬 변환부;상기 직렬 변환부에서 출력된 피승수와 승수 각각의 한 비트의 부분 곱을 생성하는 앤드 게이트부; 상기 한 비트의 부분 곱들 중 논리 값 '1'을 갖는 부분 곱의 개수에 비례하여 아날로그 전압을 생성하는 1진법의 디지털-아날로그 변환기;상기 아날로그 전압을 디지털 값으로 변환하는 아날로그-디지털 변환기; 및 상기 변환된 디지털 값을 비트 직렬 방식의 자릿수에 맞게 산술자리이동 후 덧셈기를 이용해 누적하여 최종 디지털 값을 추력하는 누산기;를 포함하는 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
2 2
제 1항에 있어서, 상기 직렬 변환부는상기 다중 비트를 갖는 피승수와 승수가 각각 N개(N은 자연수)인 경우, 2N개의 직렬 변환기를 포함하는 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
3 3
제 2항에 있어서, 상기 앤드 게이트부는N개의 앤드 게이트를 포함하는 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
4 4
제 3항에 있어서, 상기 디지털-아날로그 변환기는저항을 이용하여 전류를 생성하고 이를 더하여 아날로그 출력전압을 출력하는 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
5 5
제 3항에 있어서, 상기 디지털-아날로그 변환기는상기 앤드 게이트부로부터 생성되는 한 비트의 부분곱들을 입력받아 전류를 생성하는 입력저항부;상기 입력저항부의 양단에 흐르는 전류를 입력받아 아날로그 출력전압을 생성하는 연산증폭기; 및상기 연산증폭기의 출력단자 및 상기 연산증폭기의 반전 입력단자 사이에 위치하는 피드백 저항;을 포함하는 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
6 6
제 5항에 있어서, 상기 입력저항부는동일한 저항 값을 갖는 N개의 입력저항을 포함하는 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
7 7
제 5항에 있어서, 상기 입력저항부는N개의 전류원 및 상기 N개의 전류원에 각각 직렬로 연결된 N개의 스위치로 이루어진 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
8 8
제 1항에 있어서, 상기 누산기는자릿수에 따른 가중치를 위한 산술자리이동 및 음수 표현을 위해 2의 보수로 변환하여 누적하는 것을 특징으로 하는 디지털-아날로그 변환기와 아날로그-디지털 변환기를 이용한 비트 직렬 곱셈누적 연산기
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 KIST 한국과학기술연구원 포항공과대학교 산학협력단 개방형 연구 사업 (Open Research Program) TEMPORAL LEARNING 신경망모사 회로 설계