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미리 설계된 주파수의 발진신호를 생성하는 자유 구동 발진기; 상기 발진신호를 이용하여 위상이 고정된 출력클럭신호 및 출력위상신호를 생성하는 직접 디지털주파수 합성기 및 상기 출력클럭신호를 처리하여 아웃 오브 밴드 노이즈를 줄이는 위상 간섭기를 포함하되,상기 직접 디지털주파수 합성기는 상기 출력위상신호를 동기기준클럭신호로 샘플링하여 상기 출력클럭신호와 상기 동기기준클럭신호의 위상 차이에 상응되는 위상차신호를 출력하는 샘플링 D형 플립플롭;상기 위상차신호를 필터링하여 상기 출력클럭신호의 주파수를 조절하기 위한 제1주파수코드를 생성하는 디지털 루프 필터; 상기 발진신호의 매 주기 마다 제1주파수코드와 제2주파수코드의 합인 합주파수코드를 모듈러스 방식으로 축적하고, 상기 축적된 출력값 중에서 최상위 비트를 상기 출력클럭신호로 출력하는 순환 축적기;상기 발진신호로 기준클럭신호를 샘플링하여 상기 발진신호에 동기된 상기 동기기준클럭신호를 생성하는 리타이머; 및상기 출력클럭신호가 서브 샘플링 방식으로 고조파 고정되는 것을 방지하기 위해 상기 제2주파수코드를 생성하여 상기 순환 축적기의 입력측에 출력하는 코스 주파수 고정기를 포함하고,상기 샘플링 D형 플립플롭, 상기 디지털 루프 필터 및 상기 순환 축적기는 파인 고정 루프(Fine Lock Loop)를 형성하고,상기 코스 주파수 고정기 및 상기 순환 축적기는 코스 고정 루프(Coarse Lock Loop)를 형성하되,상기 코스 주파수 고정기는상기 파인 고정 루프가 동작하기 전에 상기 출력클럭신호의 초기 주파수를 결정하는 상기 제2주파수코드의 오프셋 값을 생성하고,상기 파인 고정 루프는상기 코스 주파수 고정기에서 상기 제2주파수코드의 오프셋 값이 생성된 후 동작을 시작하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 디지털 루프필터는 상기 샘플링 D형 플립플롭에서 상기 위상차신호가 출력되면 상기 위상차신호를 필터링하여 상기 제1주파수코드를 생성하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 직접 디지털주파수 합성기는 상기 동기기준클럭신호의 매 주기마다 분수 주파수코드를 누산하고 이에 따른 분수누산값으로 상기 위상차신호를 보상하는 분수 누산기를 포함하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 샘플링 D형 플립플롭 및 순환 축적기는상기 위상 고정루프에서 디지털-아날로그 변환과 아날로그-디지털 변환을 거치며 생기는 비선형성(nonlinearity)을 제거해주는 역할을 수행하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 순환 축적기는상기 축적된 출력값이 미리 설정된 최대값을 초과하더라도 모듈러스 방식으로 계속 입력값을 축적하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 리타이머는 D형 플립플롭을 이용하여 상기 동기기준클럭신호를 생성하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 위상 간섭기에서 출력되는 출력클럭신호(fOUT)는 다음의 [수학식]으로 표현되는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 위상 간섭기는 상기 출력위상신호의 하위비트들을 이용하여 위상간섭하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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제1항에 있어서, 상기 리타이머는 독립적인 주파수를 갖는 상기 발진신호와 상기 동기기준클럭신호를 하나의 클럭신호로 동기화시키기 위하여, 상기 발진신호로 기준클럭신호를 샘플링하여 상기 발진신호에 동기된 상기 동기기준클럭신호를 생성하는 D형 플립플롭을 포함하는 것을 특징으로 하는 직접 디지털 주파수 합성기를 이용한 위상 고정루프
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