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반도체 소자 및 이의 제조 방법

  • 기술번호 : KST2020004506
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명에 따른 반도체 소자 제조 방법은 기판을 준비하는 단계; 상기 기판에서 전극이 형성될 영역에 요철을 형성하는 단계; 상기 요철이 형성된 기판 상에 이차원 소재의 전구체 막을 형성하는 단계; 상기 형성된 전구체 막에 대하여 칼코겐화 공정을 수행하여 금속 칼코겐 막을 형성하는 단계 및 상기 형성된 금속 칼코겐 막 위에 전극을 형성하는 단계를 포함한다.
Int. CL H01L 29/16 (2006.01.01) H01L 21/02 (2006.01.01) H01L 21/285 (2006.01.01) H01L 29/06 (2006.01.01)
CPC
출원번호/일자 1020190132561 (2019.10.23)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2020-0050380 (2020.05.11) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020180132739   |   2018.11.01
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 20

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 윤선진 대전광역시 유성구
2 정광훈 경상남도 창원시 성산구
3 김소현 대전광역시 대덕구
4 임정욱 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인지명 대한민국 서울특별시 강남구 남부순환로**** 차우빌딩*층

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2019.10.23 수리 (Accepted) 1-1-2019-1085665-49
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번호 청구항
1 1
기판을 준비하는 단계;상기 기판에서 전극이 형성될 영역에 요철을 형성하는 단계;상기 요철이 형성된 기판 상에 이차원 소재의 전구체 막을 형성하는 단계;상기 형성된 전구체 막에 대하여 칼코겐화 공정을 수행하여 금속 칼코겐 막을 형성하는 단계 및상기 형성된 금속 칼코겐 막 위에 전극을 형성하는 단계를 포함하는 반도체 소자 제조 방법
2 2
제 1 항에 있어서,상기 기판에는 전극이 형성되어 있는 것을 특징으로 하는 반도체 소자 제조 방법
3 3
제 1 항에 있어서,상기 기판에서 전극이 형성될 영역에 요철을 형성하는 단계는,유전체 막 표면의 일정 영역에 요철을 형성하는 것을 특징으로 하는 반도체 소자 제조 방법
4 4
제 1 항에 있어서,상기 요철이 형성된 기판 상에 이차원 소재를 형성하는 단계는,상기 이차원 소재의 전구체인 금속 극초박막 또는 일부 산화된 금속의 극초박막을 형성하는 것을 특징으로 하는 반도체 소자 제조 방법
5 5
제 1 항에 있어서,상기 요철이 형성된 기판 상에 이차원 소재를 형성하는 단계는,하나 이상의 컨택트 영역 및 채널 영역을 포함하도록 형성하는 것을 특징으로 하는 반도체 소자 제조 방법
6 6
제 5 항에 있어서,상기 컨택트 영역은 한 종류 이상의 이차원 소재가 적층되는 것을 특징으로 하는 반도체 소자 제조 방법
7 7
제 5 항에 있어서,상기 컨택트 영역은 MoS2, MoSe2, MoTe2, WSe2, WS2, WTe2, ZrS2, ZrSe2, ZrTe2, HfSe2, HfS2, HfTe2, SnS2, SnSe2, SnTe2, InSe2, InS2, InTe2, TiS2, TiSe2, TiTe2, NbS2, NbSe2, NbTe2, TaS2, TaSe2, TaTe2, ReS2, ReSe2, ReTe2, VS2, VSe2 및 VTe2 중 한 종류 이상의 이차원 소재를 포함하고, 상기 채널 영역은 MoS2, MoSe2, MoTe2, WSe2, WS2, WTe2, ZrS2, ZrSe2, ZrTe2, HfSe2, HfS2, HfTe2, SnS2, SnSe2, SnTe2, InSe2, InS2, InTe2, ReS2, ReSe2, ReTe2, VS2, VSe2 및 VTe2중 한 종류 이상의 이차원 소재를 포함하는 것을 특징으로 하는 반도체 소자 제조 방법
8 8
제 5 항에 있어서,상기 채널 영역은 한 종류 이상의 이차원 소재가 적층되는 것을 특징으로 하는 반도체 소자 제조 방법
9 9
제5 항에 있어서,상기 형성된 전구체 막에 대하여 칼코겐화 공정을 수행하여 금속 칼코겐 막을 형성하는 단계는,상기 채널 영역에는 상기 기판과 평행한 방향으로 배향된 층들로 구성된 이차원 소재층이 형성되고, 상기 컨택트 영역의 골 부분에는 상기 기판과 수직한 방향으로 배향된 이차원 소재 층들이 형성되는 것을 특징으로 하는 반도체 소자 제조 방법
10 10
제 5 항에 있어서,상기 형성된 금속 칼코겐 막 위에 전극을 형성하는 단계는,상기 컨택트 영역 상에 소스 전극 및 드레인 전극을 형성하는 것을 특징으로 하는 반도체 소자 제조 방법
11 11
제 1 항에 있어서,상기 기판에서 전극이 형성될 영역에 요철을 형성하는 단계는,상기 기판 상에 미리 요철이 형성된 하부 전극을 형성하는 것을 특징으로 하는 반도체 소자 제조 방법
12 12
제 11 항에 있어서,상기 하부 전극 상에 하나 이상의 층으로 구성된 반도체 층을 형성하는 단계를 더 포함하는 반도체 소자 제조 방법
13 13
제 1 항에 있어서,상기 금속 칼코겐 막의 두께는 0
14 14
제 1 항에 있어서,상기 요철의 골 부분은 120도 이하의 예각을 가지는 것을 특징으로 하는 반도체 소자 제조 방법
15 15
접촉 저항이 개선된 반도체 소자에 있어서,기판과, 상기 기판 상의 전극이 형성될 영역에 대응하도록 형성된 요철과,상기 요철의 상면에 형성된 금속 칼코겐 막과,상기 금속 칼코겐 막 위에 형성된 전극을 포함하되,상기 금속 칼코겐 막은 상기 요철이 형성된 기판 상에 형성된 이차원 소재의 전구체 막에 대하여 칼코겐화 공정이 수행됨에 따라 형성되는 것을 특징으로 하는 반도체 소자
16 16
제 15 항에 있어서,상기 기판은 하나 이상의 컨택트 영역 및 채널 영역을 포함하도록 형성된 것을 특징으로 하는 반도체 소자
17 17
제 16 항에 있어서,상기 채널 영역에는 상기 기판과 평행한 방향으로 배향된 층들로 구성된 이차원 소재층이 형성되고, 상기 컨택트 영역의 골 부분에는 상기 기판과 수직한 방향으로 배향된 층들이 형성되는 것을 특징으로 하는 반도체 소자
18 18
제 15 항에 있어서,상기 기판 상에 형성된 하부 전극 및 상기 하부 전극 상에 하나 이상의 층으로 구성된 반도체 층을 더 포함하되,상기 요철은 상기 하부 전극 상에 형성되고,상기 금속 칼코겐 막 위에 형성된 전극은 상부 전극인 것을 특징으로 하는 반도체 소자
19 19
제 15 항에 있어서,상기 이차원 소재의 전구체 막은 금속 극초박막 또는 일부 산화된 금속의 극초박막인 것을 특징으로 하는 반도체 소자
20 20
접촉 저항이 개선된 반도체 소자에 있어서,기판과, 상기 기판 상에 형성된 한 개 이상의 전극과 상기 전극의 상면에 형성된 금속 칼코겐 막을 포함하고,상기 전극의 상면은 요철이 형성되어 있는 영역을 포함하되, 상기 전극의 상면과 기판 상에 형성된 이차원 소재의 전구체 막에 대하여 칼코겐화 공정이 수행됨에 따라 형성되어 수직한 방향으로 배향된 이차원 소재 층들을 포함하는 것을 특징으로 하는 반도체 소자
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패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 한국전자통신연구원 한국전자통신연구원연구개발지원사업(정보화) 차세대 신기능 스마트디바이스 플랫폼을 위한 대면적 이차원소재 및 소자 원천기술 개발