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칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템 및 예측방법

  • 기술번호 : KST2020004914
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템 및 예측방법이 개시된다. 본 발명의 일실시예에 따른 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템은 관통 실리콘 비아(TSV)의 초기 형상 정보, TSV에 충전된 구리의 결정립 초기 형상 정보, 열처리 조건 정보, 열팽창 예측정보를 입력받는 입력부 및 상기 입력부를 통해 입력된 TSV 초기 형상 정보, TSV에 충전된 구리의 결정립 초기 형상 정보, 열처리 조건 정보, 열팽창 예측정보를 입력받고, 상기 입력된 정보들을 이용하여 TSV 초기 형상을 정의하고, 상기 TSV의 구리 결정립 성장률을 계산하고, 열팽창 기반 구리 결정립 탄성변형을 계산하고, 구리 결정립 소성변형을 계산하고, 상기 계산된 정보들을 바탕으로 상기 TSV의 구리돌출량을 예측하는 구리 돌출량 예측부를 포함한다.
Int. CL H01L 21/66 (2006.01.01) H01L 23/498 (2006.01.01) H01L 23/522 (2006.01.01) H01L 25/065 (2006.01.01)
CPC H01L 22/12(2013.01) H01L 22/12(2013.01) H01L 22/12(2013.01) H01L 22/12(2013.01) H01L 22/12(2013.01)
출원번호/일자 1020180134689 (2018.11.05)
출원인 서강대학교산학협력단
등록번호/일자
공개번호/일자 10-2020-0051914 (2020.05.14) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2018.11.05)
심사청구항수 11

출원인

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번호 이름 국적 주소
1 서강대학교산학협력단 대한민국 서울특별시 마포구

발명자

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번호 이름 국적 주소
1 김동철 서울 마포구
2 이우주 서울 마포구
3 곽태진 서울 마포구

대리인

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번호 이름 국적 주소
1 특허법인세림 대한민국 서울특별시 서초구 강남대로 ***, **층, **층(서초동, 태우빌딩)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2018.11.05 수리 (Accepted) 1-1-2018-1096263-11
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.01.22 수리 (Accepted) 4-1-2019-5014626-89
3 선행기술조사의뢰서
Request for Prior Art Search
2019.09.18 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search
2019.11.07 발송처리완료 (Completion of Transmission) 9-6-2020-0010447-72
5 의견제출통지서
Notification of reason for refusal
2020.01.30 발송처리완료 (Completion of Transmission) 9-5-2020-0071687-18
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2020.03.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2020-0324583-89
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2020.03.27 수리 (Accepted) 1-1-2020-0324585-70
8 보정요구서
Request for Amendment
2020.04.06 발송처리완료 (Completion of Transmission) 1-5-2020-0051609-45
9 [출원서 등 보정]보정서(납부자번호)
[Amendment to Patent Application, etc.] Amendment(Payer number)
2020.04.08 수리 (Accepted) 1-1-2020-0353115-15
10 의견제출통지서
Notification of reason for refusal
2020.08.12 발송처리완료 (Completion of Transmission) 9-5-2020-0553247-15
11 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2020.10.07 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2020-1057902-99
12 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2020.10.07 수리 (Accepted) 1-1-2020-1057903-34
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
관통 실리콘 비아(TSV)의 초기 형상 정보, TSV에 충전된 구리의 결정립 초기 형상 정보, 열처리 조건 정보, 열팽창 예측정보를 입력받는 입력부; 및상기 입력부를 통해 입력된 TSV 초기 형상 정보, TSV에 충전된 구리의 결정립 초기 형상 정보, 열처리 조건 정보, 열팽창 예측정보를 입력받고, 상기 입력된 정보들을 이용하여 TSV 초기 형상을 정의하고, 상기 TSV의 구리 결정립 성장률을 계산하고, 열팽창 기반 구리 결정립 탄성변형을 계산하고, 구리 결정립 소성변형을 계산하고, 상기 계산된 정보들을 바탕으로 상기 TSV의 구리돌출량을 예측하는 구리 돌출량 예측부를 포함하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
2 2
제1항에 있어서,상기 구리 돌출량 예측부는 상기 정의된 TSV 초기 형상, 열처리 조건, 구리와 실리콘의 확산계수 비율 및 구리와 실리콘의 열팽창계수 비율을 이용하여 구리 결정립 성장률을 계산하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
3 3
제2항에 있어서, 상기 구리 돌출량 예측부는 상기 계산된 구리 결정립 성장률, 열처리 조건, 구리와 실리콘의 확산계수 비율, 구리와 실리콘의 열팽창계수 비율, 구리와 실리콘의 탄성계수 비율, 실리콘의 강성행렬 및 구리 결정립 성장위치에 따른 변형벡터를 이용하여 열팽창 기반 구리 결정립 탄성변형을 계산하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
4 4
제3항에 있어서,상기 구리 돌출량 예측부는 상기 계산된 열팽창 기반 구리 결정립 탄성변형, 계산된 구리 결정립 성장률, 열처리 조건, 구리와 실리콘의 확산계수 비율, 구리와 실리콘의 열팽창계수 비율, 구리와 실리콘의 탄성계수 비율, 실리콘의 강성행렬 및 구리 결정립 성장위치에 따른 변형벡터를 이용하여 구리 결정립 소성변형을 계산하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
5 5
제4항에 있어서,상기 구리 돌출량 예측부는 계산된 구리 결정립 성장률, 계산된 열팽창 기반 구리 결정립 탄성변형 및 계산된 구리 결정립 소성변형을 근거로 TSV의 구리 돌출량을 예측하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
6 6
제1항에 있어서,상기 구리 돌출량 예측부의 제어신호에 따라 상기 예측된 구리 돌출량과 관련된 이미지를 출력하는 출력부를 포함하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
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제6항에 있어서,상기 출력부는 상기 예측된 구리 돌출량을 바탕으로 가열시간에 따른 TSV의 열변형 및 변형 후의 형상을 이미지로 출력하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
8 8
제7항에 있어서,상기 출력부는 상기 예측된 구리 돌출량을 바탕으로 초기 형상 대비 구리 돌출량을 정량적으로 수치화하고 그래프로 출력하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
9 9
제1항에 있어서,상기 출력부는 상기 구리 돌출량 예측부의 제어신호에 따라 상기 예측된 구리 돌출량을 바탕으로 TSV의 열변형 및 변형 후의 형상 정보와 함께 열팽창 후 변형이 발생한 구리 영역에서 시간에 따른 결정립의 형상 정보를 포함하는 이미지를 출력하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템
10 10
관통 실리콘 비아(TSV)의 초기 형상 정보, TSV에 충전된 구리의 결정립 초기 형상 정보, 열처리 조건 정보, 열팽창 예측정보를 입력받고,상기 입력된 정보들을 이용하여 TSV 초기 형상을 정의하고,상기 정의된 TSV 초기 형상, 열처리 조건, 구리와 실리콘의 확산계수 비율 및 구리와 실리콘의 열팽창계수 비율을 이용하여 구리 결정립 성장률을 계산하고,상기 계산된 구리 결정립 성장률, 열처리 조건, 구리와 실리콘의 확산계수 비율, 구리와 실리콘의 열팽창계수 비율, 구리와 실리콘의 탄성계수 비율, 실리콘의 강성행렬 및 구리 결정립 성장위치에 따른 변형벡터를 이용하여 열팽창 기반 구리 결정립 탄성변형을 계산하고,상기 계산된 열팽창 기반 구리 결정립 탄성변형, 계산된 구리 결정립 성장률, 열처리 조건, 구리와 실리콘의 확산계수 비율, 구리와 실리콘의 열팽창계수 비율, 구리와 실리콘의 탄성계수 비율, 실리콘의 강성행렬 및 구리 결정립 성장위치에 따른 변형벡터를 이용하여 구리 결정립 소성변형을 계산하고,상기 구리 돌출량 예측부는 계산된 구리 결정립 성장률, 계산된 열팽창 기반 구리 결정립 탄성변형 및 계산된 구리 결정립 소성변형을 근거로 TSV의 구리 돌출량을 예측하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측방법
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제10항에 있어서,상기 예측된 구리 돌출량을 근거로 하여 가열시간에 따른 TSV의 열변형 및 변형 후의 형상을 이미지로 출력하거나, 초기 형상 대비 구리 돌출량을 정량적으로 수치화하고 그래프로 출력하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측방법
12 12
제10항에 있어서,상기 상기 예측된 구리 돌출량을 바탕으로 TSV의 열변형 및 변형 후의 형상 정보와 함께 열팽창 후 변형이 발생한 구리 영역에서 시간에 따른 결정립의 형상 정보를 포함하는 이미지를 출력하는 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
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