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베타전지 및 이의 제조방법

  • 기술번호 : KST2020015166
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 기판 상에 구비된 p형 반도체층; 상기 p형 반도체층 상에 구비된 n형 반도체층; 및 상기 n형 반도체층 상에 구비된 방사성 동위원소 함유층;을 포함하는 것인 베타전지 및 기판 상에 p형 반도체층을 형성하는 단계; 상기 p형 반도체층 상에 n형 반도체층을 형성하는 단계; 및 상기 n형 반도체층 상에 방사성 동위원소 함유층을 형성하는 단계;를 포함하는 것인 베타전지의 제조 방법에 관한 것이다.
Int. CL G21H 1/02 (2006.01.01)
CPC G21H 1/02(2013.01)
출원번호/일자 1020190030782 (2019.03.18)
출원인 한국원자력연구원
등록번호/일자
공개번호/일자 10-2020-0111040 (2020.09.28) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2020.03.17)
심사청구항수 18

출원인

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번호 이름 국적 주소
1 한국원자력연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김동석 대구광역시 동구
2 황용석 대구광역시 수성구
3 이찬영 대전광역시 유성구
4 석재권 경상북도 포항시 남구

대리인

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번호 이름 국적 주소
1 특허법인태평양 대한민국 서울특별시 중구 청계천로 **, *층(다동, 예금보험공사빌딩)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2019.03.18 수리 (Accepted) 1-1-2019-0277466-39
2 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2020.03.17 수리 (Accepted) 1-1-2020-0279090-36
3 선행기술조사의뢰서
Request for Prior Art Search
2020.06.12 수리 (Accepted) 9-1-9999-9999999-89
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
기판 상에 구비된 p형 반도체층;상기 p형 반도체층 상에 구비된 n형 반도체층; 및상기 n형 반도체층 상에 구비된 방사성 동위원소 함유층;을 포함하는 것인 베타전지
2 2
청구항 1에 있어서,상기 p형 반도체층 및 상기 n형 반도체층의 적어도 하나는 질화갈륨(GaN)을 포함하는 것인 베타전지
3 3
청구항 1에 있어서,상기 n형 반도체층의 두께는 20 내지 90 ㎚인 것인 베타전지
4 4
청구항 1에 있어서,상기 p형 반도체층의 두께는 150 내지 1,000 ㎚인 것인 베타전지
5 5
청구항 1에 있어서,상기 방사성 동위원소는 니켈(Ni)-63, 스트론튬(Sr)-90, 프로메튬(Pm)-147 및 트리튬(H)-3 중에서 선택되는 적어도 하나를 포함하는 것인 베타전지
6 6
청구항 1에 있어서,상기 p형 반도체층과 상기 n형 반도체층 사이에 진성 반도체층(intrinsic semiconductor layer)을 더 포함하는 것인 베타전지
7 7
청구항 6에 있어서,상기 진성 반도체층은 질화갈륨(GaN)을 포함하는 것인 베타전지
8 8
청구항 6에 있어서,상기 진성 반도체층의 두께는 100 내지 900 ㎚인 것인 베타전지
9 9
청구항 1에 있어서,상기 p형 반도체층에 전기적으로 연결된 p형 전극; 및상기 n형 반도체층에 전기적으로 연결된 n형 전극을 더 포함하는 것인 베타전지
10 10
기판 상에 p형 반도체층을 형성하는 단계;상기 p형 반도체층 상에 n형 반도체층을 형성하는 단계; 및상기 n형 반도체층 상에 방사성 동위원소 함유층을 형성하는 단계;를 포함하는 것인 베타전지의 제조 방법
11 11
청구항 10에 있어서,상기 p형 반도체층 및 상기 n형 반도체층의 적어도 하나는 질화갈륨(GaN)을 포함하는 것인 베타전지의 제조 방법
12 12
청구항 10에 있어서,상기 n형 반도체층의 두께는 20 내지 90 ㎚인 것인 베타전지의 제조 방법
13 13
청구항 10에 있어서,상기 p형 반도체층의 두께는 150 내지 1,000 ㎚인 것인 베타전지의 제조 방법
14 14
청구항 10에 있어서,상기 방사성 동위원소는 니켈(Ni)-63, 스트론튬(Sr)-90, 프로메튬(Pm)-147 및 트리튬(H)-3 중에서 선택되는 적어도 하나를 포함하는 것인 베타전지의 제조 방법
15 15
청구항 10에 있어서,상기 p형 반도체층을 형성하는 단계 후 상기 n형 반도체층을 형성하는 단계 이전에, 상기 p형 반도체층 상에 진성 반도체층(intrinsic semiconductor layer)을 형성하는 단계를 더 포함하는 것인 베타전지의 제조 방법
16 16
청구항 15에 있어서,상기 진성 반도체층은 질화갈륨(GaN)을 포함하는 것인 베타전지의 제조 방법
17 17
청구항 15에 있어서,상기 진성 반도체층의 두께는 100 내지 900 ㎚인 것인 베타전지의 제조 방법
18 18
청구항 10에 있어서,상기 p형 반도체층에 전기적으로 연결된 p형 전극을 형성하는 단계; 및상기 n형 반도체 층에 전기적으로 연결된 n형 전극을 형성하는 단계를 더 포함하는 것인 베타전지의 제조 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 한국원자력연구원 원자력연구개발사업 GaN 기반 고효율 베타전지 개발을 위한 이온빔 이용 연구