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전력 분배기 회로 장치

  • 기술번호 : KST2020016807
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명에 따른 전력 분배기 회로 장치는 일단이 상기 입력단에 연결되는 입력 캐패시터와, 일단이 상기 입력 캐패시터의 타단에 연결되고 타단은 접지되는 션트 인덕터와, 일단이 상기 입력 캐패시터의 타단에 연결되고 타단이 출력단에 연결되는 복수의 병렬로 연결된 캐패시터를 포함하는 캐패시터부와, 상기 출력단에 연결되는 적어도 하나의 저항을 포함하는 출력 저항부를 포함한다.
Int. CL H01P 5/18 (2006.01.01) H01P 1/04 (2006.01.01)
CPC H01P 5/184(2013.01) H01P 1/047(2013.01)
출원번호/일자 1020190068743 (2019.06.11)
출원인 한국전자기술연구원
등록번호/일자
공개번호/일자 10-2020-0141775 (2020.12.21) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2020.02.25)
심사청구항수 9

출원인

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번호 이름 국적 주소
1 한국전자기술연구원 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 김동수 경기도 성남시 분당구
2 육종민 경기도 성남시 분당구
3 김준철 경기도 성남시 분당구

대리인

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번호 이름 국적 주소
1 박종한 대한민국 서울특별시 구로구 디지털로**길 * (구로동, 에이스하이엔드타워*차) ***호(한림특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2019.06.11 수리 (Accepted) 1-1-2019-0595215-67
2 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2020.02.25 수리 (Accepted) 1-1-2020-0198938-15
3 선행기술조사의뢰서
Request for Prior Art Search
2020.08.12 수리 (Accepted) 9-1-9999-9999999-89
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.08.24 수리 (Accepted) 4-1-2020-5189497-57
5 선행기술조사보고서
Report of Prior Art Search
2020.10.16 발송처리완료 (Completion of Transmission) 9-6-2020-0155266-15
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번호 청구항
1 1
전력 분배기 회로 장치에 있어서, 일단이 상기 입력단에 연결되는 입력 캐패시터; 일단이 상기 입력 캐패시터의 타단에 연결되고 타단은 접지되는 션트 인덕터;일단이 상기 입력 캐패시터의 타단에 연결되고 타단이 출력단에 연결되는 복수의 병렬로 연결된 캐패시터를 포함하는 캐패시터부; 및 상기 출력단에 연결되는 적어도 하나의 저항을 포함하는 출력 저항부;를 포함하는 전력 분배기 회로 장치
2 2
제1항에 있어서, 상기 출력단이 제1 출력단 및 제2 출력단을 포함할 때, 상기 캐패시터부는 일단이 상기 입력 캐패시터의 타단에 연결되고 타단이 상기 제1 출력단에 연결되는 제1 캐패시터; 및 일단이 상기 입력 캐패시터의 타단에 연결되고 타단이 상기 제2 출력단에 연결되는 제2 캐패시터;를 포함하며, 상기 저항부는 일단이 상기 제1 출력단에 연결되고 타단은 상기 제2 출력단에 연결되는 저항;을 포함하는 것을 특징으로 하는 전력 분배기 회로 장치
3 3
제1항에 있어서, 상기 출력단이 제1 출력단 및 제2 출력단을 포함할 때, 상기 캐패시터부는 일단이 상기 입력 캐패시터의 타단에 연결되는 제1 강유전체 캐패시터; 일단이 상기 제1 강유전체 캐패시터의 타단에 연결되고 타단이 상기 제1 출력단에 연결되는 제2 강유전체 캐패시터; 일단이 상기 입력 캐패시터의 타단에 연결되는 제3 강유전체 캐패시터; 및 일단이 상기 제3 강유전체 캐패시터의 타단에 연결되고 타단이 상기 제2 출력단에 연결되는 제4 강유전체 캐패시터;를 포함하며, 상기 저항부는 일단이 상기 제1 출력단에 연결되고 타단은 상기 제2 출력단에 연결되는 저항;을 포함하는 것을 특징으로 하는 전력 분배기 회로 장치
4 4
제3항에 있어서, 상기 제2 강유전체 캐패시터의 일단과 상기 제4 강유전체 캐패시터의 일단에 바이어스 전압을 인가하는 바이어스 소스;를 더 포함하는 것을 특징으로 하는 전력 분배기 회로 장치
5 5
제1항에 있어서, 상기 출력단이 제1 출력단, 제2 출력단 및 제3 출력단을 포함할 때, 상기 캐패시터부는일단이 상기 입력 캐패시터의 타단에 연결되고 타단이 상기 제1 출력단에 연결되는 제1 캐패시터; 및일단이 상기 입력 캐패시터의 타단에 연결되고 타단이 상기 제2 출력단에 연결되는 제2 캐패시터;를 포함하며,일단이 상기 입력 캐패시터의 타단에 연결되고 타단이 상기 제3 출력단에 연결되는 제3 캐패시터;를 포함하며,상기 저항부는 일단이 상기 제1 출력단에 연결되는 제1 저항; 일단이 상기 제2 출력단에 연결되는 제2 저항; 및 일단이 상기 제3 출력단에 연결되는 제3 저항;을 포함하되, 상기 제1 저항, 제2 저항 및 제3 저항 모두의 타단은 상호 간에 연결되는 것을 특징으로 하는 전력 분배기 회로 장치
6 6
제5항에 있어서, 상기 저항부와 출력단 사이에 형성되는 위상천이부;를 더 포함하는 것을 특징으로 하는 전력 분배기 회로 장치
7 7
제6항에 있어서, 상기 위상천이부는 일단이 상기 제2 저항의 일단에 연결되고 타단이 제2 출력단에 연결되는 제1 인덕터와, 일단이 상기 제2 저항의 일단에 연결되고 타단이 접지되는 제1 위상 캐패시터와, 일단이 상기 제2 출력단에 연결되고 타단이 접지되는 제2 위상 캐패시터를 포함하는 제1 위상천이기; 및 일단이 상기 제3 저항의 일단에 연결되고 타단이 제3 출력단에 연결되는 제2 인덕터와, 일단이 상기 제3 저항의 일단에 연결되고 타단이 접지되는 제3 위상 캐패시터와, 일단이 상기 제3 출력단에 연결되고 타단이 접지되는 제4 위상 캐패시터를 포함하는 제2 위상천이기;를 포함하는 것을 특징으로 하는 전력 분배기 회로 장치
8 8
제1항에 있어서, 상기 전력 분배기 회로 장치가 반도체 공정으로 형성될 때, 상기 션트 인덕터는 인덕터 패턴 없이 본드 와이어로 형성되는 것을 특징으로 하는 전력 분배기 회로 장치
9 9
제8항에 있어서, 상기 본드 와이어는 설계 목적에 따라 길이를 변경하여 형성하는 것을 특징으로 하는 전력 분배기 회로 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과기정통부 (주)웨이비스 ICT유망기술개발지원사업 (M)Si IPD 기술을 이용한 고집적 GaN Quasi-MMIC 전력증폭기 기술 개발