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반도체 발광소자의 제조 방법 및 반도체 발광소자

  • 기술번호 : KST2021002016
  • 담당센터 : 광주기술혁신센터
  • 전화번호 : 062-360-4654
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 일 실시예에 따른 반도체 발광소자의 제조 방법은 공정 챔버 내부에 타겟 및 기판 홀더를 포함하는 스퍼터링 장치를 이용하는 반도체 발광소자의 제조 방법으로서, 기판 상에 적층된 n형 반도체층, 활성층, 및 p형 반도체층을 포함하는 질화물계 반도체 적층 구조를 준비하는 과정; 상기 타겟에 전원을 인가하여 상기 공정 챔버 내에 플라즈마를 발생하는 과정; 상기 타겟과 상기 기판 홀더 사이에 배치된 차단 플레이트로 상기 플라즈마의 일부를 차단하는 과정; 및 차단되지 않은 상기 플라즈마의 나머지를 이용하여 상기 질화물계 반도체 적층 구조 상에 컨택 전극층을 증착하는 과정을 포함할 수 있다.
Int. CL H01L 33/00 (2010.01.01) H01L 33/40 (2010.01.01)
CPC H01L 33/005(2013.01) H01L 33/0008(2013.01) H01L 33/405(2013.01)
출원번호/일자 1020190097631 (2019.08.09)
출원인 순천대학교 산학협력단
등록번호/일자 10-2218587-0000 (2021.02.16)
공개번호/일자 10-2021-0017817 (2021.02.17) 문서열기
공고번호/일자 (20210222) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2019.08.09)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 순천대학교 산학협력단 대한민국 전라남도 순천시

발명자

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번호 이름 국적 주소
1 곽준섭 전라남도 순천시 중앙로 **
2 조성민 전라남도 순천시 중앙로 **
3 차유정 전라남도 순천시 중앙로 **
4 김태경 전라남도 순천시 중앙로 **

대리인

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번호 이름 국적 주소
1 안준형 대한민국 서울특별시 강남구 역삼로 ***, *층(역삼동, 청보빌딩)(아인특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 순천대학교 산학협력단 전라남도 순천시
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2019.08.09 수리 (Accepted) 1-1-2019-0820132-99
2 의견제출통지서
Notification of reason for refusal
2020.10.15 발송처리완료 (Completion of Transmission) 9-5-2020-0708678-60
3 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2020.12.08 수리 (Accepted) 1-1-2020-1329841-59
4 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2020.12.08 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2020-1329842-05
5 등록결정서
Decision to grant
2021.02.10 발송처리완료 (Completion of Transmission) 9-5-2021-0123458-57
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
공정 챔버 내부에 타겟 및 기판 홀더를 포함하는 스퍼터링 장치를 이용한 반도체 발광소자의 제조 방법에 있어서,기판 상에 적층된 n형 반도체층, 활성층, 및 p형 반도체층을 포함하는 질화물계 반도체 적층 구조를 준비하는 과정;상기 타겟에 전원을 인가하여 상기 공정 챔버 내에 플라즈마를 발생하는 과정;상기 타겟과 상기 기판 홀더 사이에 배치된 차단 플레이트로 상기 플라즈마의 일부를 차단하는 과정; 및차단되지 않은 상기 플라즈마의 나머지를 이용하여 상기 질화물계 반도체 적층 구조 상에 컨택 전극층을 증착하는 과정;을 포함하고,상기 컨택 전극층을 증착하는 과정 이후에, 상기 차단 플레이트를 상기 플라즈마로부터 제거하는 과정; 및상기 플라즈마 전부를 이용하여 인시츄(in-situ)로 상기 컨택 전극층 상에 반사 전극층을 증착하는 과정을 더 포함하는 반도체 발광소자의 제조 방법
2 2
청구항 1에 있어서,상기 플라즈마는 상기 타겟의 전방을 향하여 연장되는 중심부 및 상기 중심부를 둘러싸는 주변부를 포함하고, 상기 차단 플레이트는 상기 플라즈마의 중심부를 가로질러 배치되는 반도체 발광소자의 제조 방법
3 3
청구항 1에 있어서,상기 컨택 전극층을 증착하는 과정에서 상기 컨택 전극층은 비정질 또는 나노결정질인 금속으로 이루어진 박막으로 증착되는 반도체 발광소자의 제조 방법
4 4
청구항 1에 있어서, 상기 질화물계 반도체 적층 구조는 상기 p형 반도체층 상에 배치되고 상기 컨택 전극층과 오믹 접촉을 형성하는 p형 컨택층을 더 포함하고,상기 컨택 전극층을 증착하는 과정이 완료된 상태에서 상기 p형 컨택층은 1×1019 내지 5×1021/cm3 범위의 하전 결함 밀도(charged defect density)를 가지는 반도체 발광소자의 제조 방법
5 5
청구항 1에 있어서,상기 컨택 전극층을 증착하는 과정에서 상기 컨택 전극층은 10nm 내지 150nm 범위의 두께로 형성되는 반도체 발광소자의 제조 방법
6 6
삭제
7 7
청구항 1에 있어서,상기 반사 전극층을 증착하는 과정에서 상기 반사 전극층은 결정질이고, 상기 컨택 전극층과 동일한 금속으로 이루어진 박막으로 증착되는 반도체 발광소자의 제조 방법
8 8
청구항 1에 있어서,상기 차단 플레이트의 직경은 상기 타겟의 직경에 비해 -20% 내지 +20%의 범위를 가지는 반도체 발광소자의 제조 방법
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청구항 1에 있어서,상기 차단 플레이트와 상기 기판 홀더 사이의 간격은 상기 타겟과 상기 기판 홀더 사이의 간격의 1/2보다 작고, 상기 타겟과 상기 기판 홀더 사이의 간격의 1/5보다 큰 반도체 발광소자의 제조 방법
10 10
청구항 1에 있어서,상기 컨택 전극층을 증착하는 과정은, 상기 기판 홀더에 음의 전압을 인가한 상태에서 수행되는 반도체 발광소자의 제조 방법
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제 1항 내지 제 5항, 제 7항 내지 제 10항 중 어느 한 항에 따른 반도체 발광소자의 제조 방법에 의해 제조된 반도체 발광소자
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