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기생 인덕턴스 감소를 위한 적층형 회로 구조체

  • 기술번호 : KST2021002676
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 적층형 회로 구조체에 대한 것으로서, 보다 상세하게는 기생 인덕턴스 감소를 위한 적층형 회로 구조체에 대한 것이다. 본 발명의 일 실시 예에 따른 적층형 회로 구조체는, 제1 전기적 경로가 형성된 제1 레이어, 제1 전기적 경로와 연결되어 제1 루프를 형성하는 제2 전기적 경로가 형성된 제2 레이어, 제3 전기적 경로가 형성된 제3 레이어 및 제3 전기적 경로와 연결되어 제2 루프를 형성하는 제4 전기적 경로가 형성된 제4 레이어를 포함할 수 있다. 본 발명에 따른 적층형 회로 구조체는 복수의 루프를 형성하여 기생 인덕턴스를 효과적으로 감소시킬 수 있다.
Int. CL H05K 1/02 (2006.01.01)
CPC
출원번호/일자 1020190138438 (2019.11.01)
출원인 한양대학교 산학협력단
등록번호/일자
공개번호/일자 10-2021-0026994 (2021.03.10) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020190107601   |   2019.08.30
법적상태 등록
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2019.11.01)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 한양대학교 산학협력단 대한민국 서울특별시 성동구

발명자

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번호 이름 국적 주소
1 김래영 서울특별시 성동구
2 양시석 서울특별시 성동구

대리인

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번호 이름 국적 주소
1 최영수 대한민국 서울특별시 서초구 서초대로 ***, *층 ***,***호 (서초동, 서초지웰타워)(모티버스특허법률사무소)
2 윤종원 대한민국 서울특별시 서초구 서초대로 ***, *층 ***,***호 (서초동, 서초지웰타워)(모티버스특허법률사무소)
3 정성준 대한민국 서울특별시 서초구 서초대로 ***, *층 ***,***호 (서초동, 서초지웰타워)(모티버스특허법률사무소)

최종권리자

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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2019.11.01 수리 (Accepted) 1-1-2019-1121034-95
2 의견제출통지서
Notification of reason for refusal		 2020.08.28 발송처리완료 (Completion of Transmission) 9-5-2020-0591514-81
3 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
 2020.10.27 수리 (Accepted) 1-1-2020-1140413-00
4 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2020.10.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2020-1140412-54
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
제1 전기적 경로가 형성된 제1 레이어;상기 제1 레이어와 인접하게 적층되고, 상기 제1 전기적 경로와 연결되어 제1 루프를 형성하는 제2 전기적 경로가 형성된 제2 레이어;상기 제2 레이어와 인접하게 적층되고, 제3 전기적 경로가 형성된 제3 레이어; 및 상기 제3 레이어와 인접하게 적층되고, 상기 제3 전기적 경로와 연결되어 제2 루프를 형성하는 제4 전기적 경로가 형성된 제4 레이어;를 포함하는 적층형 회로 구조체
2 2
제1항에 있어서,상기 제1 전기적 경로에 흐르는 전류의 방향은 상기 제2 전기적 경로에 흐르는 전류의 방향과 반대인, 적층형 회로 구조체
3 3
제1항에 있어서,상기 제3 전기적 경로에 흐르는 전류의 방향은 상기 제4 전기적 경로에 흐르는 전류의 방향과 반대인, 적층형 회로 구조체
4 4
제1항에 있어서,상기 제1 전기적 경로에 흐르는 전류의 방향은 상기 제3 전기적 경로에 흐르는 전류의 방향과 동일한, 적층형 회로 구조체
5 5
제1항에 있어서,상기 제4 레이어와 인접하게 적층되고, 제5 전기적 경로가 형성된 제5 레이어; 및 상기 제5 레이어와 인접하게 적층되고, 상기 제5 전기적 경로와 연결되어 제3 루프를 형성하는 제6 전기적 경로가 형성된 제6 레이어;를 더 포함하는 적층형 회로 구조체
6 6
제5항에 있어서,상기 제5 전기적 경로에 흐르는 전류의 방향은 상기 제6 전기적 경로에 흐르는 전류의 방향과 반대인, 적층형 회로 구조체
7 7
제5항에 있어서,상기 제1 전기적 경로에 흐르는 전류의 방향은 상기 제5 전기적 경로에 흐르는 전류의 방향과 동일한, 적층형 회로 구조체
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순번 연구부처 주관기관 연구사업 연구과제
1 산업통상자원부 전자부품연구원 에너지수요관리핵심기술개발(에특)(R＆D) WBG 소자의 저손실 구동 공통 기술 개발