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출력 임피던스 모니터를 포함하는 메모리 인터페이스 회로 및 그것의 출력 임피던스 보정 방법

  • 기술번호 : KST2021008133
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 출력 임피던스 모니터를 포함하는 메모리 인터페이스 회로 및 출력 임피던스 보정 방법에 관한 것으로, 좀 더 상세하게는 구동 회로의 출력 임피던스를 실시간으로 모니터링하고 보정할 수 있는 메모리 인터페이스 회로에 관한 것이다. 본 발명의 실시 예에 따른 메모리 인터페이스 회로는 디지털 송신 신호를 출력하는 제어 회로; 상기 디지털 송신 신호에 기반하여 출력 신호를 출력하는 구동 회로; 상기 디지털 송신 신호 및 상기 출력 신호에 기반하여 풀-업 모니터링 신호 또는 풀-다운 모니터링 신호를 출력하는 출력 임피던스 모니터; 및 상기 풀-업 모니터링 신호 또는 상기 풀-다운 모니터링 신호에 기반하여 임피던스 모니터링 신호를 출력하는 출력 임피던스 칼리브레이터를 포함하되, 상기 구동 회로는 상기 임피던스 모니터링 신호에 기반하여 출력 임피던스를 보정한다.
Int. CL G11C 11/4093 (2021.01.01) G11C 7/10 (2021.01.01)
CPC
출원번호/일자 1020200094366 (2020.07.29)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2021-0074990 (2021.06.22) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020190166100   |   2019.12.12
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 16

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 조민형 대전광역시 서구
2 전영득 세종특별자치시 새롬중앙로
3 김성민 세종특별자치시 새롬남로

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2020.07.29 수리 (Accepted) 1-1-2020-0794457-80
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번호 청구항
1 1
디지털 송신 신호를 출력하는 제어 회로;상기 디지털 송신 신호에 기반하여 출력 신호를 출력하는 구동 회로;상기 디지털 송신 신호 및 상기 출력 신호에 기반하여 풀-업 모니터링 신호 또는 풀-다운 모니터링 신호를 출력하는 출력 임피던스 모니터; 및상기 풀-업 모니터링 신호 또는 상기 풀-다운 모니터링 신호에 기반하여 임피던스 모니터링 신호를 출력하는 출력 임피던스 칼리브레이터를 포함하되,상기 구동 회로는 상기 임피던스 모니터링 신호에 기반하여 출력 임피던스를 보정하는 메모리 인터페이스 회로
2 2
제 1 항에 있어서,상기 구동 회로는 병렬로 연결된 복수의 드라이버들을 포함하고;상기 복수의 드라이버들은 프리 드라이버, 풀-업 드라이버, 및 풀-다운 드라이버를 포함하되,상기 풀-업 드라이버는 병렬로 연결된 복수의 서브 풀-업 드라이버들을 포함하고, 상기 풀-다운 드라이버는 병렬로 연결된 복수의 서브 풀-다운 드라이버들을 포함하고;상기 디지털 송신 신호가 로직 하이 신호인 경우, 상기 프리 드라이버는 상기 풀-업 드라이버로 풀-업 구동 신호를 출력하고, 상기 풀-업 드라이버는 상기 풀-업 구동 신호에 응답하여 활성화되고;상기 디지털 송신 신호가 로직 로우 신호인 경우, 상기 프리 드라이버는 상기 풀-다운 드라이버로 풀-다운 구동 신호를 출력하고, 상기 풀-다운 드라이버는 상기 풀-다운 구동 신호에 응답하여 활성화되고; 그리고상기 프리 드라이버는 상기 임피던스 모니터링 신호에 대응하는 풀-업 구동 신호 또는 풀-다운 구동 신호를 출력하는 메모리 인터페이스 회로
3 3
제 1 항에 있어서,상기 출력 임피던스 모니터는:풀-업 모니터 및 풀-다운 모니터를 포함하고;상기 풀-업 모니터는 VOH 누산기 및 VOH 모니터를 포함하고;상기 풀-다운 모니터는 VOL 누산기 및 VOL 모니터를 포함하고; 그리고상기 VOH 모니터 및 상기 VOL 모니터는 제 1 비교기 및 제 2 비교기를 포함하되,상기 VOH 모니터 및 상기 VOL 모니터는 상기 디지털 송신 신호를 수신하고;상기 수신한 디지털 송신 신호가 로직 하이 신호인 경우, 상기 VOH 모니터의 상기 제 1 비교기 및 상기 제 2 비교기가 활성화되고; 그리고상기 수신한 디지털 송신 신호가 로직 로우 신호인 경우, 상기 VOL 모니터의 상기 제 1 비교기 및 상기 제 2 비교기가 활성화되는 메모리 인터페이스 회로
4 4
제 3 항에 있어서,상기 VOH 모니터의 상기 제 1 비교기는 로직 하이를 출력할 때의 상기 출력 신호의 레벨과 제 1 하이 전압 신호를 비교하여 하이 전압 오버 신호를 출력하고;상기 VOH 모니터의 상기 제 2 비교기는 로직 하이를 출력할 때의 상기 출력 신호의 레벨과 제 2 하이 전압 신호를 비교하여 하이 전압 언더 신호를 출력하고;상기 VOL 모니터의 상기 제 1 비교기는 로직 로우를 출력할 때의 상기 출력 신호의 레벨과 제 1 로우 전압 신호를 비교하여 로우 전압 오버 신호를 출력하고; 그리고상기 VOL 모니터의 상기 제 2 비교기는 로직 로우를 출력할 때의 상기 출력 신호의 레벨과 제 2 로우 전압 신호를 비교하여 로우 전압 언더 신호를 출력하는 메모리 인터페이스 회로
5 5
제 4 항에 있어서,상기 제 1 하이 전압 신호의 값은 로직 하이를 나타내는 하이 전압 신호의 값에 대하여 허용범위값만큼 증가한 값이고;상기 제 2 하이 전압 신호의 값은 상기 하이 전압 신호의 값에 대하여 상기 허용범위값만큼 감소한 값이고;상기 제 1 로우 전압 신호의 값은 로직 로우를 나타내는 로우 전압 신호의 값에 대하여 상기 허용범위값만큼 증가한 값이고; 그리고상기 제 2 로우 전압 신호의 값은 상기 로우 전압 신호의 값에 대하여 상기 허용범위값만큼 감소한 값인 메모리 인터페이스 회로
6 6
제 5 항에 있어서,상기 VOH 누산기는:상기 하이 전압 오버 신호 또는 상기 하이 전압 언더 신호를 누적하고; 그리고상기 누적된 하이 전압 오버 신호 또는 상기 누적된 하이 전압 언더 신호에 기반하여 상기 풀-업 모니터링 신호를 출력하고;상기 VOL 누산기는:상기 로우 전압 오버 신호 또는 상기 로우 전압 언더 신호를 누적하고; 그리고상기 누적된 로우 전압 오버 신호 또는 상기 누적된 로우 전압 언더 신호에 기반하여 상기 풀-다운 모니터링 신호를 출력하는 메모리 인터페이스 회로
7 7
제 3 항에 있어서,상기 풀-업 모니터 및 상기 풀-다운 모니터는 상기 디지털 송신 신호가 로직 하이 신호 또는 로직 로우 신호로 유지되는 지속 시간이 임계 시간 이상인지 판단하는 TxD 모니터를 더 포함하고;상기 지속 시간이 상기 임계 시간 이상인 것으로 판단한 경우에만 상기 VOH 모니터 및 상기 VOL 모니터는 상기 디지털 송신 신호를 수신하고; 그리고상기 임계 시간은 상기 구동 회로가 1-비트의 데이터를 전송하는 데 걸리는 시간의 배수로 결정되는 메모리 인터페이스
8 8
제어 회로에서 디지털 송신 신호를 출력하는 단계;구동 회로에서 상기 디지털 송신 신호에 기반하여 출력 신호를 출력하는 단계;출력 임피던스 모니터의 풀-업 모니터 또는 풀-다운 모니터에서 상기 디지털 송신 신호 및 상기 출력 신호에 기반하여 모니터링 신호를 출력하는 단계;출력 임피던스 칼리브레이터에서 상기 모니터링 신호에 기반하여 임피던스 모니터링 신호를 출력하는 단계; 및상기 구동 회로에서 상기 임피던스 모니터링 신호에 기반하여 출력 임피던스를 보정하는 단계를 포함하는 메모리 인터페이스 회로의 출력 임피던스 보정 방법
9 9
제 8 항에 있어서,상기 디지털 송신 신호가 로직 하이 신호인 경우,상기 모니터링 신호를 출력하는 단계는:풀-업 모니터의 VOH 모니터에서 제 1 비교기 및 제 2 비교기가 활성화되는 단계;상기 VOH 모니터의 상기 제 1 비교기에서 상기 출력 신호의 레벨과 제 1 하이 전압 신호를 비교하여 하이 전압 오버 신호를 출력하는 단계; 및상기 VOH 모니터의 상기 제 2 비교기에서 상기 출력 신호의 레벨과 제 2 하이 전압 신호를 비교하여 하이 전압 언더 신호를 출력하는 단계를 포함하되,상기 제 1 하이 전압 신호의 값은 로직 하이를 나타내는 하이 전압 신호의 값에 대하여 허용범위값만큼 증가한 값이고; 그리고상기 제 2 하이 전압 신호의 값은 상기 하이 전압 신호의 값에 대하여 상기 허용범위값만큼 감소한 값인 메모리 인터페이스 회로의 출력 임피던스 보정 방법
10 10
제 9 항에 있어서,상기 모니터링 신호를 출력하는 단계는:상기 풀-업 모니터의 VOH 누산기에서 상기 하이 전압 오버 신호 또는 상기 하이 전압 언더 신호를 누적하는 단계; 및상기 풀-업 모니터의 VOH 누산기에서 상기 누적된 하이 전압 오버 신호 또는 상기 누적된 하이 전압 언더 신호에 기반하여 풀-업 모니터링 신호를 출력하는 단계를 더 포함하는 메모리 인터페이스 회로의 출력 임피던스 보정 방법
11 11
제 10 항에 있어서,상기 임피던스 모니터링 신호를 출력하는 단계는:상기 구동 회로의 프리 드라이버에서, 상기 풀-업 모니터링 신호에 기반하여 출력한 상기 임피던스 모니터링 신호에 대응하는 풀-업 구동 신호를 출력하는 단계를 더 포함하는 메모리 인터페이스 회로의 출력 임피던스 보정 방법
12 12
제 9 항에 있어서,상기 모니터링 신호를 출력하는 단계는:상기 풀-업 모니터의 TxD 모니터에서 상기 디지털 송신 신호가 로직 하이 신호로 유지되는 지속 시간이 임계 시간 이상인지 판단하는 단계; 및상기 지속 시간이 상기 임계 시간 이상인 경우에만 상기 VOH 모니터에서 상기 디지털 송신 신호를 수신하는 단계를 더 포함하되,상기 임계 시간은 상기 구동 회로가 1-비트의 데이터를 전송하는 데 걸리는 시간의 배수로 결정되는 메모리 인터페이스 회로의 출력 임피던스 보정 방법
13 13
제 8 항에 있어서,상기 디지털 송신 신호가 로직 로우 신호인 경우,상기 모니터링 신호를 출력하는 단계는:풀-다운 모니터의 VOL 모니터에서 제 1 비교기 및 제 2 비교기가 활성화되는 단계;상기 VOL 모니터의 상기 제 1 비교기에서 상기 출력 신호의 레벨과 제 1 로우 전압 신호를 비교하여 로우 전압 오버 신호를 출력하는 단계; 및상기 VOL 모니터의 상기 제 2 비교기에서 상기 출력 신호의 레벨과 제 2 로우 전압 신호를 비교하여 로우 전압 언더 신호를 출력하는 단계를 포함하되,상기 제 1 로우 전압 신호의 값은 로직 로우를 나타내는 로우 전압 신호의 값에 대하여 허용범위값만큼 증가한 값이고; 그리고상기 제 2 로우 전압 신호의 값은 상기 로우 전압 신호의 값에 대하여 상기 허용범위값만큼 감소한 값인 메모리 인터페이스 회로의 출력 임피던스 보정 방법
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제 13 항에 있어서,상기 모니터링 신호를 출력하는 단계는:상기 풀-다운 모니터의 VOL 누산기에서 상기 로우 전압 오버 신호 또는 상기 로우 전압 언더 신호를 누적하는 단계; 및상기 풀-다운 모니터의 VOL 누산기에서 상기 누적된 로우 전압 오버 신호 또는 상기 누적된 로우 전압 언더 신호에 기반하여 풀-다운 모니터링 신호를 출력하는 단계를 더 포함하는 메모리 인터페이스 회로의 출력 임피던스 보정 방법
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제 14 항에 있어서,상기 임피던스 모니터링 신호를 출력하는 단계는:상기 구동 회로의 프리 드라이버에서, 상기 풀-다운 모니터링 신호에 기반하여 출력한 상기 임피던스 모니터링 신호에 대응하는 풀-다운 구동 신호를 출력하는 단계를 더 포함하는 메모리 인터페이스 회로의 출력 임피던스 보정 방법
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제 13 항에 있어서,상기 모니터링 신호를 출력하는 단계는:상기 풀-다운 모니터의 TxD 모니터에서 상기 디지털 송신 신호가 로직 하이 신호로 유지되는 지속 시간이 임계 시간 이상인지 판단하는 단계; 및상기 지속 시간이 상기 임계 시간 이상인 경우에만 상기 VOL 모니터에서 상기 디지털 송신 신호를 수신하는 단계를 더 포함하되,상기 임계 시간은 상기 구동 회로가 1-비트의 데이터를 전송하는 데 걸리는 시간의 배수로 결정되는 메모리 인터페이스 회로의 출력 임피던스 보정 방법
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1 과학기술정보통신부 한국전자통신연구원(ETRI) 정보통신 방송연구개발사업 LPDDR5 기반 인공지능 반도체용 고대역폭 메모리 인터페이스 기술 개발