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나노로드 구조체의 제조방법 및 이를 적용한 전자소자의 제조방법

  • 기술번호 : KST2022002080
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 나노로드 구조체의 제조방법 및 이를 적용한 전자소자의 제조방법에 관해 개시되어 있다. 개시된 나노로드 구조체의 제조방법은 기판 상에 마스크층을 형성하되 상기 마스크층은 상기 기판의 제1 영역을 노출시키는 제1 개구부를 갖는 메인 마스크 패턴과 상기 제1 개구부 내에 구비되어 상기 제1 영역의 일부를 가려주는 보조 마스크 패턴을 포함하도록 형성하는 단계, 상기 제1 개구부에 의해 노출되고 상기 보조 마스크 패턴에 의해 그 일부가 가려진 상기 기판의 제1 영역으로부터 Ⅲ-Ⅴ족 계열의 반도체를 포함하는 나노로드 구조체를 성장시키는 단계 및 상기 나노로드 구조체를 상기 기판으로부터 분리하는 단계를 포함할 수 있다.
Int. CL H01L 33/00 (2010.01.01) H01L 33/20 (2010.01.01) H01L 33/32 (2010.01.01)
CPC H01L 33/0093(2013.01) H01L 33/20(2013.01) H01L 33/32(2013.01)
출원번호/일자 1020200101796 (2020.08.13)
출원인 고려대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0021223 (2022.02.22) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 20

출원인

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번호 이름 국적 주소
1 고려대학교 산학협력단 대한민국 서울특별시 성북구

발명자

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번호 이름 국적 주소
1 김태환 서울특별시 성북구
2 이인환 서울특별시 성북구

대리인

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번호 이름 국적 주소
1 특허법인 천지 대한민국 서울특별시 강남구 논현로**길 **, *층(역삼동, 신한빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2020.08.13 수리 (Accepted) 1-1-2020-0853390-37
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번호 청구항
1 1
기판 상에 마스크층을 형성하되, 상기 마스크층은 상기 기판의 제1 영역을 노출시키는 제1 개구부를 갖는 메인 마스크 패턴과 상기 제1 개구부 내에 구비되어 상기 제1 영역의 일부를 가려주는 보조 마스크 패턴을 포함하도록 형성하는 단계; 상기 제1 개구부에 의해 노출되고 상기 보조 마스크 패턴에 의해 그 일부가 가려진 상기 기판의 제1 영역으로부터 Ⅲ-Ⅴ족 계열의 반도체를 포함하는 나노로드 구조체를 성장시키는 단계; 및 상기 나노로드 구조체를 상기 기판으로부터 분리하는 단계;를 포함하는, 나노로드 구조체의 제조방법
2 2
제 1 항에 있어서, 상기 메인 마스크 패턴은 복수의 상기 제1 개구부를 포함하고, 각각의 상기 제1 개구부 내에 상기 보조 마스크 패턴이 구비된 나노로드 구조체의 제조방법
3 3
제 1 항에 있어서, 상기 제1 개구부 내에 구비된 상기 보조 마스크 패턴은 하나 또는 복수 개의 도트(dot) 패턴으로 구성된 나노로드 구조체의 제조방법
4 4
제 1 항에 있어서, 상기 제1 개구부 내에 구비된 상기 보조 마스크 패턴은 상기 제1 영역의 40% 내지 80%에 해당하는 면적을 가려주도록 구성된 나노로드 구조체의 제조방법
5 5
제 1 항에 있어서, 상기 Ⅲ-Ⅴ족 계열의 반도체는 GaN을 포함하는 나노로드 구조체의 제조방법
6 6
제 1 항에 있어서, 상기 나노로드 구조체는 제1 도전형 반도체, 활성층 및 제2 도전형 반도체를 포함하는 발광구조체인 나노로드 구조체의 제조방법
7 7
제 6 항에 있어서, 상기 나노로드 구조체는 단순 적층 구조를 갖고, 상기 제1 도전형 반도체의 상면에 상기 활성층이 구비되고, 상기 활성층의 상면에 상기 제2 도전형 반도체가 구비된 나노로드 구조체의 제조방법
8 8
제 6 항에 있어서, 상기 나노로드 구조체는 코어-쉘(core-shell) 구조를 갖고, 상기 제1 도전형 반도체는 코어부를 구성하고, 상기 활성층 및 상기 제2 도전형 반도체는 상기 코어부를 순차로 감싸는 껍질부를 구성하는 나노로드 구조체의 제조방법
9 9
제 1 항에 있어서, 상기 나노로드 구조체는 100∼1000 nm의 직경을 갖는 나노로드 구조체의 제조방법
10 10
청구항 1 내지 9 중 어느 하나에 기재된 방법을 이용해서 나노로드 구조체를 마련하는 단계; 및 상기 나노로드 구조체를 포함하는 전자소자를 제조하는 단계;를 포함하는, 전자소자의 제조방법
11 11
제 10 항에 있어서, 상기 전자소자는 LED 디스플레이를 포함하는 전자소자의 제조방법
12 12
기판을 포함하는 하부구조체 상에 상기 하부구조체의 일부 영역들을 가려주는 마스크 패턴층을 형성하는 단계; 상기 마스크 패턴층에 의해 가려지지 않고 노출된 상기 하부구조체의 영역으로부터 Ⅲ-Ⅴ족 계열의 반도체를 포함하는 물질층을 성장시키되, 상기 마스크 패턴층을 덮도록 상기 물질층을 성장시키는 단계; 상기 물질층을 상기 마스크 패턴층이 노출될 때까지 패터닝하여 상기 물질층으로부터 나노로드 구조체를 형성하되, 상기 나노로드 구조체와 상기 하부구조체 사이에 상기 마스크 패턴층의 일부가 개재되도록 상기 나노로드 구조체를 형성하는 단계; 및 상기 나노로드 구조체를 상기 하부구조체로부터 분리하는 단계;를 포함하는, 나노로드 구조체의 제조방법
13 13
제 12 항에 있어서, 상기 하부구조체는 상기 기판 및 상기 기판 상에 구비된 하지층(underlayer)을 포함하고, 상기 마스크 패턴층은 상기 하지층 상에 형성되는 나노로드 구조체의 제조방법
14 14
제 12 항에 있어서, 상기 마스크 패턴층은 규칙적으로 배열된 복수의 도트(dot) 패턴을 포함하는 나노로드 구조체의 제조방법
15 15
제 12 항에 있어서, 상기 나노로드 구조체와 상기 하부구조체 사이에 개재된 상기 마스크 패턴층의 일부는 상기 나노로드 구조체의 수평 단면의 40% 내지 80%에 해당하는 면적을 가려주도록 구성된 나노로드 구조체의 제조방법
16 16
제 12 항에 있어서, 상기 Ⅲ-Ⅴ족 계열의 반도체는 GaN을 포함하는 나노로드 구조체의 제조방법
17 17
제 12 항에 있어서, 상기 나노로드 구조체는 제1 도전형 반도체, 활성층 및 제2 도전형 반도체를 포함하는 발광구조체인 나노로드 구조체의 제조방법
18 18
제 12 항에 있어서, 상기 나노로드 구조체는 100∼1000 nm의 직경을 갖는 나노로드 구조체의 제조방법
19 19
청구항 12 내지 18 중 어느 하나에 기재된 방법을 이용해서 나노로드 구조체를 마련하는 단계; 및 상기 나노로드 구조체를 포함하는 전자소자를 제조하는 단계;를 포함하는, 전자소자의 제조방법
20 20
제 19 항에 있어서, 상기 전자소자는 LED 디스플레이를 포함하는 전자소자의 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.