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스트레처블 N-doped 그래핀 TFT 및 이의 제조방법

  • 기술번호 : KST2022002334
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 게이트 전극, 상기 게이트 전극 위에 접촉하는 게이트 절연층, 상기 게이트 절연층의 일부 영역에 위치하여 질소 도핑된 그래핀층을 포함하여 채널로 사용되는 활성층, 상기 활성층의 일측에 접촉하는 제1 전극 및 상기 활성층의 타측에 접촉하는 제2 전극을 포함하며, 상기 게이트 절연층은 신축성이 있는 고분자소재로 제공되는 스트레처블 N-doped 그래핀 TFT
Int. CL H01L 29/786 (2006.01.01) H01L 29/16 (2006.01.01) H01L 29/423 (2006.01.01) H01L 29/49 (2006.01.01) H01L 51/05 (2006.01.01) H01L 29/66 (2006.01.01) H01L 51/00 (2006.01.01)
CPC H01L 29/78684(2013.01) H01L 29/1606(2013.01) H01L 29/42384(2013.01) H01L 29/4908(2013.01) H01L 51/0516(2013.01) H01L 29/66045(2013.01) H01L 51/0545(2013.01) H01L 51/0558(2013.01) H01L 51/0045(2013.01)
출원번호/일자 1020200102162 (2020.08.14)
출원인 충남대학교산학협력단
등록번호/일자
공개번호/일자 10-2022-0021517 (2022.02.22) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2020.08.14)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 충남대학교산학협력단 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 윤순길 대전시 유성구
2 한이레 대전시 서구

대리인

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번호 이름 국적 주소
1 특허법인오암 대한민국 대전광역시 서구 문예로 **, *층 ***호(둔산동, 오성빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2020.08.14 수리 (Accepted) 1-1-2020-0855888-19
2 선행기술조사의뢰서
Request for Prior Art Search
2021.06.18 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2021.09.09 발송처리완료 (Completion of Transmission) 9-6-2021-0198834-25
4 특허고객번호 정보변경(경정)신고서·정정신고서
2021.10.05 수리 (Accepted) 4-1-2021-5261638-12
5 의견제출통지서
Notification of reason for refusal
2021.11.10 발송처리완료 (Completion of Transmission) 9-5-2021-0886570-03
6 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2022.01.06 수리 (Accepted) 1-1-2022-0018411-70
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2022.01.06 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2022-0018412-15
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번호 청구항
1 1
게이트 전극;상기 게이트 전극 위에 접촉하는 게이트 절연층;상기 게이트 절연층의 일부 영역에 위치하여 질소 도핑된 그래핀층을 포함하여 채널로 사용되는 활성층;상기 활성층의 일측에 접촉하는 제1 전극; 및상기 활성층의 타측에 접촉하는 제2 전극;을 포함하며, 상기 게이트 절연층은 신축성이 있는 고분자소재로 제공되는 스트레처블 N-doped 그래핀 TFT
2 2
제 1항에 있어서, 상기 질소 도핑된 그래핀층은,무산소 분위기에서 게이트 절연층 위에 티타늄(Ti)층이 증착된 후 In-situ로 그래핀층이 직접 생성되고 도핑된 질소 도핑 그래핀층/TiO2-x층인 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
3 3
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 게이트전극이 그래핀층을 포함하는 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
4 4
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 제1 전극 및 제2 전극은 그래핀층/TiO2-x층을 포함하는 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
5 5
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 신축성이 있는 고분자소재는 폴리이미드(polyimide), 열가소성 탄성 중합체(polyurethane thermoplastic elastomers), 폴리아미드(polyamides), 폴리우레탄(polyurethanes), 폴리올레핀(polyolefin), 합성고무(synthetic rubbers), 폴리우레탄폴리클로로프렌(polychloroprene), 실리콘, 스티렌계 물질(styrenic materials), 열가소성 탄성 중합체(thermoplastic elastomer), 폴리부타디엔(polybutadiene), 폴리디메틸실록산(polydimethylsiloxane; PDMS), 폴리이소부티렌(polyisobutylene), 올레핀계 물질(olefenic materials) 및 이들의 조합들로 이루어진 군에서 선택되는 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
6 6
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 스트레처블 N-doped 그래핀 TFT의 투명도가 90% 이상인 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
7 7
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 TFT에서 상기 채널과 수평한 방향인 수평방향 또는 상기 채널에 수직한 방향인 수직방향 중 어느 하나의 방향으로 120% 인장 시 점멸비(On/off ratio)가 1
8 8
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 TFT를 수평방향 또는 수직방향 중 어느 하나의 방향으로 120% 인장 시 전기전하이동도(Mobility)가 250㎠/V·S을 초과하는 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
9 9
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 TFT를 수평방향 또는 수직방향 중 어느 하나의 방향으로 120% 인장 시 서브문턱 스윙(Subthreshold Swing)이 0
10 10
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 TFT를 수평방향으로 120% 인장 하는 것을 3,000번 반복 수행하는 동안 점멸비(On/off ratio)가 1
11 11
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 TFT를 수평방향으로 120% 인장 하는 것을 3,000번 반복 수행하는 동안 전기전하이동도(Mobility)가 200㎠/V·S을 초과하는 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
12 12
제 1항 또는 제 2항 중 어느 한 항에 있어서, 상기 TFT를 수평방향으로 120% 인장 하는 것을 3,000번 반복 수행하는 동안 서브문턱 스윙(Subthreshold Swing)이 35%미만으로 증가하는 것을 특징으로 하는, 스트레처블 N-doped 그래핀 TFT
13 13
신축성이 있는 고분자소재로 제공되는 게이트 절연층 위에 티타늄(Ti)층을 증착하는 단계;in-situ로 상기 티타늄(Ti)층 위에 그래핀층을 성장시키는 단계;플라즈마 처리를 통해 상기 그래핀층에 결함(defect)을 형성하는 단계; 및 상기 결함이 형성된 그래핀층을 질소 도핑하는 단계;를 포함하여 채널로 사용되는 활성층을 형성하는 것을 특징으로 하는, 그래핀 기반의 TFT 제조방법
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제 13항에 있어서,상기 활성층 형성단계 이후에 제1 전극 및 제2 전극을 형성한 후 100 내지 400℃에서 어닐링하는 단계를 더 포함하는 것을 특징으로 하는, 그래핀 기반의 TFT 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 충남대학교 개인기초연구(과기정통부)(R&D) 투명하고 유연한 정보 전자소자를 위한 신 개념의 in-situ 그래핀 성장 원천기술 개발