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반도체 패키지의 제조 방법

  • 기술번호 : KST2022003489
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 반도체 패키지의 제조 방법을 개시한다. 그의 방법은, 하부 기판, 하부 전극, 하부 범프 층, 및 환원제 층을 포함하는 하부 소자를 준비하는 단계와, 상부 기판, 상부 전극, 및 상부 범프 층을 포함하는 상부 소자를 제공하는 단계와, 상기 상부 기판 상에 가압 부재를 제공하여 상기 상부 기판을 상기 하부 기판에 압착하는 단계와, 상기 가압 부재를 투과하는 레이저 빔을 제공하여 상기 상부 소자를 상기 하부 소자에 접합하는 단계를 포함한다.
Int. CL B23K 26/20 (2014.01.01) B23K 101/40 (2006.01.01)
CPC
출원번호/일자 1020210077893 (2021.06.16)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2022-0043007 (2022.04.05) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020200126348   |   2020.09.28
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.06.16)
심사청구항수 20

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 최광성 대전광역시 유성구
2 엄용성 대전광역시 유성구
3 주지호 대전광역시 유성구
4 최광문 대전광역시 유성구
5 문석환 대전광역시 유성구
6 이찬미 대전광역시 유성구
7 장기석 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2021.06.16 수리 (Accepted) 1-1-2021-0692522-25
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번호 청구항
1 1
하부 기판, 상기 하부 기판 상의 하부 전극, 상기 하부 전극 상의 하부 범프 층, 및 상기 하부 범프 층 상의 환원제 층을 포함하는 하부 소자를 준비하는 단계;상부 기판, 상기 상부 기판 상의 상부 전극, 및 상기 상부 전극 상의 상부 범프 층을 포함하는 상부 소자를 제공하는 단계;상기 상부 기판 상에 가압 부재를 제공하여 상기 상부 기판을 상기 하부 기판에 압착하는 단계; 및상기 가압 부재를 투과하는 레이저 빔을 상기 상부 기판에 제공하여 상기 상부 기판 및 상기 상부 전극의 전도 열을 이용하여 상기 하부 범프 층, 상기 환원제 층, 및 상기 상부 범프 층을 금속간 화합물 층으로 형성시키는 단계를 포함하는 반도체 패키지의 제조 방법
2 2
제 1 항에 있어서,상기 하부 소자는:상기 하부 범프 층과 상기 환원제 층 사이의 경화제 층; 및 상기 경화제 층과 상기 환원제 층 사이의 베이스 물질 층을 더 포함하는 반도체 패키지의 제조방법
3 3
제 2 항에 있어서,상기 경화제 및 상기 베이스 물질 층은 상기 금속간 화합물 층 둘레의 보호 층으로 형성되는 반도체 패키지의 제조 방법
4 4
제 3 항에 있어서,상기 레이저 빔을 투과하는 DI 워터 내에 상기 하부 소자와 상기 상부 소자를 침지하는 단계를 더 포함하되,상기 DI 워터는 상기 보호 층을 상기 하부 전극 및 상기 상부 전극의 둘레에 상기 보호 층을 형성시키는 반도체 패키지의 제조방법
5 5
제 4 항에 있어서,상기 DI 워터를 버블링시키는 단계를 더 포함하는 반도체 패키지의 제조방법
6 6
제 4 항에 있어서,상기 DI 워터를 제거하여 상기 하부 소자 및 상기 상부 소자를 건조하는 단계를 더 포함하는 반도체 패키지의 제조방법
7 7
제 2 항에 있어서,상기 경화제는 알리파틱 아민을 포함하되,상기 베이스 물질 층은 에폭시를 포함하는 반도체 패키지의 제조방법
8 8
제 1 항에 있어서,상기 하부 소자는 상기 하부 범프 층과 상기 환원제 층 사이의 흡수 층을 더 포함하는 반도체 패키지의 제조방법
9 9
제 8 항에 있어서,상기 흡수 층은:판상 흡수체; 및상기 판상 흡수체에 결합되는 금속 파우더를 포함하는 반도체 패키지의 제조방법
10 10
제 9 항에 있어서,상기 판상 흡수체는 그래핀을 포함하는 반도체 패키지의 제조방법
11 11
제 9 항에 있어서,상기 금속 파우더는 니켈 또는 구리를 포함하는 반도체 패키지의 제조방법
12 12
제 1 항에 있어서,상기 하부 기판은 상기 상부 소자 외곽의 격벽들을 더 포함하는 반도체 패키지의 제조방법
13 13
제 12 항에 있어서,상기 가압 부재와 상기 격벽들 사이 및 상기 가압 부재와 상기 상부 기판 사이의 폴리머 필름을 제공하는 단계 더 포함하는 반도체 패키지의 제조방법
14 14
제 13 항에 있어서,상기 폴리머 필름은 투명하고 아래로 볼록한 모양을 갖는 반도체 패키지의 제조방법
15 15
제 13 항에 있어서,상기 폴리머 필름은 PMMA, 폴리아크릴레이트, 또는 폴리이미드를 포함하는 반도체 패키지의 제조방법
16 16
제 12 항에 있어서,상기 가압 부재와 상기 격벽들 사이 및 상기 가압 부재와 상기 상부 기판 사이의 탄성 부재를 제공하는 단계를 더 포함하되,상기 탄성 부재는 PDMA, 실리콘 또는 실리카를 포함하는 반도체 패키지의 제조방법
17 17
제 1 항에 있어서,상기 하부 범프 층은 니켈, 구리, 및 니켈 구리 합금을 포함하는 반도체 패키지의 제조방법
18 18
제 1 항에 있어서,상기 환원제 층은 카르복실 하이드레이트, 하이드록실 하이드레이트, 및 패놀릭 하이드레이트의 수화물을 포함하는 반도체 패키지의 제조방법
19 19
제 1 항에 있어서,상기 상부 범프 층은 주석, 인듐, 주석 비스무스, 주석 은 구리, 주석 은, 금 주석, 인듐 주석, 및 비스무스 인듐 주석의 솔더를 포함하는 반도체 패키지의 제조방법
20 20
제 1 항에 있어서,상기 하부 기판은 발광 소자를 포함하되,상기 상부 기판은 리드를 포함하는 반도체 패키지의 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 한국전자통신연구원(ETRI) 국가핵심소재연구단(플랫폼형) 마이크로 LED 전사·접합 일괄 공정용 다기능 핵심소재 기술 개발
2 과학기술정보통신부 한국전자통신연구원(ETRI) 국가핵심소재연구단(플랫폼형) 개발 도금 소재 활용 HBM2급 적층 칩 접합 기술 및 신뢰성 향상 기술 개발