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염소화 패시베이션층을 포함하는 디바이스 및 이의 제조방법

  • 기술번호 : KST2022005107
  • 담당센터 : 인천기술혁신센터
  • 전화번호 : 032-420-3580
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본원은, 염소화 패시베이션층의 보호막 형성을 통한 산소 대기에서 안정성이 증가된 다바이스 및 이의 제조방법에 관한 것이다.
Int. CL H01L 31/18 (2006.01.01)
CPC
출원번호/일자 1020210145230 (2021.10.28)
출원인 이화여자대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0059415 (2022.05.10) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020200144439   |   2020.11.02
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.10.28)
심사청구항수 13

출원인

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번호 이름 국적 주소
1 이화여자대학교 산학협력단 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 조윌렴 서울특별시 강남구
2 김지현 서울특별시 서대문구

대리인

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번호 이름 국적 주소
1 특허법인엠에이피에스 대한민국 서울특별시 강남구 테헤란로*길 **, *층 (역삼동, 한동빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2021.10.28 수리 (Accepted) 1-1-2021-1238743-16
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번호 청구항
1 1
기판; 및 상기 기판 상에 형성된 반도체 물질층을 포함하는 디바이스로서,상기 반도체 물질층 표면, 상기 기판 및 상기 반도체 물질층 사이, 또는 상기 둘 모두에 염소화 패시베이션층을 포함하는,디바이스
2 2
제 1 항에 있어서,상기 염소화 패시베이션층은 상기 기판, 상기 반도체 물질층의 표면 또는 상기 둘 모두에 존재하는 결함(defects)을 치유 및 보호하는 것인, 디바이스
3 3
제 1 항에 있어서,상기 반도체 물질층 표면과 상기 기판의 표면은 오존 분위기에서 UV가 조사되어 표면 결함이 치유된 것인, 디바이스
4 4
제 1 항에 있어서, 상기 반도체 물질은 내부에 염소화 패시베이션 물질을 추가 포함하는, 디바이스
5 5
제 1 항에 있어서,상기 반도체 물질층은 SnO2, TiO2, ZnO, WO3, RuO2, LaxSr1-xCoO3, LaxSr1-xMnO3, BaSnO3 및 LaNiO3 중에서 선택되는 하나 이상을 포함하는 것이고,0 003c# x ≤ 0
6 6
제 1 항에 있어서,상기 기판은 ITO 또는 FTO를 포함하는 것인, 디바이스
7 7
제 1 항에 있어서,상기 디바이스는 메모리소자(memory device), 태양광소자(solar cell) 또는 광전소자(optoelectronic device)를 포함하는 것인, 디바이스
8 8
기판에 반도체 물질층 원료를 코팅하는 단계;코팅된 반도체 물질층에 오존 분위기 하에서 UV를 조사하여 표면 처리하는 단계; 및표면 처리된 반도체 물질층 상에 염소화 패시베이션 전구체를 스핀코팅하는 단계를 포함하는, 제 1 항에 따른 디바이스의 제조방법
9 9
기판에 염소화 패시베이션 전구체를 스핀코팅하는 단계; 및형성된 염소화 패시베이션층에 반도체 물질층 원료를 코팅하는 단계를 포함하는, 제 1 항에 따른 디바이스의 제조방법
10 10
제 9 항에 있어서,상기 기판 또는 코팅된 반도체 물질층에 오존 분위기 하에서 UV를 조사하여 표면 처리하는 단계를 추가 포함하는, 디바이스의 제조방법
11 11
제 9 항에 있어서,코팅된 반도체 물질층 상에 염소화 패시베이션 전구체를 스핀코팅하는 단계를 추가 포함하는, 디바이스의 제조방법
12 12
기판에 오존 분위기 하에서 UV를 조사하여 표면 처리하는 단계;반도체 물질층 원료에 염소화 패시베이션 전구체를 혼합하는 단계; 및상기 기판에 상기 혼합된 반도체 물질층 원료를 코팅하는 단계 를 포함하는, 제 1 항에 따른 디바이스의 제조방법
13 13
제 8 항, 제 9 항 및 제 12 항 중 어느 한 항에 있어서,상기 염소화 패시베이션 전구체의 스핀코팅에서의 열처리 온도는 50℃ 내지 150℃인 것인, 디바이스의 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 교육부 이화여자대학교 이공학학술연구기반구축(R&D) 신재생에너지연구센터