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나노로드 발광소자 및 그 제조 방법

  • 기술번호 : KST2022007366
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 나노로드 발광소자를 기판과 분리하기 전에 오믹 컨택층 및 전도체층을 우선적으로 형성하여 나노로드 발광소자를 정렬 후 높은 온도의 열처리 공정을 회피하여, 나노로드 발광소자의 양자효율을 최대화하면서, 전기적 쇼트를 방지하고, LED(light emitting didoe) 디스플레이를 이루는 물질의 선택 폭을 늘릴 수 있는 기술에 관한 것으로, 본 발명의 일실시예에 따른 나노로드 발광소자는 제1 반도체층, 다중 양자 우물 구조층, 제2 반도체층 및 상기 제1 반도체층 및 상기 제2 반도체층 중 적어도 하나의 반도체층 상에 형성되는 전도체층을 포함하고, 상기 전도체층은 상기 전도체층이 정렬될 전극 패턴 상에서 상기 전극 패턴의 두 개의 전극 사이에 상기 다중 양자 우물 구조층이 위치하도록 길이 및 형태가 제어될 수 있다.
Int. CL H01L 33/24 (2010.01.01) H01L 33/06 (2010.01.01) H01L 33/32 (2010.01.01) H01L 33/62 (2010.01.01) H01L 33/00 (2010.01.01) H01L 33/12 (2010.01.01) H01L 33/44 (2010.01.01) H01L 33/38 (2010.01.01) H01L 33/14 (2010.01.01)
CPC H01L 33/24(2013.01) H01L 33/06(2013.01) H01L 33/32(2013.01) H01L 33/62(2013.01) H01L 33/0008(2013.01) H01L 33/0075(2013.01) H01L 33/12(2013.01) H01L 33/44(2013.01) H01L 33/38(2013.01) H01L 33/14(2013.01) H01L 2933/0058(2013.01) H01L 2933/0066(2013.01)
출원번호/일자 1020200156793 (2020.11.20)
출원인 고려대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0070127 (2022.05.30) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2020.11.20)
심사청구항수 16

출원인

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번호 이름 국적 주소
1 고려대학교 산학협력단 대한민국 서울특별시 성북구

발명자

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번호 이름 국적 주소
1 이인환 서울특별시 성북구
2 김태환 서울특별시 성북구

대리인

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번호 이름 국적 주소
1 김연권 대한민국 서울특별시 송파구 법원로 ***, ****/****호(문정동, 문정대명벨리온)(시안특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2020.11.20 수리 (Accepted) 1-1-2020-1250446-08
2 보정요구서
Request for Amendment
2020.11.30 발송처리완료 (Completion of Transmission) 1-5-2020-0179382-33
3 [출원서 등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2020.12.17 수리 (Accepted) 1-1-2020-1377037-26
4 선행기술조사의뢰서
Request for Prior Art Search
2021.04.16 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search
2021.07.16 발송처리완료 (Completion of Transmission) 9-6-2022-0008806-36
6 의견제출통지서
Notification of reason for refusal
2022.01.13 발송처리완료 (Completion of Transmission) 9-5-2022-0038760-04
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2022.03.14 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2022-0269811-49
8 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2022.03.14 수리 (Accepted) 1-1-2022-0269810-04
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
제1 반도체층;다중 양자 우물 구조층;제2 반도체층; 및상기 제1 반도체층 및 상기 제2 반도체층 중 적어도 하나의 반도체층 상에 형성되는 전도체층을 포함하고,상기 전도체층은 상기 전도체층이 정렬될 전극 패턴 상에서 상기 전극 패턴의 두 개의 전극 사이에 상기 다중 양자 우물 구조층이 위치하도록 길이 및 형태가 제어되는 것을 특징으로 하는나노로드 발광소자
2 2
제1항에 있어서,상기 적어도 하나의 반도체층과 상기 전도체층 사이에서 오믹 컨택층; 및상기 제1 반도체층, 상기 다중 양자 우물 구조층 및 상기 제2 반도체층의 양 측면에 형성되는 패시베이션(passivation)층을 더 포함하는 것을 특징으로 하는나노로드 발광소자
3 3
제1항 또는 제2항에 있어서,상기 전도체층은 상기 적어도 하나의 반도체층의 상부에 일측으로 기울어진 형태, 상기 적어도 하나의 반도체층과 나란한 형태, 지그재그 형태 중 어느 하나의 형태로 제어되는 것을 특징으로 하는나노로드 발광소자
4 4
제1항에 있어서,상기 전극 패턴은 IDT(interdigitated pattern) 패턴 및 원형 패턴 중 적어도 하나의 전극 패턴을 포함하는 것을 특징으로 하는나노로드 발광소자
5 5
제1항에 있어서,상기 전도체층은 전기도금 방법, 스퍼터링 방법 및 열증착 방법 중 적어도 하나의 방법을 통해 증착되는 것을 특징으로 하는나노로드 발광소자
6 6
제1항에 있어서,상기 제2 반도체층, 상기 다중 양자 우물 구조층 및 상기 제1 반도체층은 기판을 기준으로 순차적으로 형성되어 수직 구조를 이루는 것을 특징으로 하는 나노로드 발광소자
7 7
제1항에 있어서,상기 제1 반도체층은 p형 불순물이 도핑된 질화갈륨(GaN) 반도체층(p-GaN)으로서, 정공을 공급하고,상기 제2 반도체층은 n형 불순물이 도핑된 질화갈륨(GaN) 반도체층(n-GaN)으로서, 전자를 공급하는 것을 특징으로 하는 나노로드 발광소자
8 8
제1항에 있어서,상기 전도체층은 ITO(Indium Tin Oxide) 및 금속 물질 중 적어도 하나의 전도성 물질로 형성되는나노로드 발광소자
9 9
기판 상에 제2 반도체층, 다중 양자 우물 구조층 및 제1 반도체층을 순차적으로 형성하는 단계;상기 제2 반도체층, 상기 다중 양자 우물 구조층, 상기 제1 반도체층 중 상기 제2 반도체층의 일부가 가려지도록 제1 증착방지층을 형성하고, 상기 제1 증착방지층 상에 패시베이션(passivation)층을 코팅하는 단계;상기 제1 반도체층의 상부에서 상기 코팅된 상기 패시베이션(passivation)층을 에칭(etching)하는 단계; 및상기 제1 증착방지층 상에 제2 증착방지층을 형성하고, 상기 제1 반도체층의 상부에 전도체를 증착하되, 제1 전도체층이 정렬될 전극 패턴 상에서 상기 전극 패턴의 두 개의 전극 사이에 상기 다중 양자 우물 구조층이 위치하도록 길이 및 형태를 제어하여 상기 제1 전도체층을 형성하는 단계를 포함하는 것을 특징으로 하는나노로드 발광소자의 제조 방법
10 10
제9항에 있어서,상기 제1 반도체층 상에 상기 제1 전도체층이 형성된 후, 상기 제1 증착방지층 및 상기 제2 증착방지층을 제거하는 단계;상기 기판을 리프트 오프(lift-off)하면서 상기 제2 반도체층의 상부가 노출되도록 상기 제2 반도체층을 에칭하는 단계; 및제3 증착방지층을 형성한 후 상기 제2 반도체층의 상부에 전도체를 증착하되, 상기 두 개의 전극 사이에 상기 다중 양자 우물 구조층이 위치하도록 길이 및 형태를 제어하여 제2 전도체층을 형성하는 단계를 더 포함하는 것을 특징으로 하는나노로드 발광소자의 제조 방법
11 11
제9항에 있어서,상기 제1 전도체층을 형성하는 단계는,나노로드 발광소자의 제조 샘플이 일측으로 기울어진 상태에서 전도체를 기준보다 두껍게 증착하여 상기 일측으로 기울어진 형태의 제1 전도체층을 형성하는 단계를 포함하는 것을 특징으로 하는나노로드 발광소자의 제조 방법
12 12
제9항에 있어서,상기 제1 전도체층을 형성하는 단계는,나노로드 발광소자의 제조 샘플을 회전하는 상태에서 상기 제1 반도체층과 나란한 형태의 제1 전도체층을 형성하는 단계를 포함하는 것을 특징으로 하는나노로드 발광소자의 제조 방법
13 13
제9항에 있어서,상기 제1 전도체층을 형성하는 단계는,나노로드 발광소자의 제조 샘플을 회전하는 상태에서 전도체를 기준보다 두껍게 증착하여 지그재그 형태의 제1 전도체층을 형성하는 단계를 포함하는 것을 특징으로 하는나노로드 발광소자의 제조 방법
14 14
제9항에 있어서,상기 전극 패턴은 IDT(interdigitated pattern) 패턴 및 원형 패턴 중 적어도 하나의 전극 패턴을 포함하는 것을 특징으로 하는나노로드 발광소자의 제조 방법
15 15
제1 전극과 제2 전극을 포함하는 전극 패턴 상에 정렬된 복수의 나노로드 발광소자를 포함하는 디스플레이에 있어서,제1 반도체층, 다중 양자 우물 구조층, 제2 반도체층 및 상기 제1 반도체층 및 상기 제2 반도체층 중 적어도 하나의 반도체층 상에 형성되는 전도체층을 포함하고, 상기 전도체층은 상기 제1 전극과 상기 제2 전극 사이에 상기 다중 양자 우물 구조층이 위치하도록 길이 및 형태가 제어되는 복수의 발광소자를 포함하는 것을 특징으로 하는디스플레이
16 16
제15항에 있어서,상기 전극 패턴은 IDT(interdigitated pattern) 패턴 및 원형 패턴 중 적어도 하나의 전극 패턴을 포함하는 것을 특징으로 하는디스플레이
17 17
제15항에 있어서,상기 제1 반도체층은 p형 불순물이 도핑된 질화갈륨(GaN) 반도체층(p-GaN)으로서, 정공을 공급하고,상기 제2 반도체층은 n형 불순물이 도핑된 질화갈륨(GaN) 반도체층(n-GaN)으로서, 전자를 공급하는 것을 특징으로 하는디스플레이
18 18
제15항에 있어서,상기 제1 전극은 상기 전도체층 중 제1 전도체층과 접촉되고,상기 제2 전극은 상기 전도체층 중 제2 전도체층과 접촉되는 것을 특징으로 하는디스플레이
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.