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멀티레벨 저항 변화형 메모리 소자 및 이의 제조 방법

  • 기술번호 : KST2022011261
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 멀티레벨 저항변화 메모리 소자 및 이의 제조 방법에 관한 것이다. 본 발명의 일 양태에 따르면 제1 전극; 상기 제1 전극에 대향하는 제2 전극; 및 상기 제1 전극과 상기 제2 전극 사이의 저항 변화층을 포함하며, 상기 저항 변화층은 LaNiO3을 포함하는, 멀티레벨(multi-level) 저항변화 메모리 소자가 제공된다. 본 발명에 따른 메모리 소자는 전극 면적, 셋 전압(set voltage) 또는 리셋 전압의 크기에 따라 다양한 상태를 구분 가능하여 멀티레벨 소자의 특성을 갖는다. 또한, 본 소자를 사용하면 고집적화가 가능하고 저장 능력이 우수한 메모리 장치가 제공될 수 있다.
Int. CL H01L 45/00 (2006.01.01) H01L 27/24 (2006.01.01)
CPC H01L 45/147(2013.01) H01L 45/1233(2013.01) H01L 45/1253(2013.01) H01L 45/1625(2013.01) H01L 45/1675(2013.01) H01L 27/2463(2013.01)
출원번호/일자 1020210097768 (2021.07.26)
출원인 연세대학교 산학협력단
등록번호/일자 10-2405553-0000 (2022.05.31)
공개번호/일자
공고번호/일자 (20220603) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.07.26)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 손현철 서울특별시 서대문구
2 이정우 서울특별시 서대문구
3 김재연 서울특별시 서대문구
4 윤창호 서울특별시 서대문구

대리인

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번호 이름 국적 주소
1 특허법인(유한)아이시스 대한민국 서울특별시 강남구 선릉로**길**, **층, **층(코아렌빌딩)

최종권리자

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번호 이름 국적 주소
1 연세대학교 산학협력단 서울특별시 서대문구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2021.07.26 수리 (Accepted) 1-1-2021-0860380-80
2 [우선심사신청]심사청구서·우선심사신청서
2021.07.26 수리 (Accepted) 1-1-2021-0862951-97
3 [우선심사신청]선행기술조사의뢰서
[Request for Preferential Examination] Request for Prior Art Search
2021.07.27 수리 (Accepted) 9-1-9999-9999999-89
4 [우선심사신청]선행기술조사보고서
[Request for Preferential Examination] Report of Prior Art Search
2021.08.06 수리 (Accepted) 9-1-2021-0011487-39
5 의견제출통지서
Notification of reason for refusal
2022.01.26 발송처리완료 (Completion of Transmission) 9-5-2022-0077145-93
6 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2022.03.28 수리 (Accepted) 1-1-2022-0329182-14
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2022.03.28 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2022-0329181-79
8 등록결정서
Decision to grant
2022.05.27 발송처리완료 (Completion of Transmission) 9-5-2022-0394699-66
9 [명세서등 보정]보정서(심사관 직권보정)
2022.06.01 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2022-5011621-82
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번호 청구항
1 1
제1 전극; 상기 제1 전극에 대향하는 제2 전극; 및상기 제1 전극과 상기 제2 전극 사이의 저항 변화층을 포함하며, 상기 저항 변화층은 LaNiO3을 포함하고, 상기 저항 변화층은 상기 제1 전극의 면적에 따라 저항값이 변하는 것을 특징으로 하고,상기 제1 전극의 면적은 1
2 2
삭제
3 3
제1항에 있어서, 상기 저항 변화층은 셋 전압(set voltage) 또는 리셋 전압(reset voltage)의 크기에 따라 저항값이 변하는 것을 특징으로 하는 멀티레벨 저항변화 메모리 소자
4 4
제1항에 있어서, 상기 제2 전극은 산소 반응성이 있는 금속 또는 금속 합금을 포함하는 것을 특징으로 하는 멀티레벨 저항변화 메모리 소자
5 5
제1항에 있어서, 상기 제2 전극은 산소 반응성이 있는 금속 또는 금속 합금을 포함하고 상기 저항 변화층과 접촉하는 하층; 및 상기 하층의 금속 또는 금속 합금과는 상이한 배선용 금속 또는 금속 합금을 포함하는 상층을 포함하는 것을 특징으로 하는 멀티레벨 저항변화 메모리 소자
6 6
제4항 또는 제5항에 있어서, 상기 산소 반응성이 있는 금속 또는 금속 합금은 TiN, TaN, Ti, 또는 Ta 인 것을 특징으로 멀티레벨 저항변화 메모리 소자
7 7
제6항에 있어서, 상기 제1 전극은 Al, W, Cu, Pt, Ir, Au, 또는 Ru를 포함하는 것을 특징으로 하는 멀티레벨 저항변화 메모리 소자
8 8
기판 상에 제1 전극을 형성하는 단계;상기 제1 전극 상에 LaNiO3 을 포함하는 저항 변화층을 형성하는 단계;상기 저항 변화층 상에 제2 전극을 형성하는 단계를 포함하고, 상기 제1 전극의 면적은 1
9 9
제8항에 있어서, 상기 저항 변화층은 10 내지 30%의 산소 분압 조건에서 DC/RF 동시 인가 스퍼터링에 의해 증착되는 것을 특징으로 하는 멀티레벨 저항변화 메모리 소자의 제조 방법
10 10
제9항에 있어서, 상기 DC/RF 동시인가 스퍼터링은 50 내지 200 W 범위의 DC와 50 내지 200 W 범위의 RF 를 이용하는 것을 특징으로 하는 멀티레벨 저항변화 메모리 소자의 제조 방법
11 11
제8항에 있어서, 상기 저항 변화층을 리프트-오프(lift-off) 방식에 의해 패터닝하는 단계를 추가로 포함하는 것을 특징으로 하는 멀티레벨 저항변화 메모리 소자의 제조 방법
12 12
제1항에 기재된 멀티레벨 저항변화 메모리 소자를 포함하는 메모리 장치
13 13
제12항에 있어서, 크로스 포인트 어레이 구조를 갖는 것을 특징으로 하는 메모리 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 연세대학교 산학협력단 전자정보디바이스산업원천기술개발(R&D,정보화) Mott-transition 기반 Forming-less 비휘발성 저항 변화 메모리 및 Array 개발