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아날로그 신호에 대응되는 펄스 신호를 입력받고, 상기 입력된 펄스 신호에 따라 턴온되어 턴온 신호를 출력하는 역치 변환 소자; 및상기 역치 변환 소자에서 출력되는 상기 턴온 신호를 감지하고, 감지된 신호를 이용하여 확률 신호로 변환하는 확률 변환 회로를 포함하는 아날로그-확률 변환기
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제1항에 있어서,상기 펄스 신호의 진폭에 따라 상기 확률 신호가 결정되는 것인 아날로그-확률 변환기
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제2항에 있어서,상기 펄스 신호의 진폭이 커질수록 상기 확률 신호의 확률은 커지고, 상기 펄스 신호의 진폭이 작아질수록 상기 확률 신호의 확률은 작아지는 것인 아날로그-확률 변환기
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제1항에 있어서,상기 역치 변환 소자의 출력단에 연결된 저항을 더 포함하는 아날로그-확률 변환기
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제1항에 있어서, 상기 확률 변환 회로는,상기 턴온 신호와 클럭 신호를 입력받고, 상기 확률 신호를 출력하는 D플립플롭을 포함하는 아날로그-확률 변환기
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제5항에 있어서,상기 턴온 신호와 상기 클럭 신호에 따라 상기 확률 신호가 결정되는 것인 아날로그-확률 변환기
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7
제5항에 있어서,상기 펄스 신호 대비 상기 클럭 신호가 입력되는 타이밍에 따라 상기 확률 신호가 결정되는 것인 아날로그-확률 변환기
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제1항에 있어서, 상기 확률 변환 회로는,상기 턴온 신호를 입력받고, 게이트에 샘플 신호가 인가되는 트랜지스터;상기 트랜지스터와 연결되고, 상기 턴온 신호를 저장하는 커패시터; 및상기 커패시터에 저장된 저장 신호와 셀렉트(select) 신호를 입력받고, 상기 확률 신호를 출력하는 AND 게이트를 포함하는 아날로그-확률 변환기
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제8항에 있어서,상기 턴온 신호는 상기 샘플 신호에 의해 상기 트랜지스터가 턴온되는 동안 상기 커패시터에 저장되는 것인 아날로그-확률 변환기
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제8항에 있어서,상기 확률 신호는 상기 저장 신호와 상기 셀렉트 신호에 의해 결정되는 것인 아날로그-확률 변환기
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11
제8항에 있어서,상기 펄스 신호 대비 상기 샘플 신호가 입력되는 타이밍에 따라 상기 확률 신호가 결정되는 것인 아날로그-확률 변환기
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제1항에 있어서, 상기 확률 변환 회로는,상기 턴온 신호를 입력받고, 게이트에 샘플 신호가 인가되는 트랜지스터;상기 트랜지스터와 연결되고, 상기 턴온 신호를 저장하는 커패시터; 상기 커패시터에 저장된 저장 신호를 입력받고, 상기 저장 신호를 반전하여 반전 신호를 출력하는 NOT 게이트; 및상기 반전 신호와 상기 펄스 신호를 입력받고, 상기 확률 신호를 출력하는 NOR 게이트를 포함하는 아날로그-확률 변환기
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제12항에 있어서,상기 확률 신호는 상기 반전 신호와 상기 펄스 신호에 의해 결정되는 것인 아날로그-확률 변환기
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제12항에 있어서,상기 펄스 신호 대비 상기 샘플 신호가 입력되는 타이밍에 따라 상기 확률 신호가 결정되는 것인 아날로그-확률 변환기
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제12항에 있어서, 상기 펄스 신호는,상기 턴온 신호를 감지하는 감지(detect) 구간; 및상기 감지 구간에서 감지된 감지 결과를 시냅스 소자로 발화(fire) 하는 발화 동작을 수행하는 프로그램(PGM) 구간을 포함하는 것인 아날로그-확률 변환기
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