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딥러닝 하드웨어 가속기를 구비하는 BSPE 및 BSPE 코어

  • 기술번호 : KST2022012742
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 딥러닝 하드웨어 가속기를 구비하는 BSPE 및 BSPE 코어에 관한 것이다. 본 발명에서는 딥러닝에서 수행되는 다수의 뉴런값 및 가중치의 곱셈을 수행하는 비트 시리얼 프로세싱 엘리먼트(Bit Serial Processing Element)로서, 뉴런값과 가중치 곱셈을 비트 시리얼 곱셈기로 처리하는 것을 특징으로 하는 비트 시리얼 프로세싱 엘리먼트가 개시된다. 본 발명에 따른 딥러닝 하드웨어 가속기를 구비하는 BSPE 코어에 의하면 종래 곱셈 알고리즘인 MBS보다 적은 하드웨어 자원과 전력을 소모하여 컨벌루션 연산을 수행할 수 있게 되었다.
Int. CL G06N 3/063 (2006.01.01) G06F 9/28 (2017.01.01) G06F 7/52 (2006.01.01)
CPC G06N 3/063(2013.01) G06F 7/52(2013.01) G06F 9/28(2013.01)
출원번호/일자 1020200183290 (2020.12.24)
출원인 서경대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0091987 (2022.07.01) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2020.12.24)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 서경대학교 산학협력단 대한민국 서울특별시 성북구

발명자

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번호 이름 국적 주소
1 이광엽 서울특별시 성동구
2 조철원 경기도 부천시 소삼로 **, *

대리인

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번호 이름 국적 주소
1 특허법인다울 대한민국 서울 강남구 봉은사로 ***, ***호(역삼동, 혜전빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2020.12.24 수리 (Accepted) 1-1-2020-1410324-45
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번호 청구항
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딥러닝에서 수행되는 다수의 뉴런값 및 가중치의 곱셈을 수행하는 비트 시리얼 프로세싱 엘리먼트(Bit Serial Processing Element)로서,뉴런값과 가중치 곱셈을 수행하는 비트 시리얼 곱셈기 및가중치가 '0'인지 여부를 판별하는 제로판별기를 포함하는 것을 특징으로 하는 비트 시리얼 로 처리하는 것을 특징으로 하는 비트 시리얼 프로세싱 엘리먼트
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제1항에 있어서,가중치의 최상위 비트, 제로판별기 및 비트 시리얼 곱셈기로부터 곱셈 결과를 입력받은 후, (1) 가중치가 '0'인 경우에는 '0'값을 출력하고, (2) 가중치가 '0'이 아니면서 가중치의 부호가 양인 경우에는 상기 비트 시리얼 곱셈기로부터 곱셈 결과를 그대로 출력하고, (3) 가중치가 '0'이 아니면서 가중치의 부호가 음인 경우에는 상기 비트 시리얼 곱셈기로부터 곱셈 결과를 1의 보수로 변환한 후 출력하는 1-보수기를 더 포함하는 것을 특징으로 하는 비트 시리얼 프로세싱 엘리먼트
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제1항 또는 제2항의 비트 시리얼 프로세싱 엘리먼트 및상기 1-보수기의 출력값을 더하는 제1 애드 트리(adder tree)를 포함하고,상기 제1 애드 트리는 상기 1-보수기의 출력값의 최하위 비트부터 p비트까지는 Or 게이트를 이용하여 근사값으로 더하고 나머지 p비트를 초과하는 상위비트는 전가산기(full adder)를 이용하여 더하는 LOA(Lower-part OR approximation Adder)로 구성되는 것을 특징으로 하는 비트 시리얼 프로세싱 엘리먼트 코어
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제3항에 있어서,상기 1-보수기는 가중치가 '0'이 아니면서 가중치의 부호가 음인 경우에 '1'을 출력라인 INV로 출력하는 기능이 더 구비되고,전가산기(full adder)로 구성되며, 상기 INV로부터 입력되는 값을 더하는 제2 애드 트리를 더 포함하는 것을 특징으로 하는 비트 시리얼 프로세싱 엘리먼트 코어
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 세종대학교 산학협력단 ICT융합산업혁신기술개발(R&D) 극사실적인 실시간 가상현실을 위한 모바일 GPU 하드웨어 개발