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델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기

  • 기술번호 : KST2022014823
  • 담당센터 : 부산기술혁신센터
  • 전화번호 : 051-606-6561
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명에 따른 델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기는, SAR(success approximation register) 로직을 이용하여 입력신호(VIN)로부터 N비트의 MSB(most significant bit)를 생성하는 코스(Coarse) 아날로그 디지털 변환부(ADC)와, 델타 시그마 루프를 이용하여 상기 입력신호를 다단 적분한 후 기준 전압과의 비교를 통해 M비트의 출력1을 생성하는 증가형(incremental) 델타 시그마 변조부와, 상기 증가형 델타 시그마 변조부의 2차 적분 출력을 제공받아 3차 적분한 후 기준 전압과의 비교를 통해 L비트의 출력2를 생성하는 확장형 카운팅부와, 상기 MSB, 상기 출력1 및 상기 출력2를 제공받아 최종의 디지털 출력을 생성하는 데시메이션 필터 및 레지스터를 포함할 수 있다.
Int. CL H03M 3/00 (2006.01.01) H03M 1/38 (2006.01.01) H03M 1/14 (2006.01.01)
CPC H03M 3/494(2013.01) H03M 1/38(2013.01) H03M 1/14(2013.01) H03M 2201/627(2013.01) H03M 2201/6372(2013.01) H03M 2201/16(2013.01)
출원번호/일자 1020170160659 (2017.11.28)
출원인 울산과학기술원
등록번호/일자 10-1902972-0000 (2018.09.20)
공개번호/일자
공고번호/일자 (20181002) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2017.11.28)
심사청구항수 11

출원인

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번호 이름 국적 주소
1 울산과학기술원 대한민국 울산광역시 울주군

발명자

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번호 이름 국적 주소
1 김재준 울산광역시 울주군
2 오병주 울산광역시 울주군

대리인

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번호 이름 국적 주소
1 제일특허법인(유) 대한민국 서울특별시 서초구 마방로 ** (양재동, 동원F&B빌딩)

최종권리자

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번호 이름 국적 주소
1 울산과학기술원 울산광역시 울주군
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2017.11.28 수리 (Accepted) 1-1-2017-1186323-62
2 선행기술조사의뢰서
Request for Prior Art Search
2018.05.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2018.07.09 수리 (Accepted) 9-1-2018-0033871-81
4 의견제출통지서
Notification of reason for refusal
2018.07.25 발송처리완료 (Completion of Transmission) 9-5-2018-0504868-51
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2018.08.13 수리 (Accepted) 1-1-2018-0799666-28
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2018.08.13 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0799667-74
7 등록결정서
Decision to grant
2018.09.10 발송처리완료 (Completion of Transmission) 9-5-2018-0616263-98
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.07.03 수리 (Accepted) 4-1-2020-5148444-43
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.08.20 수리 (Accepted) 4-1-2020-5186266-03
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
SAR(success approximation register) 로직을 이용하여 입력신호(VIN)로부터 N비트의 MSB(most significant bit)를 생성하는 코스(Coarse) 아날로그 디지털 변환부(ADC)와,델타 시그마 루프를 이용하여 상기 입력신호를 다단 적분한 후 기준 전압과의 비교를 통해 M비트의 출력1을 생성하는 증가형(incremental) 델타 시그마 변조부와,상기 증가형 델타 시그마 변조부의 2차 적분 출력을 제공받아 3차 적분한 후 기준 전압과의 비교를 통해 L비트의 출력2를 생성하는 확장형 카운팅부와,상기 MSB, 상기 출력1 및 상기 출력2를 제공받아 최종의 디지털 출력을 생성하는 데시메이션 필터 및 레지스터를 포함하는 델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
2 2
제 1 항에 있어서,상기 코스 ADC는,상기 입력신호의 양수 구분을 위해 디지털 신호를 아날로그 신호로 변환하는 제 1 디지털 아날로그 변환부(DAC1)와,상기 DAC1의 출력과 상기 입력신호를 비교하여 그 차이 값을 비트 정보로써 출력하는 제 1 비교기와,상기 제 1 비교기로부터 제공되는 상기 비트 정보를 바탕으로 상기 MSB를 생성하는 SAR 로직부와,생성된 상기 MSB를 저장하는 레지스터 및상기 레지스터의 비트 정보를 가중 평균하여 상기 DAC1에 제공하는 제 1 데이터 가중 평균부(DWA1)를 포함하는 델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
3 3
제 2 항에 있어서,상기 SAR 로직부는,6비트의 MSB를 생성하는델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
4 4
제 2 항에 있어서,상기 DWA1은,1차 노이즈 쉐이핑 효과를 통해 상기 입력신호의 주파수 대역의 노이즈를 낮추어 주는델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
5 5
제 2 항에 있어서,상기 증가형 델타 시그마 변조부는,상기 입력신호를 1차 적분하는 제 1 적분기와,상기 제 1 적분기의 출력을 2차 적분하는 제 2 적분기와,상기 제 2 적분기의 출력에 계수가 곱해진 값과 기준 전압과의 비교를 통해 상기 출력1을 생성하는 제 2 비교기와,상기 제 2 비교기의 상기 출력1을 피드백시켜 디지털 값을 가산 또는 감산하여 아날로그로 변환한 후 상기 입력신호와의 차감을 위해 상기 제 1 적분기의 입력으로 제공하는 회로 수단을 포함하는 델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
6 6
제 5 항에 있어서,상기 회로 수단은,상기 제 2 비교기의 출력 레벨에 따라 상기 출력1에 디지털 값을 가산 또는 감산하는 가감산부와,상기 가감산부의 출력을 가중 평균하는 제 2 데이터 가중 평균부(DWA2)와,상기 제 2 데이터 가중 평균부의 디지털 출력을 아날로그로 변환하여 상기 입력신호와의 차감을 위해 상기 제 1 적분기의 입력으로 제공하는 제 2 디지털 아날로그 변환부(DAC2)를 포함하는 델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
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제 6 항에 있어서,상기 가감산부는,상기 제 2 비교기의 출력 값이 "1"일 때 디지털 값을 K+2로 가산하고, 상기 출력 값이 "0"일 때 디지털 값을 K-2로 감산하는(상기 K는 상기 레지스터에 저장된 상기 MSB 정보인)델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
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제 1 항에 있어서,상기 확장형 카운팅부는,상기 증가형 델타 시그마 변조부의 2차 적분 출력을 제공받아 적분하는 제 3 적분기와,상기 제 3 적분기의 출력과 기준 전압과의 비교를 통해 상기 출력2를 생성하는 제 3 비교기와,상기 제 3 비교기의 디지털 출력을 아날로그로 변환하여 상기 2차 적분 출력과의 가산을 위해 상기 제 3 적분기의 입력으로 제공하는 제 3 디지털 아날로그 변환부(DAC3)를 포함하는 델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
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제 1 항에 있어서,상기 코스 ADC, 상기 증가형 델타 시그마 변조부 및 상기 확장형 카운팅부의 전체 구동을 통해 3개의 OTA(operational transconductance amplifier)를 사용하는 고해상도 모드를 수행할 수 있는델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
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제 1 항에 있어서,상기 코스 ADC와 상기 증가형 델타 시그마 변조부의 선택 구동을 통해 2개의 OTA(operational transconductance amplifier)를 사용하는 중간 해상도 모드를 수행할 수 있는델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
11 11
제 1 항에 있어서,상기 코스 ADC와 상기 확장형 카운팅부의 선택 구동을 통해 1개의 OTA(operational transconductance amplifier)를 사용하는 저전력 모드를 수행할 수 있는델타 시그마 변조 방식을 이용한 아날로그 디지털 변환기
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패밀리정보가 없습니다
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