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삼진 논리 회로 장치

  • 기술번호 : KST2022021701
  • 담당센터 : 대구기술혁신센터
  • 전화번호 : 053-550-1450
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 일 실시예에 따른 회로는, 복수의 제1 카운팅 게이트, 복수의 제1 카운팅 게이트와 연결된 제1 삼진 반가산기(ternary half adder, THA) 및 제2 삼진 반가산기, 제1 삼진 반가산기의 합(sum) 출력 신호 및 제2 삼진 반가산기의 합 출력 신호를 수신하는 제3 삼진 반가산기, 제1 삼진 반가산기의 캐리(carry) 출력 신호 및 제2 삼진 반가산기의 캐리 출력 신호를 수신하는 제1 삼진 합 게이트, 및 제3 삼진 반가산기의 캐리 출력 신호 및 제1 삼진 합 게이트의 출력 신호를 수신하는 제2 삼진 합 게이트를 포함하고, 제3 삼진 반가산기 및 제2 삼진 합 게이트는, 복수의 제1 카운팅 게이트에 인가된 입력 신호들 중 드레인 전압의 개수에 대응하는 전압 신호들을 출력할 수 있다.
Int. CL H03K 19/20 (2006.01.01) H03K 19/0948 (2006.01.01) G06F 7/502 (2006.01.01) G06F 7/503 (2006.01.01)
CPC H03K 19/20(2013.01) H03K 19/0948(2013.01) G06F 7/502(2013.01) G06F 7/503(2013.01)
출원번호/일자 1020210055864 (2021.04.29)
출원인 포항공과대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0148592 (2022.11.07) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.04.29)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 포항공과대학교 산학협력단 대한민국 경상북도 포항시 남구

발명자

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번호 이름 국적 주소
1 강석형 경상북도 포항시 남구
2 김선민 경상북도 포항시 남구
3 이승윤 부산광역시 남구
4 박성혜 대구광역시 북구

대리인

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번호 이름 국적 주소
1 특허법인 무한 대한민국 서울특별시 강남구 언주로 ***, *층(역삼동,화물재단빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2021.04.29 수리 (Accepted) 1-1-2021-0503713-62
2 의견제출통지서
Notification of reason for refusal
2022.09.07 발송처리완료 (Completion of Transmission) 9-5-2022-0683004-67
3 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2022.11.03 수리 (Accepted) 1-1-2022-1168676-14
4 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2022.11.03 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2022-1168677-59
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번호 청구항
1 1
복수의 제1 카운팅 게이트;상기 복수의 제1 카운팅 게이트와 연결된 제1 삼진 반가산기(ternary half adder, THA) 및 제2 삼진 반가산기;상기 제1 삼진 반가산기의 합(sum) 출력 신호 및 상기 제2 삼진 반가산기의 합 출력 신호를 수신하는 제3 삼진 반가산기;상기 제1 삼진 반가산기의 캐리(carry) 출력 신호 및 상기 제2 삼진 반가산기의 캐리 출력 신호를 수신하는 제1 삼진 합 게이트; 및상기 제3 삼진 반가산기의 캐리 출력 신호 및 상기 제1 삼진 합 게이트의 출력 신호를 수신하는 제2 삼진 합 게이트를 포함하고,상기 제3 삼진 반가산기 및 상기 제2 삼진 합 게이트는, 상기 복수의 제1 카운팅 게이트에 인가된 입력 신호들 중 드레인 전압의 개수에 대응하는 전압 신호들을 출력하는,회로
2 2
제1항에 있어서,상기 복수의 제1 카운팅 게이트의 각각은,해당 제1 카운팅 게이트에 인가된 두개의 입력 전압들이 모두 드레인 전압이 아닌 경우, 접지 전압을 출력하고,상기 해당 제1 카운팅 게이트에 인가된 두개의 입력 신호가 모두 드레인 전압인 경우, 드레인 전압을 출력하고,상기 해당 제1 카운팅 게이트에 인가된 두개의 입력 신호 중 하나의 입력 신호만이 드레인 전압인 경우, 하프 드레인 전압을 출력하는,회로
3 3
제1항에 있어서,복수의 제2 카운팅 게이트;상기 복수의 제2 카운팅 게이트와 연결된 제4 삼진 반가산기 및 제5 삼진 반가산기;상기 제4 삼진 반가산기의 합 출력 신호 및 상기 제5 삼진 반가산기의 합 출력 신호를 수신하는 제6 삼진 반가산기;상기 제4 삼진 반가산기의 캐리 출력 신호 및 상기 제5 삼진 반가산기의 캐리 출력 신호를 수신하는 제3 삼진 합 게이트; 및상기 제6 삼진 반가산기의 캐리 출력 신호 및 상기 제3 삼진 합 게이트의 출력 신호를 수신하는 제4 삼진 합 게이트를 더 포함하는 회로
4 4
제3항에 있어서,상기 복수의 제2 카운팅 게이트 각각은,해당 제2 카운팅 게이트에 인가된 두개의 입력 전압들이 모두 하프 드레인 전압이 아닌 경우, 접지 전압을 출력하고,상기 해당 제2 카운팅 게이트에 인가된 두개의 입력 신호가 모두 하프 드레인 전압인 경우, 드레인 전압을 출력하고,상기 해당 제2 카운팅 게이트에 인가된 두개의 입력 신호 중 하나의 입력 신호만이 하프 드레인 전압인 경우, 하프 드레인 전압을 출력하는,회로
5 5
제1항에 있어서,제1 곱셈 게이트, 제2 곱셈 게이트, 제3 곱셈 게이트, 제4 곱셈 게이트, 제5 곱셈 게이트, 및 제6 곱셈 게이트를 더 포함하고,상기 제1 곱셈 게이트, 상기 제2 곱셈 게이트, 상기 제3 곱셈 게이트, 상기 제4 곱셈 게이트, 상기 제5 곱셈 게이트, 및 상기 제6 곱셈 게이트는, 상기 제3 삼진 반가산기의 합 출력 신호 및 상기 제2 삼진 합 게이트의 출력 신호를 수신하는회로
6 6
제5항에 있어서,복수의 입력 신호들을 수신하는 NNMIN 게이트;선택 신호로서 수신된 상기 NNMIN 게이트의 출력 신호에 기초하여, 입력 신호로서 수신된 상기 제1 곱셈 게이트의 출력 신호 및 접지 전압 중 하나를 선택하여 출력하는 제1 멀티플렉서;선택 신호로서 수신된 상기 NNMIN 게이트의 출력 신호에 기초하여, 입력 신호로서 수신된 상기 제2 곱셈 게이트의 출력 신호 및 접지 전압 중 하나를 선택하여 출력하는 제2 멀티플렉서;선택 신호로서 수신된 상기 NNMIN 게이트의 출력 신호에 기초하여, 입력 신호로서 수신된 상기 제3 곱셈 게이트의 출력 신호 및 접지 전압 중 하나를 선택하여 출력하는 제3 멀티플렉서;선택 신호로서 수신된 상기 NNMIN 게이트의 출력 신호에 기초하여, 입력 신호로서 수신된 상기 제4 곱셈 게이트의 출력 신호 및 접지 전압 중 하나를 선택하여 출력하는 제4 멀티플렉서;선택 신호로서 수신된 상기 NNMIN 게이트의 출력 신호에 기초하여, 입력 신호로서 수신된 상기 제5 곱셈 게이트의 출력 신호 및 접지 전압 중 하나를 선택하여 출력하는 제5 멀티플렉서;선택 신호로서 수신된 상기 NNMIN 게이트의 출력 신호에 기초하여, 입력 신호로서 수신된 상기 제6 곱셈 게이트의 출력 신호 및 접지 전압 중 하나를 선택하여 출력하는 제6 멀티플렉서를 더 포함하는 회로
7 7
제6항에 있어서,상기 NNMIN 게이트는,상기 NNMIN 게이트에 인가된 복수의 입력 전압들 중 최소 전압이 접지 전압인 경우, 접지 전압을 출력하고,상기 NNMIN 게이트에 인가된 복수의 입력 전압들 중 최소 전압이 하프 드레인 전압 및 드레인 전압 중 하나인 경우, 드레인 전압을 출력하는,회로
8 8
복수의 NMIN 게이트;상기 복수의 NMIN 게이트와 각각 연결되는 복수의 표준 삼진 인버터(standard tenary inverter, STI);상기 복수의 표준 삼진 인버터의 출력 신호를 수신하는 NMAX 게이트; 및상기 NMAX 게이트의 출력 신호를 수신하는 표준 삼진 인버터를 포함하고,회로에 인가된 복수의 입력 신호들 중 미리 정한 개수의 입력 신호가 순환(cyclic)하여 상기 NMIN 게이트에 인가되는,회로
9 9
제8항에 있어서,상기 복수의 NMIN 게이트 각각은,해당 NMIN 게이트에 인가된 복수의 입력 전압들 중 최소 전압이 접지 전압인 경우, 드레인 전압을 출력하고,상기 해당 NMIN 게이트에 인가된 복수의 입력 전압들 중 최소 전압이 하프 드레인 전압인 경우, 하프 드레인 전압을 출력하며,상기 해당 NMIN 게이트에 인가된 복수의 입력 전압들 중 최소 전압이 드레인 전압인 경우, 접지 전압을 출력하는회로
10 10
제8항에 있어서,상기 NMAX 게이트는,상기 NMAX 게이트에 인가된 복수의 입력 전압들 중 최대 전압이 접지 전압인 경우, 드레인 전압을 출력하고,상기 NMAX 게이트에 인가된 복수의 입력 전압들 중 최대 전압이 하프 드레인 전압인 경우, 하프 드레인 전압을 출력하며,상기 NMAX 게이트에 인가된 복수의 입력 전압들 중 최대 전압이 드레인 전압인 경우, 접지 전압을 출력하는회로
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 울산과학기술원 나노·소재기술개발(R&D) 그래핀 배리스터 기반 삼진로직 아키텍쳐 연구
2 과학기술정보통신부 울산과학기술원 혁신성장연계지능형반도체선도기술개발(R&D) 다치로직 신소자 집적공정 및 아키텍쳐 검증 연구
3 과학기술정보통신부 광주과학기술원 미래소재디스커버리지원(R&D) 다중 정전용량 소재 및 멤커패시터 응용 기초기술 개발