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아날로그 대 확률 신호 변환기의 정규화 방법

  • 기술번호 : KST2022021712
  • 담당센터 : 대구기술혁신센터
  • 전화번호 : 053-550-1450
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 멤리스터 기반 뉴럴 네트워크 학습의 최적화를 위해 정규화를 수행하는 방법에 대한 것으로, 아날로그 대 확률 신호 변환기를 선형적으로 동작시킬 때 신호 정규화 상수를 적용하는 방법을 제공함으로써 효율적인 인공 신경망 학습이 가능하도록 한 것을 특징으로 한다.
Int. CL G06N 3/063 (2006.01.01) G06N 3/04 (2006.01.01) G06N 7/00 (2022.01.01)
CPC G06N 3/063(2013.01) G06N 3/0472(2013.01) G06N 7/005(2013.01)
출원번호/일자 1020210060555 (2021.05.11)
출원인 포항공과대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0153244 (2022.11.18) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.05.11)
심사청구항수 9

출원인

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번호 이름 국적 주소
1 포항공과대학교 산학협력단 대한민국 경상북도 포항시 남구

발명자

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번호 이름 국적 주소
1 곽명훈 경상북도 포항시 남구
2 황현상 대구광역시 수성구

대리인

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번호 이름 국적 주소
1 이철희 대한민국 서울특별시 강남구 삼성로***길 *, ***호 가디언국제특허법률사무소 (삼성동, 우경빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2021.05.11 수리 (Accepted) 1-1-2021-0542431-40
2 선행기술조사의뢰서
Request for Prior Art Search		 2022.09.16 수리 (Accepted) 9-1-9999-9999999-89
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번호 청구항
1 1
펄스폭을 갖는 아날로그 입력신호를 확률을 갖는 출력신호로 변환하는 아날로그 대 확률 신호 변환기의 정규화 방법에 있어서, 아날로그 입력신호의 펄스폭을 제1 펄스폭(T0)으로 초기화하는 펄스폭 초기화 단계;상기 제1 펄스폭(T0)을 갖는 아날로그 입력신호를 기반으로 딜레이 타임 측정값을 수집하는 딜레이 타임 측정값 수집단계;상기 수집된 딜레이 타임 측정값을 기반으로 선형성을 체크하는 선형성 체크 단계;선형성을 만족하지 않는 경우 평균 딜레이 타임을 측정하는 평균 딜레이 타임 측정단계; 및 상기 측정된 평균 딜레이 타임을 기반으로 하여 펄스폭을 변경하는 펄스폭 변경 단계;를 포함하는 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
2 2
제 1항에 있어서, 선형성이 확보될 때까지 상기 딜레이 타임 측정값 수집단계 내지 상기 펄스폭 변경 단계를 반복하는 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
3 3
제 1항에 있어서, 상기 선형성 체크 단계는,결정계수(coefficient of determination, R2)003e#0
4 4
제 1항에 있어서, 상기 아날로그 대 확률 신호 변환기의 정규화 방법은, 멤리스터 기반의 인공 신경망 학습에 적용 가능한 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
5 5
제1항에 있어서,상기 입력신호를 인가하였을 때 상기 정규화 방법을 적용하기 전의 상기 출력신호의 출력 펄스의 수(n0)를 구하는 제1 단계;상기 입력신호를 인가하였을 때 상기 정규화 방법을 적용한 후의 상기 출력신호의 출력 펄스의 수(n')를 구하는 제2 단계; 및상기 제1 단계에서 구해진 상기 출력 펄스의 수(n0)를 상기 제2 단계에서 구해진 상기 출력 펄스의 수(n')로 나눈 값을 상기 입력신호의 입력 펄스의 수(i)에 곱하는 제3단계;를 더 포함하는 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
6 6
제5항에 있어서, 상기 제1 단계는상기 출력 펄스의 수(n0), 상기 출력 펄스의 수(n') 및 상기 입력펄스의 수(i)를 초기화하는 제1 초기화 단계;상기 입력신호의 펄스폭을 제1 펄스폭(T0)으로 설정하는 제1 펄스폭 설정 단계;상기 입력신호의 입력펄스의 수(i)를 '1'씩 증가시키면서 상기 입력신호를 인가하는 제1 입력신호 인가단계;상기 출력신호가 턴온되었는지 여부를 확인하는 제1 턴온 확인단계; 및상기 출력신호가 턴온된 경우 상기 출력 펄스의 수(n0)를 '1'씩 증가시키면서 상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)에 도달하였는지 확인하고, 상기 출력신호가 턴온되지 아니한 경우에는 바로 상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)에 도달하였는지 확인하는 제1 입력펄스의 수 확인단계;를 포함하는 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
7 7
제6항에 있어서, 상기 제1 입력펄스의 수 확인단계에서 확인결과 상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)보다 작은 경우에는 상기 제1 입력신호 인가단계 내지 상기 제1 입력펄스의 수 확인단계를 반복수행하고상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)에 도달한 경우에는 상기 제2단계를 수행하는 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
8 8
제7항에 있어서, 상기 제2 단계는상기 입력펄스의 수(i)를 초기화하는 제2 초기화 단계;상기 입력신호의 펄스폭을 제2 펄스폭(T')으로 설정하는 제2 펄스폭 설정 단계;상기 입력신호의 입력펄스의 수(i)를 '1'씩 증가시키면서 상기 입력신호를 인가하는 제2 입력신호 인가단계;상기 출력신호가 턴온되었는지 여부를 확인하는 제2 턴온 확인단계; 및상기 출력신호가 턴온된 경우 상기 출력 펄스의 수(n')를 '1'씩 증가시키면서 상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)에 도달하였는지 확인하고, 상기 출력신호가 턴온되지 아니한 경우에는 바로 상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)에 도달하였는지 확인하는 제2 입력펄스의 수 확인단계;를 포함하는 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
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제8항에 있어서, 상기 제2 입력펄스의 수 확인단계에서 확인결과 상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)보다 작은 경우에는 상기 제2 입력신호 인가단계 내지 상기 제2 입력펄스의 수 확인단계를 반복수행하고상기 입력펄스의 수(i)가 미리 설정된 입력펄스의 수(iteration)에 도달한 경우에는 상기 제3단계를 수행하는 것을 특징으로 하는 아날로그 대 확률 신호 변환기의 정규화 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 포항공과대학교산학협력단 전자정보디바이스산업원천기술개발(R＆D) 시냅스 소자 기반 패턴인식 하드웨어 시스템의 시뮬레이션을 통한 소자/회로/아키텍처 플랫폼 개발