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아날로그 신호를 디지털 코드로 변환하는 연속 근사 레지스터 아날로그 디지털 변환기로서,적어도 하나의 상위 어레이 및 종단 커패시터(terminal capacitor)를 포함하되, 상기 적어도 하나의 상위 어레이는 적어도 하나의 커패시터를 포함하며, 상기 디지털 코드의 적어도 하나의 상위 비트에 각각 대응하도록 구성된 커패시터 어레이(capacitor array); 및상기 종단 커패시터 또는 상기 디지털 코드의 최하위 비트(LSB: Least Significant Bit)와 상이한 값을 가지는 비트(이하, 대상비트)에 대응하는 상위 어레이의 하단에 인가되는 전압을 변경시켜 보정코드를 결정하고, 상기 보정코드를 이용하여 상기 디지털 코드를 보정하는 SAR 제어부를 포함하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제1항에 있어서,상기 상위 어레이는, 적어도 하나의 보정 커패시터를 포함하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제2항에 있어서,상기 SAR 제어부는,상기 대상비트에 대응하는 상기 적어도 하나의 보정 커패시터의 하단에 연결된 스위치를 제어하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제1항에 있어서,상기 대상비트에 대응하는 상위 어레이는,상기 대상비트에 대응하는 커패시터에서 적어도 하나의 보정 커패시터가 분리된 형태로 구성되는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제1항에 있어서,상기 종단 커패시터의 하단에 연결되는 차지펌프를 더 포함하고,상기 SAR 제어부는,상기 대상비트에 대응하는 상위 어레이가 없는 경우, 상기 차지펌프를 제어하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제1항에 있어서,상기 커패시터 어레이는, 비교기의 입력단에 각각 연결되는 제1 커패시터 어레이 및 제2 커패시터 어레이를 포함하고,상기 SAR 제어부는,제1 커패시터 어레이 및 제2 커패시터 어레이 중 적어도 하나의 상기 종단 커패시터 또는 상기 대상비트에 대응하는 상위 어레이의 하단에 인가되는 전압을 변경시키는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제6항에 있어서,상기 SAR 제어부는,상기 하단에 인가되는 전압의 변경에 대응해 상기 제1 커패시터 어레이의 상단전압 및 제2 커패시터 어레이의 상단전압이 교차하는지에 기초하여, 상기 보정코드를 결정하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제6항에 있어서,상기 SAR 제어부는,기설정된 횟수 내에서, 상기 제1 커패시터 어레이의 상단전압 및 제2 커패시터 어레이의 상단전압이 교차할 때까지, 상기 하단에 인가되는 전압을 변경시키는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제6항에 있어서,상기 SAR 제어부는,상기 제1 커패시터 어레이 및 제2 커패시터 어레이 중 상기 비교기의 입력단에 인가되는 상단전압이 더 높다고 판단된 커패시터 어레이의 상위 어레이를 이용하여 상기 보정코드를 결정하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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제6항에 있어서,상기 SAR 제어부는,상기 제1 커패시터 어레이 및 제2 커패시터 어레이 중 상기 비교기의 입력단에 인가되는 상단전압이 더 낮다고 판단된 커패시터 어레이의 종단 커패시터를 이용하여 상기 보정코드를 결정하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기
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적어도 하나의 커패시터를 포함하며 디지털 코드의 적어도 하나의 상위 비트에 각각 대응하는 적어도 하나의 상위 어레이 및 종단 커패시터를 포함하는 연속 근사 레지스터 아날로그 디지털 변환기의 동작방법으로서, 아날로그 신호에 대응하는 디지털 코드를 결정하는 과정;상기 종단 커패시터 또는 상기 디지털 코드의 최하위 비트(LSB: Least Significant Bit)와 상이한 값을 가지는 비트에 대응하는 상위 어레이의 하단전압을 변경시켜 보정코드를 결정하는 과정; 및상기 보정코드를 이용하여 상기 디지털 코드를 보정하는 과정을 포함하는 것을 특징으로 하는 연속 근사 레지스터 아날로그 디지털 변환기의 동작방법
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