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시간 증폭기, 이를 포함하는 아날로그-디지털 변환기 및 이미지 센서

  • 기술번호 : KST2022022743
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 커패시터의 자연 방전을 이용하여 전력 소모를 최소화하고, 준안정(metastability)에 의한 문제가 없고, 공정에 따른 시간 이득 변화를 최소화할 수 있으며, 높은 입력 범위를 확보할 수 있는 시간 증폭기, 이를 포함하는 아날로그-디지털 변환기 및 이미지 센서가 개시된다. 본 발명의 실시예에 따른 시간 증폭기는 입력 신호의 에지와 설정된 클록 신호의 에지 간의 시간잔여 차이를 증폭하여 출력하는 시간 증폭기에 있어서, 제1 입력단과 인가되는 제1 전압과 제2 입력단에 인가되는 제2 전압을 비교하여 상기 시간잔여 차이를 증폭하기 위한 출력 클록을 출력하는 비교 회로; 상기 제1 입력단과 접지 사이에 연결되는 시동 커패시터; 상기 제2 입력단과 접지 사이에 상기 시동 커패시터와 병렬로 연결되는 리셋 커패시터; 및 상기 시동 커패시터 및 상기 리셋 커패시터와 병렬로 연결되고, 상기 비교 신호의 에지와 상기 클록 신호의 에지에 의해 생성되는 리셋 신호와 상기 리셋 신호의 에지에 의해 생성되는 시동 신호에 따라 스위칭되는 스위칭부;를 포함한다. 상기 스위칭부는 상기 리셋 신호에 따라 상기 리셋 커패시터를 자연 방전시킨 후, 상기 시동 신호에 따라 상기 시동 커패시터를 자연 방전시키도록 구성된다.
Int. CL H03M 1/56 (2006.01.01) H03M 1/00 (2006.01.01) H03M 1/38 (2006.01.01)
CPC H03M 1/56(2013.01) H03M 1/002(2013.01) H03M 1/38(2013.01)
출원번호/일자 1020210065629 (2021.05.21)
출원인 연세대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0157724 (2022.11.29) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.05.21)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 채영철 서울특별시 서대문구
2 박철언 서울특별시 서대문구

대리인

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번호 이름 국적 주소
1 백두진 대한민국 서울특별시 서초구 바우뫼로 ***, *층(양재동, 혜산빌딩)(시공특허법률사무소)
2 유광철 대한민국 서울특별시 서초구 바우뫼로 *** *층 (양재동, 혜산빌딩)(시공특허법률사무소)
3 김정연 대한민국 서울특별시 서초구 바우뫼로 *** *층(양재동, 혜산빌딩)(시공특허법률사무소)
4 권성현 대한민국 서울특별시 서초구 바우뫼로 *** 혜산빌딩 *층(시공특허법률사무소)
5 강일신 대한민국 서울특별시 서초구 바우뫼로 ***, *층 혜산빌딩(양재동)(시공특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2021.05.21 수리 (Accepted) 1-1-2021-0587773-37
2 선행기술조사의뢰서
Request for Prior Art Search
2022.08.12 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2022.10.06 발송처리완료 (Completion of Transmission) 9-6-2022-0176429-77
4 특허고객번호 정보변경(경정)신고서·정정신고서
2022.10.07 수리 (Accepted) 4-1-2022-5235822-97
5 의견제출통지서
Notification of reason for refusal
2022.10.07 발송처리완료 (Completion of Transmission) 9-5-2022-0766928-08
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번호 청구항
1 1
아날로그 입력신호와 설정된 기준 신호를 비교하여 비교 신호를 생성하는 비교기;상기 비교 신호의 에지와 설정된 클록 신호의 에지 간의 시간잔여 차이를 증폭하기 위한 출력 클록을 생성하는 시간 증폭기; 및상기 출력 클록을 계수하여 디지털 신호로 출력하는 카운터를 포함하되,상기 시간 증폭기는:제1 입력단에 입력되는 제1 전압과 제2 입력단에 입력되는 제2 전압을 비교하여 상기 시간잔여 차이를 증폭하기 위한 출력 클록을 출력하는 비교 회로;상기 제1 입력단과 접지 사이에 연결되는 시동 커패시터;상기 제2 입력단과 접지 사이에 상기 시동 커패시터와 병렬로 연결되는 리셋 커패시터; 및상기 시동 커패시터 및 상기 리셋 커패시터와 병렬로 연결되고, 상기 비교 신호의 에지와 상기 클록 신호의 에지에 의해 생성되는 리셋 신호와 상기 리셋 신호의 에지에 의해 생성되는 시동 신호에 따라 스위칭되는 스위칭부;를 포함하고,상기 스위칭부는 상기 리셋 신호에 따라 상기 리셋 커패시터를 자연 방전시킨 후, 상기 시동 신호에 따라 상기 시동 커패시터를 자연 방전시키도록 구성되는 아날로그-디지털 변환기
2 2
제1항에 있어서,상기 스위칭부는 상기 시동 커패시터의 방전 경로와 상기 리셋 커패시터의 방전 경로를 공유하도록 구성되는 아날로그-디지털 변환기
3 3
제1항에 있어서,상기 스위칭부는:상기 제1 입력단과 연결되는 제1 노드와, 접지 사이에 연결되는 제1 라인;상기 제2 입력단과 연결되는 제2 노드와, 접지 사이에 연결되는 제2 라인;상기 제1 라인 및 상기 제2 라인과 제3 노드에서 연결되고, 상기 제3 노드와 접지 사이에 연결되는 제3 라인;상기 제1 라인에 설치되고, 상기 리셋 신호에 의해 개폐 제어되는 제1 스위치;상기 제2 라인에 설치되고, 상기 시동 신호에 의해 개폐 제어되는 제2 스위치; 및상기 제3 라인에 설치되고, 동작 신호에 의해 개폐 제어되는 제3 스위치;를 포함하는 아날로그-디지털 변환기
4 4
제3항에 있어서,상기 리셋 커패시터는 제4 스위치를 통해 전원을 공급받아 충전되고,상기 시동 커패시터는 제5 스위치를 통해 전원을 공급받아 충전되고,상기 제4 스위치 및 상기 제5 스위치는 상기 동작 신호의 반전 신호인 반전 동작 신호에 의해 개폐 제어되는 아날로그-디지털 변환기
5 5
입사광을 감지하여 아날로그 입력 신호를 발생하는 다수의 픽셀을 포함하는 픽셀 어레이; 및상기 픽셀 어레이의 각 픽셀과 연결되어 상기 아날로그 입력 신호를 디지털 신호로 변환하는 아날로그-디지털 변환기;를 포함하고,상기 아날로그-디지털 변환기는:아날로그 입력 신호와 설정된 기준 신호를 비교하여 비교 신호를 생성하는 비교기;상기 비교 신호의 에지와 설정된 클록 신호의 에지 간의 시간잔여 차이를 증폭하기 위한 출력 클록을 생성하는 시간 증폭기; 및상기 출력 클록을 계수하여 디지털 신호로 출력하는 카운터를 포함하되,상기 시간 증폭기는:제1 입력단에 입력되는 제1 전압과 제2 입력단에 입력되는 제2 전압을 비교하여 상기 시간잔여 차이를 증폭하기 위한 출력 클록을 출력하는 비교 회로;상기 제1 입력단과 접지 사이에 연결되는 시동 커패시터;상기 제2 입력단과 접지 사이에 상기 시동 커패시터와 병렬로 연결되는 리셋 커패시터; 및상기 시동 커패시터 및 상기 리셋 커패시터와 병렬로 연결되고, 상기 비교 신호의 에지와 상기 클록 신호의 에지에 의해 생성되는 리셋 신호와 상기 리셋 신호의 에지에 의해 생성되는 시동 신호에 따라 스위칭되는 스위칭부;를 포함하고,상기 스위칭부는 상기 리셋 신호에 따라 상기 리셋 커패시터를 자연 방전시킨 후, 상기 시동 신호에 따라 상기 시동 커패시터를 자연 방전시키도록 구성되는 이미지 센서
6 6
제5항에 있어서,상기 스위칭부는:상기 제1 입력단과 연결되는 제1 노드와, 접지 사이에 연결되는 제1 라인;상기 제2 입력단과 연결되는 제2 노드와, 접지 사이에 연결되는 제2 라인;상기 제1 라인 및 상기 제2 라인과 제3 노드에서 연결되고, 상기 제3 노드와 접지 사이에 연결되는 제3 라인;상기 제1 라인에 설치되고, 상기 리셋 신호에 의해 개폐 제어되는 제1 스위치;상기 제2 라인에 설치되고, 상기 시동 신호에 의해 개폐 제어되는 제2 스위치; 및상기 제3 라인에 설치되고, 동작 신호에 의해 개폐 제어되는 제3 스위치;를 포함하고,상기 스위칭부는 상기 제3 라인을 통해 상기 시동 커패시터의 방전 경로와 상기 리셋 커패시터의 방전 경로를 공유하도록 구성되는 이미지 센서
7 7
제6항에 있어서,상기 리셋 커패시터는 제4 스위치를 통해 전원을 공급받아 충전되고,상기 시동 커패시터는 제5 스위치를 통해 전원을 공급받아 충전되고,상기 제4 스위치 및 상기 제5 스위치는 상기 동작 신호의 반전 신호인 반전 동작 신호에 의해 개폐 제어되는 이미지 센서
8 8
입력 신호의 에지와 설정된 클록 신호의 에지 간의 시간잔여 차이를 증폭하여 출력하는 시간 증폭기에 있어서,제1 입력단과 인가되는 제1 전압과 제2 입력단에 인가되는 제2 전압을 비교하여 상기 시간잔여 차이를 증폭하기 위한 출력 클록을 출력하는 비교 회로;상기 제1 입력단과 접지 사이에 연결되는 시동 커패시터;상기 제2 입력단과 접지 사이에 상기 시동 커패시터와 병렬로 연결되는 리셋 커패시터; 및상기 시동 커패시터 및 상기 리셋 커패시터와 병렬로 연결되고, 상기 비교 신호의 에지와 상기 클록 신호의 에지에 의해 생성되는 리셋 신호와 상기 리셋 신호의 에지에 의해 생성되는 시동 신호에 따라 스위칭되는 스위칭부;를 포함하고,상기 스위칭부는 상기 리셋 신호에 따라 상기 리셋 커패시터를 자연 방전시킨 후, 상기 시동 신호에 따라 상기 시동 커패시터를 자연 방전시키도록 구성되는 시간 증폭기
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제8항에 있어서,상기 스위칭부는:상기 제1 입력단과 연결되는 제1 노드와, 접지 사이에 연결되는 제1 라인;상기 제2 입력단과 연결되는 제2 노드와, 접지 사이에 연결되는 제2 라인;상기 제1 라인 및 상기 제2 라인과 제3 노드에서 연결되고, 상기 제3 노드와 접지 사이에 연결되는 제3 라인;상기 제1 라인에 설치되고, 상기 리셋 신호에 의해 개폐 제어되는 제1 스위치;상기 제2 라인에 설치되고, 상기 시동 신호에 의해 개폐 제어되는 제2 스위치; 및상기 제3 라인에 설치되고, 동작 신호에 의해 개폐 제어되는 제3 스위치;를 포함하고,상기 스위칭부는 상기 제3 라인을 통해 상기 시동 커패시터의 방전 경로와 상기 리셋 커패시터의 방전 경로를 공유하도록 구성되는 시간 증폭기
10 10
제9항에 있어서,상기 리셋 커패시터는 제4 스위치를 통해 전원을 공급받아 충전되고,상기 시동 커패시터는 제5 스위치를 통해 전원을 공급받아 충전되고,상기 제4 스위치 및 상기 제5 스위치는 상기 동작 신호의 반전 신호인 반전 동작 신호에 의해 개폐 제어되는 시간 증폭기
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.