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연산 증폭기의 DC 오프셋 제거 회로

  • 기술번호 : KST2023001940
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 연산 증폭기의 DC 오프셋 제거 회로가 개시된다. 이 DC 오프셋 제거 회로는 상기 연산 증폭기의 비반전 입력 단자와 상기 입력 전압이 입력되는 입력 단자 사이에 연결되는 제1 샘플링 커패시터; 상기 연산 증폭기의 반전 입력 단자와 상기 입력 단자 사이에 연결되는 제2 샘플링 커패시터; 상기 제1 샘플링 커패시터에 병렬로 연결되는 제1 스위치; 상기 입력 단자와 상기 제2 샘플링 커패시터의 연결을 제어하는 제2 스위치; 상기 연산 증폭기의 반전 입력 단자와 상기 연산 증폭기의 출력 단자의 연결을 제어하는 제3 스위치; 및 상기 입력 단자와 상기 연산 증폭기의 출력 단자의 연결을 제어하는 제4 스위치를 포함한다.
Int. CL H03F 3/45 (2006.01.01) H03F 3/00 (2006.01.01)
CPC H03F 3/45986(2013.01) H03F 3/45475(2013.01) H03F 3/005(2013.01)
출원번호/일자 1020220022176 (2022.02.21)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2023-0075328 (2023.05.31) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020210161455   |   2021.11.22
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 1

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 문현원 경기도 고양시 일산서구

대리인

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번호 이름 국적 주소
1 특허법인지명 대한민국 서울특별시 강남구 남부순환로**** 차우빌딩*층

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2022.02.21 수리 (Accepted) 1-1-2022-0190607-12
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번호 청구항
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입력 전압을 그대로 출력하는 연산 증폭기의 DC 오프셋 제거 회로에 있어서, 상기 연산 증폭기의 비반전 입력 단자와 상기 입력 전압이 입력되는 입력 단자 사이에 연결되는 제1 샘플링 커패시터;상기 연산 증폭기의 반전 입력 단자와 상기 입력 단자 사이에 연결되는 제2 샘플링 커패시터;상기 제1 샘플링 커패시터에 병렬로 연결되는 제1 스위치;상기 입력 단자와 상기 제2 샘플링 커패시터의 연결을 제어하는 제2 스위치;상기 연산 증폭기의 반전 입력 단자와 상기 연산 증폭기의 출력 단자의 연결을 제어하는 제3 스위치; 및상기 입력 단자와 상기 연산 증폭기의 출력 단자의 연결을 제어하는 제4 스위치를 포함하는 연산 증폭기의 DC 오프셋 제거 회로
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 한국전자통신연구원 6G핵심기술개발사업 THz 대역 RF 핵심 부품 개발