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양방향 인터페이스 조합기를 지원하는 하드웨어 기술 언어

  • 기술번호 : KST2023003293
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 개시는 새로운 하드웨어 기술 언어로 설계되는 양방향 인터페이스 조합기 및 그의 설계 방법을 제공한다. 본 개시에 따르면, 양방향 인터페이스 조합기는 적어도 하나의 포트로 각각 이루어지고 일 방향성을 갖는 적어도 하나의 채널을 갖는 입력 인터페이스, 및 적어도 하나의 포트로 각각 이루어지고 일 방향성에 반대되는 다른 방향성을 갖는 적어도 하나의 채널을 갖는 출력 인터페이스를 포함하도록, 하드웨어 기술 언어로 설계된다. 하드웨어 기술 언어는 프로그래밍 언어인 러스트(Rust)에 임베딩되어 구현되며, 베릴로그(Verilog)로 변환 가능하다.
Int. CL G06F 8/30 (2018.01.01) G06F 8/35 (2018.01.01) G06F 8/38 (2018.01.01) G06F 30/32 (2020.01.01) G06F 9/448 (2018.01.01)
CPC G06F 8/31(2013.01) G06F 8/35(2013.01) G06F 8/38(2013.01) G06F 30/32(2013.01) G06F 9/4498(2013.01)
출원번호/일자 1020210182196 (2021.12.17)
출원인 한국과학기술원
등록번호/일자
공개번호/일자 10-2023-0092635 (2023.06.26) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.12.17)
심사청구항수 20

출원인

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번호 이름 국적 주소
1 한국과학기술원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 강지훈 대전광역시 유성구
2 장민성 대전광역시 유성구
3 한성수 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 양성보 대한민국 서울특별시 강남구 선릉로***길 ** (논현동) 삼성빌딩 *층(피앤티특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2021.12.17 수리 (Accepted) 1-1-2021-1468724-21
2 특허고객번호 정보변경(경정)신고서·정정신고서
2023.01.31 수리 (Accepted) 4-1-2023-5023571-05
3 특허고객번호 정보변경(경정)신고서·정정신고서
2023.05.04 수리 (Accepted) 4-1-2023-5110236-33
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
양방향 인터페이스 조합기에 있어서, 적어도 하나의 포트로 각각 이루어지고 일 방향성을 갖는 적어도 하나의 채널을 갖는 입력 인터페이스; 및 적어도 하나의 포트로 각각 이루어지고 상기 일 방향성에 반대되는 다른 방향성을 갖는 적어도 하나의 채널을 갖는 출력 인터페이스를 포함하도록 하드웨어 기술 언어로 설계되는,양방향 인터페이스 조합기
2 2
제 1 항에 있어서, 상기 양방향 인터페이스 조합기는,결합 로직을 갖는 FSM(finite state machine) 모듈을 포함하고, 상기 결합 로직은,적어도 하나의 정방향 입력 포트, 적어도 하나의 역방향 입력 포트, 적어도 하나의 정방향 출력 포트, 및 적어도 하나의 역방향 출력 포트를 갖고, 상기 입력 인터페이스는,상기 정방향 입력 포트와 상기 역방향 입력 포트로 이루어지고, 상기 출력 인터페이스는,상기 정방향 출력 포트와 상기 역방향 출력 포트로 이루어지는,양방향 인터페이스 조합기
3 3
제 1 항에 있어서, 상기 양방향 인터페이스 조합기는,복수의 서브 모듈들로 구성되는 복합 모듈을 포함하고, 상기 복합 모듈의 상기 입력 인터페이스는,상기 서브 모듈들 중 적어도 하나에 대한 입력 인터페이스로 제공되고, 상기 복합 모듈의 상기 출력 인터페이스는,상기 서브 모듈들 중 적어도 하나에 대한 출력 인터페이스로부터 형성되는,양방향 인터페이스 조합기
4 4
제 3 항에 있어서, 상기 복합 모듈의 상기 입력 인터페이스는,적어도 두 개의 서브 모듈들이 병렬로 상기 복합 모듈의 입력단에 연결되는 경우, 상기 적어도 두 개의 서브 모듈들에 대한 입력 인터페이스들로 분할되는,양방향 인터페이스 조합기
5 5
제 3 항에 있어서, 상기 복합 모듈의 상기 출력 인터페이스는,적어도 두 개의 서브 모듈들이 병렬로 상기 복합 모듈의 출력단에 연결되는 경우, 상기 적어도 두 개의 서브 모듈들에 대한 출력 인터페이스들로부터 형성되는,양방향 인터페이스 조합기
6 6
제 3 항에 있어서, 적어도 두 개의 서브 모듈들이 직렬로 서로에 연결되는 경우, 상기 적어도 두 개의 서브 모듈들 중 하나의 출력 인터페이스가 상기 적어도 두 개의 서브 모듈들 중 다른 하나의 입력 인터페이스로 제공되는,양방향 인터페이스 조합기
7 7
제 1 항에 있어서,상기 하드웨어 기술 언어는,프로그래밍 언어인 러스트(Rust)에 임베딩되어 구현된 것인,양방향 인터페이스 조합기
8 8
제 7 항에 있어서,상기 하드웨어 기술 언어는,러스트 유형에 대한 값 특성들로부터 도출되는 값들, 표현들, 채널들, 및 인터페이스들로 구성되는,양방향 인터페이스 조합기
9 9
제 7 항에 있어서, 상기 하드웨어 기술 언어는,베릴로그(Verilog)로 변환되고, 상기 하드웨어 기술 언어가 상기 베릴로그로 변환되면서 생성되는 중복 레지스터들 및 중복 연결들이 제거되는,양방향 인터페이스 조합기
10 10
양방향 인터페이스 조합기의 설계 방법에 있어서, 상기 양방향 인터페이스 조합기가 적어도 하나의 포트로 각각 이루어지고 일 방향성을 갖는 적어도 하나의 채널을 갖는 입력 인터페이스, 및 적어도 하나의 포트로 각각 이루어지고 상기 일 방향성에 반대되는 다른 방향성을 갖는 적어도 하나의 채널을 갖는 출력 인터페이스를 포함하도록, 상기 양방향 인터페이스 조합기를 하드웨어 기술 언어로 설계하는 단계를 포함하는,설계 방법
11 11
제 10 항에 있어서, 상기 양방향 인터페이스 조합기는,결합 로직을 갖는 FSM 모듈을 포함하고, 상기 결합 로직은,적어도 하나의 정방향 입력 포트, 적어도 하나의 역방향 입력 포트, 적어도 하나의 정방향 출력 포트, 및 적어도 하나의 역방향 출력 포트를 갖고, 상기 입력 인터페이스는,상기 정방향 입력 포트와 상기 역방향 입력 포트로 이루어지고, 상기 출력 인터페이스는,상기 정방향 출력 포트와 상기 역방향 출력 포트로 이루어지는,설계 방법
12 12
제 10 항에 있어서, 상기 양방향 인터페이스 조합기는,복수의 서브 모듈들로 구성되는 복합 모듈을 포함하고, 상기 복합 모듈의 상기 입력 인터페이스는,상기 서브 모듈들 중 적어도 하나에 대한 입력 인터페이스로 제공되고, 상기 복합 모듈의 상기 출력 인터페이스는,상기 서브 모듈들 중 적어도 하나에 대한 출력 인터페이스로부터 형성되는,설계 방법
13 13
제 12 항에 있어서,상기 복합 모듈의 상기 입력 인터페이스는,적어도 두 개의 서브 모듈들이 병렬로 상기 복합 모듈의 입력단에 연결되는 경우, 상기 적어도 두 개의 서브 모듈들에 대한 입력 인터페이스들로 분할되는,설계 방법
14 14
제 12 항에 있어서, 상기 복합 모듈의 상기 출력 인터페이스는,적어도 두 개의 서브 모듈들이 병렬로 상기 복합 모듈의 출력단에 연결되는 경우, 상기 적어도 두 개의 서브 모듈들에 대한 출력 인터페이스들로부터 형성되는,설계 방법
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제 12 항에 있어서, 적어도 두 개의 서브 모듈들이 직렬로 서로에 연결되는 경우, 상기 적어도 두 개의 서브 모듈들 중 하나의 출력 인터페이스가 상기 적어도 두 개의 서브 모듈들 중 다른 하나의 입력 인터페이스로 제공되는,설계 방법
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제 10 항에 있어서, 상기 하드웨어 기술 언어는,프로그래밍 언어인 러스트에 임베딩되어 구현된 것인,설계 방법
17 17
제 16 항에 있어서, 상기 하드웨어 기술 언어는,러스트 유형에 대한 값 특성들로부터 도출되는 값들, 표현들, 채널들, 및 인터페이스들로 구성되는,설계 방법
18 18
제 16 항에 있어서, 상기 하드웨어 기술 언어는,베릴로그로 변환되고, 상기 하드웨어 기술 언어가 상기 베릴로그로 변환되면서 생성되는 중복 레지스터들 및 중복 연결들이 제거되는,설계 방법
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양방향 인터페이스 조합기의 설계 방법을 컴퓨터 장치에서 실행시키 위한 적어도 하나의 프로그램이 기록되어 있는 비-일시적 컴퓨터 판독 가능한 기록 매체에 있어서, 상기 설계 방법은, 상기 양방향 인터페이스 조합기가 적어도 하나의 포트로 각각 이루어지고 일 방향성을 갖는 적어도 하나의 채널을 갖는 입력 인터페이스, 및 적어도 하나의 포트로 각각 이루어지고 상기 일 방향성에 반대되는 다른 방향성을 갖는 적어도 하나의 채널을 갖는 출력 인터페이스를 포함하도록, 상기 양방향 인터페이스 조합기를 하드웨어 기술 언어로 설계하는 단계를 포함하는,비-일시적 컴퓨터 판독 가능한 기록 매체
20 20
제 19 항에 있어서,상기 하드웨어 기술 언어는,프로그래밍 언어인 러스트에 임베딩되어 구현된 것인,비-일시적 컴퓨터 판독 가능한 기록 매체
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 주식회사 퓨리오사에이아이 정보통신.방송 연구개발사업 (N01210407)(통합EZ)복합 트랜잭션 처리 가능 서버용 인공지능 딥러닝 프로세서 기술개발(2021년도)
2 과학기술정보통신부 한국과학기술원 정보통신방송혁신인재양성사업 (N01210013)(통합EZ)엣지 클라우드에서 고신뢰 고사용성 빅데이터 플랫폼 및 분석 예측 서비스 기술 개발(2021년도)