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비트 플리핑 장치, 방법 및 이를 위한 컴퓨터 판독가능 프로그램

  • 기술번호 : KST2023003830
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 비트 플리핑 장치, 방법 및 이를 위한 컴퓨터 판독가능 프로그램이 개시된다. 본 발명에 따른 비트 플리핑 장치는 2차원 배열 패턴을 갖는 입력데이터에 대한 비트 플리핑 장치로서, 상기 입력데이터의 2차원 배열 패턴에 기초하여 적어도 하나 이상의 입력 데이터 시퀀스(sequence)를 생성하고, 상기 입력 데이터 시퀀스를 미리 설정된 방식에 따라 적어도 어느 하나의 클러스터에 분류하는 클러스터링부 및 상기 분류된 클러스터에 기초하여 상기 입력 데이터 시퀀스 중 오류가 발생한 비트에 대해 비트 플리핑(bit flipping)을 수행하는 비트 플리핑부를 포함한다. 따라서, 상술한 본 발명에 따르면, 부분 응답 최대 유사도(partial response maximum likelihood, PRML) 검출기의 출력측에 결합하여 PRML 검출기의 출력값을 적어도 어느 하나의 클러스터에 분류하고 분류된 결과에 기초하여 비트플리핑을 수행하므로, 기존의 오류 정정 부호 기반의 비트 플리핑 방식에 비해 시스템의 복잡도를 감소시키면서 부효율을 개선할 수 있는 이점을 갖는다.
Int. CL H03M 13/41 (2006.01.01) G11B 5/74 (2006.01.01) G11B 5/09 (2006.01.01) G06F 11/10 (2006.01.01) H03M 13/45 (2006.01.01)
CPC H03M 13/4107(2013.01) G11B 5/746(2013.01) G11B 5/09(2013.01) G06F 11/1012(2013.01) G06F 11/1048(2013.01) H03M 13/45(2013.01) G11B 2220/252(2013.01)
출원번호/일자 1020220000909 (2022.01.04)
출원인 숭실대학교산학협력단
등록번호/일자
공개번호/일자 10-2023-0105483 (2023.07.11) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2022.01.04)
심사청구항수 15

출원인

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번호 이름 국적 주소
1 숭실대학교산학협력단 대한민국 서울특별시 동작구

발명자

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번호 이름 국적 주소
1 이재진 서울시 광진구
2 정성권 서울특별시 동작구

대리인

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번호 이름 국적 주소
1 윤귀상 대한민국 서울특별시 금천구 디지털로*길 ** ***호 (가산동, 한신IT타워*차)(디앤특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2022.01.04 수리 (Accepted) 1-1-2022-0008281-41
2 선행기술조사의뢰서
Request for Prior Art Search
2023.04.14 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2023.07.14 발송처리완료 (Completion of Transmission) 9-6-2023-0137088-87
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번호 청구항
1 1
2차원 배열 패턴을 갖는 입력데이터에 대한 비트 플리핑 장치로서,상기 입력데이터의 2차원 배열 패턴에 기초하여 적어도 하나 이상의 입력 데이터 시퀀스(sequence)를 생성하고, 상기 입력 데이터 시퀀스를 미리 설정된 방식에 따라 적어도 어느 하나의 클러스터(cluster)에 분류하는 클러스터링부; 및상기 분류된 클러스터에 기초하여 상기 입력데이터 시퀀스 중 오류가 발생한 비트에 대해 비트 플리핑(bit flipping)을 수행하는 비트 플리핑부를 포함하는 비트 플리핑 장치
2 2
제 1 항에 있어서,상기 입력데이터는,소정의 채널을 통과한 리드백(readback) 신호를 부분응답(Partial Response)의 펄스(pulse) 형태로 등화시키고, 연판정 비터비 알고리즘에 따라 복호화하는 부분 응답 최대 유사도 (partial response maximum likelihood, PRML) 검출기로부터의 출력값인, 비트 플리핑 장치
3 3
제 2 항에 있어서,상기 입력데이터는,다운 트랙(down-track) 방향의 복수의 아일랜드(island)와, 크로스 트랙(cross-track) 방향의 복수의 아일랜드로 구성되는 상기 2차원 배열 패턴을 갖는, 비트 플리핑 장치
4 4
제 3 항에 있어서,상기 클러스터링부는,소정의 중심 비트와 상기 중심 비트와 인접하는 적어도 하나 이상의 이웃 비트를 추출하여 상기 입력 데이터 시퀀스를 생성하고, 상기 입력 데이터 시퀀스를 구성하는 비트의 수에 기초하여 클러스터의 수를 설정하고 상기 설정된 클러스터의 수만큼 센트로이드(centroid)를 초기화하는 전처리부;상기 입력 데이터 시퀀스와 가장 가까운 클러스터에 상기 입력 데이터 시퀀스를 분류하는 분류부; 및상기 분류된 클러스터의 인덱스(index) 값을 바이너리 시퀀스(binary sequence)로 변환하는 변환부를 포함하는, 비트 플리핑 장치
5 5
제 4 항에 있어서,상기 비트 플리핑부는 상기 변환된 바이너리 시퀀스와 상기 입력 데이터 시퀀스의 각 성분의 부호를 비교하여 상기 부호가 상이한 상기 입력 데이터 시퀀스의 부호를 변경함으로써, 상기 입력 데이터 시퀀스 중 오류가 발생한 비트에 대해 비트 플리핑을 수행하는 것인, 비트 플리핑 장치
6 6
제 1 항에 있어서, 상기 미리 설정된 방식은 K-mean 알고리즘을 따르는, 비트 플리핑 장치
7 7
제 4 항에 있어서,상기 전처리부는,소정의 아일랜드에 위치한 상기 중심 비트를 샘플링(sampling)하고, 상기 중심 비트가 샘플링된 아일랜드를 기준으로 다운 트랙 방향의 적어도 하나 이상의 아일랜드 또는 크로스 트랙 방향의 적어도 하나 이상의 아일랜드에서 상기 이웃 비트를 샘플링하여 상기 입력 데이터 시퀀스를 생성하는 것인, 비트 플리핑 장치
8 8
제 4 항에 있어서,상기 전처리부는,소정의 아일랜드에 위치한 상기 중심 비트를 샘플링(sampling)하고, 상기 중심 비트가 샘플링된 아일랜드를 기준으로 다운 트랙 방향의 적어도 하나 이상의 아일랜드 및 크로스 트랙 방향의 적어도 하나 이상의 아일랜드에서 상기 이웃 비트를 샘플링하여 상기 입력 데이터 시퀀스를 생성하는 것인, 비트 플리핑 장치
9 9
제 4 항에 있어서,상기 전처리부는,소정의 아일랜드에 위치한 상기 중심 비트를 샘플링하고, 상기 중심 비트가 샘플링된 아일랜드와 인접한 모든 아일랜드에서 상기 이웃 비트를 샘플링하여 상기 입력 데이터 시퀀스를 생성하는 것인, 비트 플리핑 장치
10 10
비트 플리핑 장치에서 수행되는 2차원 배열 패턴을 갖는 입력데이터에 대한 비트 플리핑 방법으로서,상기 입력데이터의 2차원 배열 패턴에 기초하여 적어도 하나 이상의 입력 데이터 시퀀스(sequence)를 생성하고, 상기 입력 데이터 시퀀스를 미리 설정된 방식에 따라 적어도 어느 하나의 클러스터에 분류하는 단계; 및상기 분류된 클러스터에 기초하여 상기 입력 데이터 시퀀스 중 오류가 발생한 비트에 대해 비트 플리핑(bit flipping)을 수행하는 단계를 포함하는 비트 플리핑 방법
11 11
제 10 항에 있어서,상기 입력데이터는,소정의 채널을 통과한 리드백(readback) 신호를 부분응답(Partial Response)의 펄스(pulse) 형태로 등화시키고, 연판정 비터비 알고리즘에 따라 복호화하는 부분 응답 최대 유사도(partial response maximum likelihood, PRML) 검출기로부터의 출력값인, 비트 플리핑 방법
12 12
제 11 항에 있어서,상기 적어도 어느 하나의 클러스터에 분류하는 단계는,소정의 중심 비트와 상기 중심 비트와 인접하는 적어도 하나 이상의 이웃 비트를 추출하여 상기 입력 데이터 시퀀스를 생성하고, 상기 입력 데이터 시퀀스를 구성하는 비트의 수에 기초하여 클러스터의 수를 설정하고 상기 설정된 클러스터의 수만큼 센트로이드(centroid)를 초기화하는 전처리 단계;상기 입력 데이터 시퀀스와 가장 가까운 클러스터에 상기 입력 데이터 시퀀스를 분류하는 분류 단계; 및상기 분류된 클러스터의 인덱스(index) 값을 바이너리 시퀀스(binary sequence)로 변환하는 변환 단계를 포함하는, 비트 플리핑 방법
13 13
제 12 항에 있어서,상기 비트 플리핑을 수행하는 단계는,상기 변환된 바이너리 시퀀스와 상기 입력 데이터 시퀀스의 각 성분의 부호를 비교하여 상기 부호가 상이한 상기 입력 데이터 시퀀스의 부호를 변경함으로써, 상기 입력 데이터 시퀀스 중 오류가 발생한 비트에 대해 비트 플리핑을 수행하는 것인, 비트 플리핑 방법
14 14
제 10 항에 있어서,상기 미리 설정된 방식은 K-mean 알고리즘을 따르는, 비트 플리핑 방법
15 15
제 10 항 내지 제 14 항에 기재된, 비트 플리핑 방법을 실행하도록 구성된, 컴퓨터로 판독가능한 기록매체에 저장된 컴퓨터 판독가능한 프로그램
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 숭실대학교 산학협력단 정보통신방송혁신인재양성(R&D) 지능형 사이버 위협 대응 기술 개발 및 인력양성