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메시지가 암호화된 비트 신호를 수신하는 통신부;상기 비트 신호와 상기 비트 신호에 제1 길이만큼 비트 이동을 수행하여 생성된 연산스트림을 이용하여, 상기 메시지의 암호화에 사용된 확산 코드가 상쇄된 제1 연산스트림을 생성하는 제1 연산을 수행하는 제1 연산부;상기 비트 신호와 상기 비트 신호에 제2 길이만큼 비트 이동을 수행하여 생성된 연산스트림을 이용하여, 상기 메시지가 상쇄된 제2 연산스트림을 생성하는 제2 연산을 수행하는 제2 연산부;상기 제1 연산스트림 및 상기 제2 연산스트림에 기반하여, 쉬프트 레지스터와 연관된 제3 연산스트림을 생성하는 제3 연산을 수행하는 제3 연산부; 및상기 제3 연산스트림에 기반하여 다수의 선형 방정식들을 생성하고, 상기 다수의 선형 방정식들을 이용하여 상기 쉬프트 레지스터와 연관된 다항식을 생성하는 다항식 생성부를 포함하는, 자기 동기 스크램블러 추정 장치
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제 1항에 있어서,상기 다항식 생성부는,상기 제1 연산, 상기 제2 연산, 상기 제3 연산 및 상기 다항식의 생성은 미리 설정된 횟수만큼 반복 수행하고, 상기 반복 수행되어 생성된 다항식들에 기반하여 상기 쉬프트 레지스터의 피드백 다항식을 결정하는, 자기 동기 스크램블러 추정 장치
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제 2항에 있어서,상기 피드백 다항식을 이용하여 상기 비트 신호를 복호화하고, 복호화 가능 여부를 판단하는 판단부;를 더 포함하는 자기 동기 스크램블러 추정 장치
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제 2항에 있어서,상기 다항식 생성부는,두 번 이상 동일하게 생성된 다항식들에 기반하여 상기 피드백 다항식을 결정하는, 자기 동기 스크램블러 추정 장치
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5
제 4항에 있어서,상기 다항식 생성부는,상기 반복 수행되어 생성된 다항식들 중 다수 생성된 다항식들의 최대 공약 다항식에 기반하여 상기 피드백 다항식을 결정하는, 자기 동기 스크램블러 추정 장치
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6
제 1항에 있어서,상기 제1 길이는, 상기 확산 코드에 대응하는 비트 수에 해당하며,상기 제2 길이는, 1 이상의 자연수인, 자기 동기 스크램블러 추정 장치
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7
메시지가 암호화된 비트 신호를 수신하는 단계;상기 비트 신호와 상기 비트 신호에 제1 길이만큼 비트 이동을 수행하여 생성된 연산스트림을 이용하여, 상기 메시지의 암호화에 사용된 확산 코드가 상쇄된 제1 연산스트림을 생성하는 제1 연산을 수행하는 제1연산 수행 단계;상기 비트 신호와 상기 비트 신호에 제2 길이만큼 비트 이동을 수행하여 생성된 연산스트림을 이용하여, 상기 메시지가 상쇄된 제2 연산스트림을 생성하는 제2 연산을 수행하는 제2연산 수행 단계;상기 제1 연산스트림 및 상기 제2 연산스트림에 기반하여, 쉬프트 레지스터와 연관된 제3 연산스트림을 생성하는 제3 연산을 수행하는 제3연산 수행 단계; 및상기 제3 연산스트림에 기반하여 다수의 선형 방정식들을 생성하고 상기 다수의 선형 방정식들을 이용하여 상기 쉬프트 레지스터와 연관된 다항식을 생성하는 다항식 생성 단계;를 포함하는, 자기 동기 스크램블러 추정 방법
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제7항에 있어서,상기 다항식 생성 단계는,상기 제1 연산, 상기 제2 연산, 상기 제3 연산 및 상기 다항식의 생성은 미리 설정된 횟수만큼 반복 수행하는 단계; 및상기 반복 수행되어 생성된 다항식들에 기반하여 상기 쉬프트 레지스터의 피드백 다항식을 결정하는 피드백 다항식 결정 단계;를 포함하는, 자기 동기 스크램블러 추정 방법
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제 8항에 있어서,상기 피드백 다항식을 이용하여 상기 비트 신호를 복호화하고, 복호화 가능 여부를 판단하는 복호화 판단 단계;를 더 포함하는 자기 동기 스크램블러 추정 방법
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제 8항에 있어서,상기 피드백 다항식 결정 단계는,두 번 이상 동일하게 생성된 다항식들에 기반하여 상기 피드백 다항식을 결정하는 단계를 포함하는, 자기 동기 스크램블러 추정 방법
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제 10항에 있어서,상기 피드백 다항식 결정 단계는,상기 반복 수행되어 생성된 다항식들 중 다수 생성된 다항식들의 최대 공약 다항식에 기반하여 상기 피드백 다항식을 결정하는 단계를 포함하는, 자기 동기 스크램블러 추정 방법
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제 7항에 있어서,상기 제1 길이는, 상기 확산 코드에 대응하는 비트 수에 해당하며,상기 제2 길이는, 1 이상의 자연수인, 자기 동기 스크램블러 추정 방법
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