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질화물 반도체 소자의 제조방법

  • 기술번호 : KST2023009912
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 질화물계 박막 구조물을 성장 기판으로부터 용이하게 분리할 수 있는 질화물 반도체 소자의 제조방법에 관한 것으로, 상기 방법은 성장 기판 상에 질화물계 박막 구조물을 형성하는 박막 구조물 형성 단계; 상기 질화물계 박막 구조물 상에 캐리어 기판을 본딩하는 캐리어 기판 본딩 단계; 및 습식 에칭을 통해 상기 질화물계 박막 구조물로부터 상기 성장 기판을 분리시키는 박리 공정 단계를 포함하는 것을 특징으로 한다.
Int. CL H01L 33/00 (2023.01.01) H01L 21/78 (2006.01.01) H01L 29/778 (2006.01.01) H01L 33/16 (2010.01.01) H01L 33/12 (2010.01.01) H01L 33/06 (2010.01.01) H01L 33/44 (2010.01.01)
CPC H01L 33/0093(2013.01) H01L 21/7813(2013.01) H01L 29/7783(2013.01) H01L 33/16(2013.01) H01L 33/007(2013.01) H01L 33/0075(2013.01) H01L 33/12(2013.01) H01L 33/06(2013.01) H01L 33/44(2013.01)
출원번호/일자 1020220051180 (2022.04.26)
출원인 숭실대학교산학협력단
등록번호/일자
공개번호/일자 10-2023-0151627 (2023.11.02) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2022.04.26)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 숭실대학교산학협력단 대한민국 서울특별시 동작구

발명자

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번호 이름 국적 주소
1 유건욱 서울특별시 서초구

대리인

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번호 이름 국적 주소
1 최훈식 대한민국 서울특별시 금천구 가산디지털*로 *** (가산동) ****호(강한국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2022.04.26 수리 (Accepted) 1-1-2022-0445879-16
2 선행기술조사의뢰서
Request for Prior Art Search
2023.06.18 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2023.09.15 발송처리완료 (Completion of Transmission) 9-6-2023-0183982-03
4 의견제출통지서
Notification of reason for refusal
2023.11.01 발송처리완료 (Completion of Transmission) 9-5-2023-0985393-31
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
성장 기판 상에 질화물계 박막 구조물을 형성하는 박막 구조물 형성 단계;상기 질화물계 박막 구조물 상에 캐리어 기판을 본딩하는 캐리어 기판 본딩 단계; 및습식 에칭을 통해 상기 질화물계 박막 구조물로부터 상기 성장 기판을 분리시키는 박리 공정 단계를 포함하는 것을 특징으로 하는 질화물 반도체 소자의 제조방법
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제1항에 있어서,상기 박리 공정 단계는,상기 성장 기판과 상기 질화물계 박막 구조물 사이에 버퍼층을 형성하는 단계;상기 성장 기판의 후면 일부를 딥 에칭 프로세스에 의해 에칭하여, 상기 버퍼층의 일부가 노출되도록 복수의 트렌치들을 형성하는 단계;상기 트렌치 내에 에칭용 보호층을 형성하는 단계; 및에칭액으로 습식에칭을 수행하여 상기 성장 기판을 제거하는 단계를 포함하는 것을 특징으로 하는 질화물 반도체 소자의 제조방법
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제2항에 있어서,상기 트렌치와 상기 버퍼층의 경계면에는 상기 딥 에칭 프로세스에 의해 손상된 영역이 존재하는 것을 특징으로 하는 질화물 반도체 소자의 제조방법
4 4
제2항에 있어서,상기 에칭용 보호층은 SiO2 층 또는 SiNx 층으로부터 선택되는 것을 특징으로 하는 질화물 반도체 소자의 제조방법
5 5
제2항에 있어서,상기 에칭액은 농도가 30~50%인 수산화칼륨(KOH) 계열의 에칭액인 것을 특징으로 하는 질화물 반도체 소자의 제조방법
6 6
제1항에 있어서,상기 성장 기판은 [110] 결정방향을 가지는 실리콘 기판인 것을 특징으로 하는 질화물 반도체 소자의 제조방법
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제1항에 있어서,상기 박리 공정 단계에서 상기 성장 기판이 분리된 상기 질화물계 박막 구조물을 이종 기판 위에 전사하는 단계를 더 포함하고,상기 이종 기판은 다이아몬드 기판, CMOS 기판, 사파이어 기판, 실리콘카바이드(SiC) 기판 및 유연기판 중 어느 하나인 것을 특징으로 하는 질화물 반도체 소자의 제조방법
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제1항에 있어서,상기 질화물계 박막 구조물은 3족 질화물계 에피층 또는 3족 질화물계 반도체층을 포함하는 것을 특징으로 하는 질화물 반도체 소자의 제조방법
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제8항에 있어서,상기 3족 질화물계 에피층은 GaN 에피층, InGaN/GaN LED 에피층, AlGaN/GaN HEMT 에피층 및 GaN/AlScN 에피층 중 어느 하나를 포함하고,상기 3족 질화물계 반도체층은 InGaN/GaN LED 디바이스 또는 AlGaN/GaN HEMT 디바이스를 포함하는 것을 특징으로 하는 질화물 반도체 소자의 제조방법
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제9항에 있어서,상기 InGaN/GaN LED 디바이스는 n-GaN 층; GaN/InGaN MQW 구조체; 및 p-GaN 층이 순차적으로 적층된 구조이고,상기 AlGaN/GaN HEMT 디바이스는 GaN 층; 상기 GaN 층 상에 형성되는 AlN 중간층; 상기 AlN 중간층 상에 형성되는 AlGaN 배리어층; 및 상기 AlGaN 배리어층 상에 형성되는 GaN 캡층을 포함하는 구조인 것을 특징으로 하는 질화물 반도체 소자의 제조방법
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