요약 | 80라운드의 연산을 수행하는 SHA-1 해쉬 함수 중간값 발생회로는 32비트 단위의 16개의 레지스터 블록들을 구비하여 상기 80라운드 각각의 연산을 위한 상기 중간값을 각각 저장할 수 있는 중간값 저장블락; 제 1제어신호에 응답하여 각각의 라운드의 연산에 필요한 상기 중간값을 생성하기 위하여 상기 중간값 저장블락에 저장된 4개의 중간값들을 선택하는 제 1멀티플렉서; 상기 멀티플렉서의 출력신호들을 수신하여 소정의 논리연산을 통하여 17번째 라운드 내지 80번째 라운드의 연산을 위한 중간값을 생성하는 중간값 연산회로; 제 2제어신호에 응답하여 상기 각각의 라운드에 필요한 상기 중간값을 선택하여 출력하는 제 2멀티플렉서; 제 3제어신호에 응답하여 상기 중간값 연산회로가 생성한 상기 중간값을 각각의 라운드의 연산을 위하여 선택되지 않는 상기 중간값들을 저장하는 레지스터 블록에 저장하는 것을 특징으로 한다. 상기 중간값은 다음식에 의하여 발생되며 Wt=S(W(t-3) XOR W(t-8) XOR W(t-14) XOR W(t-16), 여기서 S는 1비트 서큘러 레프트 쉬프트 연산을, XOR는 비트 대 비트의 배타 논리합을, Wt는 t번째 중간값을, 그리고 t는 0내지 79인 것을 특징으로 한다. |
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Int. CL | G06F 9/44 (2006.01) |
CPC | H03K 19/21(2013.01) H03K 19/21(2013.01) |
출원번호/일자 | 1020010040452 (2001.07.06) |
출원인 | 최준림, 주홍정보통신주식회사, 대한민국(경북대학교 총장) |
등록번호/일자 | 10-0417793-0000 (2004.01.27) |
공개번호/일자 | 10-2003-0004771 (2003.01.15) 문서열기 |
공고번호/일자 | (20040211) 문서열기 |
국제출원번호/일자 | |
국제공개번호/일자 | |
우선권정보 | |
법적상태 | 소멸 |
심사진행상태 | 수리 |
심판사항 | |
구분 | |
원출원번호/일자 | |
관련 출원번호 | |
심사청구여부/일자 | Y (2001.07.06) |
심사청구항수 | 6 |