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스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치 및 방법

  • 기술번호 : KST2014026301
  • 담당센터 : 인천기술혁신센터
  • 전화번호 : 032-420-3580
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치 및 방법이 개시된다. 키 저장부에는 사용자 키와 거짓 키가 저장된다. AES 코어부는 입력된 키를 기초로 평문을 암호화하여 암호문을 출력한다. 다중화부는 사용자 키와 거짓 키를 선택적으로 AES 코어부로 제공한다. TAP 제어부는 AES 코어부의 동작 모드가 스캔 테스트 모드이면 거짓 키를 AES 코어부에 제공하도록 다중화부를 제어한다. 본 발명에 따르면, 스캔 테스트 시 사용자 비밀 키를 대신하여 인가되는 데이터를 저장하는 별도의 레지스터를 사용하지 않으므로 면적 오버헤드와 전력 오버헤드를 줄일 수 있고, AES 코어 자체의 추가적인 수정없이 사용자 키의 누출을 방지할 수 있어 IP 코어의 재사용성을 높일 수 있다. AES, 보안, 키 보호, 스캔 테스트, 시스템 온 칩
Int. CL H04L 9/14 (2006.01)
CPC H04L 9/0631(2013.01) H04L 9/0631(2013.01) H04L 9/0631(2013.01) H04L 9/0631(2013.01)
출원번호/일자 1020080059881 (2008.06.24)
출원인 한양대학교 에리카산학협력단
등록번호/일자 10-1472777-0000 (2014.12.09)
공개번호/일자 10-2010-0000396 (2010.01.06) 문서열기
공고번호/일자 (20141216) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2013.06.24)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 한양대학교 에리카산학협력단 대한민국 경기도 안산시 상록구

발명자

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번호 이름 국적 주소
1 박성주 대한민국 경기도 성남시 분당구
2 송재훈 대한민국 서울특별시 구로구
3 정태진 대한민국 인천광역시 부평구
4 이준섭 대한민국 경상남도 거창군
5 정혜란 대한민국 서울특별시 관악구

대리인

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번호 이름 국적 주소
1 송경근 대한민국 서울특별시 서초구 서초대로**길 ** (방배동) 기산빌딩 *층(엠앤케이홀딩스주식회사)

최종권리자

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번호 이름 국적 주소
1 한양대학교 에리카산학협력단 대한민국 경기도 안산시 상록구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2008.06.24 수리 (Accepted) 1-1-2008-0454228-52
2 [출원인변경]권리관계변경신고서
[Change of Applicant] Report on Change of Proprietary Status
2012.08.22 수리 (Accepted) 1-1-2012-0674856-36
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2013.06.24 수리 (Accepted) 1-1-2013-0562663-17
4 의견제출통지서
Notification of reason for refusal
2014.03.26 발송처리완료 (Completion of Transmission) 9-5-2014-0209437-51
5 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2014.05.20 수리 (Accepted) 1-1-2014-0470566-41
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2014.06.20 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2014-0577064-64
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2014.06.20 수리 (Accepted) 1-1-2014-0577052-16
8 등록결정서
Decision to grant
2014.11.27 발송처리완료 (Completion of Transmission) 9-5-2014-0818116-28
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번호 청구항
1 1
사용자 키와 거짓 키가 저장되는 키 저장부;입력된 키를 기초로 평문을 암호화하여 암호문을 출력하는 AES 코어부;상기 사용자 키와 상기 거짓 키를 선택적으로 상기 AES 코어부로 제공하는 다중화부;상기 AES 코어부의 동작 모드가 정상 동작 모드이면 상기 사용자 키를 상기 AES 코어부로 제공하도록 상기 다중화부를 제어하고, 상기 AES 코어부의 동작 모드가 스캔 테스트 모드이면 상기 거짓 키를 상기 AES 코어부에 제공하도록 상기 다중화부를 제어하는 TAP 제어부; 및상기 AES 코어부로부터 입력되는 스캔 출력을 최종적인 스캔 출력으로 출력하는 출력부;를 포함하며,상기 AES 코어부로부터 상기 출력부로 입력되는 스캔 출력은 상기 TAP 제어부로부터 상기 출력부로 입력되는 스캔 출력 게이팅 신호에 의해 제어되는 것을 특징으로 하는 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치
2 2
제 1항에 있어서,상기 AES 코어부는,상기 사용자 키 또는 상기 거짓 키를 기초로 각각의 개별 라운드에 사용될 라운드키를 생성하는 키 확장부;상기 생성된 라운드 키들이 저장되는 키 레지스터;데이터가 저장되는 데이터 레지스터;상기 데이터 레지스터로부터 입력된 데이터의 비트열을 S-box에 의해 비트열 내에서 비트의 위치를 변경하는 비트교환부;상기 비트의 위치가 변경된 데이터의 비트열을 사전에 설정된 제1크기의 비트 단위로 분할한 후 이를 기초로 생성한 행렬의 두번째 행부터 각 성분을 각 행에 대해 설정된 이동계수만큼 왼쪽으로 이동시키는 행이동부;상기 행의 각 성분에 대한 이동이 수행된 행렬을 사전에 설정된 제2크기의 비트 단위로 분할한 후 이를 기초로 생성한 행렬에 사전에 설정되어 있는 참조행렬을 곱하는 열혼성부;평문, 상기 행이동부의 출력 데이터 및 상기 열혼성부의 출력 데이터를 다중화하여 선택적으로 출력하는 제1다중화부; 및상기 다중화부로부터 입력된 데이터와 상기 키 레지스터로부터 제공된 라운드 키에 대해 XOR 연산을 수행하여 결과값을 상기 데이터 레지스터로 출력하는 XOR 연산부;를 포함하는 것을 특징으로 하는 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치
3 3
제 2항에 있어서,상기 키 확장부는 이전 라운드의 키를 입력으로 하여 현재 라운드 키를 생성하는 것을 특징으로 하는 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치
4 4
제 1항에 있어서,상기 TAP 제어부는 키 선택 제어신호로 로드 키 신호(Load Key Signal)를 사용하여 상기 다중화부의 키 출력 동작을 제어하며, 정상 동작 시 상기 AES 코어부의 내부 레지스터에 남아있던 모든 정보가 상기 거짓 키에 의해 변경될 때까지 상기 AES 코어부를 동작시키는 것을 특징으로 하는 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치
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제 4항에 있어서,상기 TAP 제어부는 상기 AES 코어부 내부의 모든 레지스터의 값이 변경될 때까지 스캔 체인 상의 값을 스캔 출력 포트를 통해 볼 수 없도록 스캔 출력 게이팅(Scan Output Gating) 신호를 사용하여 상기 스캔 출력포트를 비활성화시키는 것을 특징으로 하는 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치
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제 4항 또는 제 5항에 있어서,상기 TAP 제어부는 스캔 테스트를 위한 명령이 입력된 후 상기 거짓 키를 상기 AES 코어부에 제공하고, 사전에 설정되어 있는 시간 동안 스캔 출력 게이팅 신호를 유지한 후 변경시켜 상기 AES 코어부의 정상 동작시 남아 있던 정보들을 제거한 뒤 스캔 출력 포트를 활성화시키는 것을 특징으로 하는 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 장치
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(a) AES 코어의 동작 모드를 확인하는 단계;(b) 상기 AES 코어의 동작 모드가 스캔 테스트 모드이면 저장되어 있는 사용자 키와 거짓 키 중에서 상기 거짓 키를 상기 AES 코어에 제공하는 단계;(c) 상기 AES 코어가 상기 거짓 키를 기초로 평문을 암호화하여 암호문을 출력하는 단계; 및(d) 상기 AES 코어로부터 출력되는 스캔 출력을 스캔 출력 게이팅 신호에 의해 제어하여 최종적인 스캔 출력을 출력하는 단계;를 포함하는 것을 특징으로 하는 스캔 기반 사이드 채널 공격을 방지하기 위한 암호화 방법
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 반도체 연구조합 System IC 2010 선행 핵심 IP 기술개발 (AES 코어보안을 위한 테스트 IP개발)