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2차 시그마-델타 모듈레이터를 이용한 오디오 클록 생성기 (AN AUDIO CLOCK REGENERATOR USING 2ND SIGMA-DELTA MODULATOR)

  • 기술번호 : KST2014036096
  • 담당센터 : 인천기술혁신센터
  • 전화번호 : 032-420-3580
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 2차 시그마-델타 모듈레이터를 이용한 오디오 클록 생성기에 관한 것으로서, 보다 구체적으로는 입력된 비디오 클록(tdms clock)을 비디오 클록 지연비(CTS)로 나눔으로써, 상기 비디오 클록 지연비만큼 지연된 비디오 클록을 출력하는 CTS 분주기; N 분주기에서 연산되는 값을 고려하여 상기 지연된 비디오 클록의 위상을 감지하여 출력하는 위상검출기(Phase Frequency Detector, PFD); 상기 위상검출기의 Up/Down 신호를 전류 신호로 변환하여 저역통과필터에 공급하는 전하 펌프(Charge Pump, CP); 상기 위상검출기에 의하여 감지된 위상의 저주파 성분만을 걸러내는 저역통과필터(Low Pass Filter); 상기 감지된 주파수를 사용하여 오디오 클록을 출력하는 전압제어발진기(Voltage Controlled Oscillator, VCO); 상기 전압제어발진기가 출력하는 파형을 비디오 클록 속도 증가비(N)로 나눈 클록을 상기 위상검출기에 인가하는 N 분주기를 포함하되, 상기 CTS 분주기는, 비디오 클록 지연비를 2진수(binary number)로 변환한 후, 제1 임계값으로 나눔으로써 정수 부분과 소수 부분을 분리하고, 상기 정수 부분을 제어 신호로 사용하는 멀티-모듈러스 분주기(multi-modulus divider); 및 상기 소수 부분을 제어 신호로 사용하는 2차 시그마-델타 모듈레이터(2nd Sigma-Delta Modulator)를 포함하며, 상기 N 분주기는, 비디오 클록 속도 증가비를 2진수(binary number)로 변환한 후, 제2 임계값으로 나눔으로써 정수 부분과 소수 부분을 분리하고, 상기 정수 부분을 제어 신호로 사용하는 멀티-모듈러스 분주기(multi-modulus divider); 및 상기 소수 부분을 제어 신호로 사용하는 2차 시그마-델타 모듈레이터(2nd Sigma-Delta Modulator)를 포함하는 것을 그 구성상의 특징으로 한다.본 발명에서 제안하고 있는 2차 시그마-델타 모듈레이터를 이용한 오디오 클록 생성기에 따르면, 분수-N 분주기에 2차 시그마-델타 모듈레이터를 이용함으로써, 비디오 클록 속도 증가비(N)와 비디오 클록 지연비(CTS)를 정수 부분과 소수 부분으로 각각 분리하고, 정수 부분을 멀티-모듈러스 분주기의 제어 값으로 사용하며, 소수 부분을 2차 시그마-델타 모듈레이터의 어큐뮬레이터의 입력 값으로 사용하여 오디오 클록 생성 속도 및 효율을 향상시킬 수 있다.
Int. CL H03L 7/183 (2006.01) H03M 3/02 (2006.01)
CPC H03L 7/1976(2013.01) H03L 7/1976(2013.01) H03L 7/1976(2013.01) H03L 7/1976(2013.01) H03L 7/1976(2013.01)
출원번호/일자 1020100077045 (2010.08.10)
출원인 인하대학교 산학협력단
등록번호/일자 10-1202124-0000 (2012.11.09)
공개번호/일자 10-2012-0014834 (2012.02.20) 문서열기
공고번호/일자 (20121115) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.08.10)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 인하대학교 산학협력단 대한민국 인천광역시 미추홀구

발명자

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번호 이름 국적 주소
1 강진구 대한민국 서울특별시 서초구
2 김상호 대한민국 경기도 군포시 산본로***번길 **, ***호 (

대리인

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번호 이름 국적 주소
1 김건우 대한민국 서울특별시 금천구 가산디지털*로 ***, 에이동 ***호 특허그룹덕원 (가산동, 우림 라이온스밸리)

최종권리자

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번호 이름 국적 주소
1 인하대학교 산학협력단 인천광역시 미추홀구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2010.08.10 수리 (Accepted) 1-1-2010-0514887-64
2 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)		 2010.10.30 수리 (Accepted) 1-1-2010-0707639-29
3 선행기술조사의뢰서
Request for Prior Art Search		 2012.01.13 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2012.02.15 수리 (Accepted) 9-1-2012-0009183-51
5 의견제출통지서
Notification of reason for refusal		 2012.03.21 발송처리완료 (Completion of Transmission) 9-5-2012-0163757-19
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2012.05.18 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2012-0400780-62
7 등록결정서
Decision to grant		 2012.10.29 발송처리완료 (Completion of Transmission) 9-5-2012-0649869-90
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.07.22 수리 (Accepted) 4-1-2015-5098802-16
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2016.09.05 수리 (Accepted) 4-1-2016-5127132-49
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2018.03.02 수리 (Accepted) 4-1-2018-5036549-31
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2018.12.27 수리 (Accepted) 4-1-2018-5266647-91
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
오디오 클록 생성기에 있어서,입력된 비디오 클록(tdms clock)을 비디오 클록 지연비(CTS)로 나눔으로써, 상기 비디오 클록 지연비만큼 지연된 비디오 클록을 출력하는 CTS 분주기;N 분주기에서 연산되는 값을 고려하여 상기 지연된 비디오 클록의 위상을 감지하여 출력하는 위상검출기(Phase Frequency Detector, PFD);상기 위상검출기의 Up/Down 신호를 전류 신호로 변환하여 저역통과필터에 공급하는 전하 펌프(Charge Pump, CP);상기 위상검출기에 의하여 감지된 위상의 저주파 성분만을 걸러내는 저역통과필터(Low Pass Filter);감지된 주파수를 사용하여 오디오 클록을 출력하는 전압제어발진기(Voltage Controlled Oscillator, VCO);상기 전압제어발진기가 출력하는 파형을 비디오 클록 속도 증가비(N)로 나눈 클록을 상기 위상검출기에 인가하는 N 분주기를 포함하되,상기 CTS 분주기는,비디오 클록 지연비를 2진수(binary number)로 변환한 후, 제1 임계값으로 나눔으로써 정수 부분과 소수 부분을 분리하고,상기 정수 부분을 제어 신호로 사용하는 멀티-모듈러스 분주기(multi-modulus divider); 및상기 소수 부분을 제어 신호로 사용하는 2차 시그마-델타 모듈레이터(2nd Sigma-Delta Modulator)를 포함하며,상기 N 분주기는,비디오 클록 속도 증가비를 2진수(binary number)로 변환한 후, 제2 임계값으로 나눔으로써 정수 부분과 소수 부분을 분리하고,상기 정수 부분을 제어 신호로 사용하는 멀티-모듈러스 분주기(multi-modulus divider); 및상기 소수 부분을 제어 신호로 사용하는 2차 시그마-델타 모듈레이터(2nd Sigma-Delta Modulator)를 포함하는 것을 특징으로 하는 2차 시그마-델타 모듈레이터를 이용한 오디오 클록 생성기
2 2
제1항에 있어서,상기 제1 임계값은, 213이며,상기 제2 임계값은, 210인 것을 특징으로 하는 2차 시그마-델타 모듈레이터를 이용한 오디오 클록 생성기
3 3
제2항에 있어서,상기 CTS 분주기의 멀티-모듈러스 분주기 및 상기 N 분주기의 멀티-모듈러스 분주기의 제어 신호로 사용되는 정수 부분은, 6 비트(bit)이며,상기 CTS 분주기의 2차 시그마-델타 모듈레이터 및 상기 N 분주기의 2차 시그마-델타 모듈레이터의 제어 신호로 사용되는 소수 부분은, 13 비트인 것을 특징으로 하는 2차 시그마-델타 모듈레이터를 이용한 오디오 클록 생성기
4 4
제3항에 있어서,상기 비디오 클록 지연비는, 2진수 기준으로 15 내지 19 비트이고,상기 비디오 클록 속도 증가비는, 2진수 기준으로 13 내지 16 비트이며,상기 N 분주기의 2차 시그마-델타 모듈레이터는, 상기 2진수로 변환된 비디오 클록 속도 증가비의 소수 부분의 최하위 3비트에 모두 0을 대입시켜 13 비트로 변환하여 사용하는 것을 특징으로 하는 2차 시그마-델타 모듈레이터를 이용한 오디오 클록 생성기
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