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ＤＲＡＭ 버퍼 엑세스 스케줄링 방법 및 장치

  • 기술번호 : KST2014053772
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 아비터에 의한 DRAM 버퍼 스케줄링 방법에 관한 것으로서, 제 1 마스터로부터 제 1 뱅크에 대한 엑세스 요청을 수신하는 단계, 상기 제 1 마스터에게 상기 제 1 뱅크에 대한 엑세스 권한을 부여하는 단계, 제 2 마스터로부터 상기 제 1 뱅크에 대한 엑세스 요청을 수신하는 단계, 상기 수신된 제 2 마스터의 엑세스 요청에 기초하여, 상기 제 2 마스터의 엑세스 순서를 후 순위로 변경하는 단계를 포함하는 DRAM 버퍼 스케쥴링 방법을 제공한다.
Int. CL G06F 13/16 (2006.01) G06F 13/14 (2006.01)
CPC G06F 13/1673(2013.01) G06F 13/1673(2013.01) G06F 13/1673(2013.01) G06F 13/1673(2013.01)
출원번호/일자 1020110065495 (2011.07.01)
출원인 성균관대학교산학협력단
등록번호/일자 10-1258533-0000 (2013.04.22)
공개번호/일자 10-2013-0003878 (2013.01.09) 문서열기
공고번호/일자 (20130430) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2011.07.01)
심사청구항수 6

출원인

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구

발명자

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번호 이름 국적 주소
1 박준수 대한민국 경상북도 경주시
2 한태희 대한민국 경기도 성남시 분당구
3 황용중 대한민국 경기도 시흥시 소래산길 **,

대리인

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번호 이름 국적 주소
1 특허법인엠에이피에스 대한민국 서울특별시 강남구 테헤란로*길 **, *층 (역삼동, 한동빌딩)

최종권리자

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번호 이름 국적 주소
1 성균관대학교산학협력단 경기도 수원시 장안구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2011.07.01 수리 (Accepted) 1-1-2011-0505575-58
2 선행기술조사의뢰서
Request for Prior Art Search		 2012.02.13 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2012.03.21 수리 (Accepted) 9-1-2012-0021380-21
4 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.04.26 수리 (Accepted) 4-1-2012-5090770-53
5 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.20 수리 (Accepted) 4-1-2012-5131828-19
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.27 수리 (Accepted) 4-1-2012-5137236-29
7 의견제출통지서
Notification of reason for refusal		 2012.10.25 발송처리완료 (Completion of Transmission) 9-5-2012-0636907-33
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2012.12.20 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2012-1057654-94
9 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2012.12.20 수리 (Accepted) 1-1-2012-1057653-48
10 등록결정서
Decision to grant		 2013.04.11 발송처리완료 (Completion of Transmission) 9-5-2013-0246114-97
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2017.02.23 수리 (Accepted) 4-1-2017-5028829-43
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
아비터에 의한 DRAM 버퍼 스케줄링 방법에 있어서,(a) 제 1 마스터로부터 제 1 뱅크에 대한 엑세스 요청을 수신하는 단계;(b) 상기 제 1 마스터에게 상기 제 1 뱅크에 대한 엑세스 권한을 부여하는 단계;(c) 제 2 마스터로부터 상기 제 1 뱅크에 대한 엑세스 요청을 수신하는 단계;(d) 상기 수신된 제 2 마스터의 엑세스 요청에 따라, 상기 제 2 마스터의 엑세스 순서를 후 순위로 변경하는 단계를 포함하되,상기 제 1 마스터 및 상기 제 2 마스터는 호스트 버퍼 컨트롤러 또는 각 채널별로 존재하는 낸드(NAND) 플래시 버퍼 컨트롤러인 것인 DRAM 버퍼 스케쥴링 방법
2 2
제 1 항에 있어서,상기 (b) 단계는,상기 제 1 마스터의 주소 및 버스트 요청 신호를 DRAM 컨트롤러로 전송하는 단계를 포함하는 DRAM 버퍼 스케쥴링 방법
3 3
제 1 항에 있어서,상기 제 1 마스터 및 상기 제 2 마스터가 엑세스하는 뱅크의 주소는 각각 상기 제 1 뱅크 및 상기 제 2 뱅크로 고정되는 것인DRAM 버퍼 스케쥴링 방법
4 4
제 1 항에 있어서,상기 (d) 단계는,상기 제 2 마스터의 상기 엑세스 요청 이후에 제 3 마스터가 제 2 뱅크에 대한 엑세스 요청을 하는 경우, 상기 제 2 마스터의 엑세스 순서를 상기 제 3 마스터의 상기 제 2 뱅크로의 엑세스 이후로 변경하는 것인DRAM 버퍼 스케쥴링 방법
5 5
삭제
6 6
아비터에 의한 DRAM 버퍼 엑세스 스케줄링 장치에 있어서,제 1 마스터 및 제 2 마스터를 포함하는 복수의 마스터로부터 복수의 뱅크를 포함하는 DRAM 버퍼에 대한 엑세스 요청을 수신하는 엑세스 요청 수신부;각 마스터에게 상기 DRAM 버퍼에 대한 엑세스 권한을 부여하는 엑세스 권한 관리부; 및상기 복수의 마스터로부터 동일 뱅크에 대한 엑세스 요청이 있는 경우, 엑세스 요청 순서에 기초하여 엑세스 순서를 조정하는 엑세스 순서 조정부를 포함하되,상기 복수의 마스터는 호스트 버퍼 컨트롤러 또는 각 채널별로 존재하는 낸드(NAND) 플래시 버퍼 컨트롤러인 것인DRAM 버퍼 엑세스 스케줄링 장치
7 7
제 6 항에 있어서,상기 DRAM 버퍼에 대한 엑세스 권한을 부여받은 마스터의 주소 및 버스트 요청 신호를 DRAM 컨트롤러로 전송하는 엑세스 정보 송신부를 더 포함하는DRAM 버퍼 엑세스 스케줄링 장치
8 8
삭제
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.