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도파관 구조의 패키지 및 그 제조 방법

  • 기술번호 : KST2015079018
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 도파관 구조의 패키지 및 그 제조방법에 관한 것으로, 반도체 칩 내에 프로브, 마이크로스트립-도파관 전이부 및 마이크로스트립 라인을 형성함으로써 도파관 구조의 패키지 제조시 본딩 와이어를 별도로 형성할 필요가 없어 본딩 와이어에 의한 기생성분의 발생을 최대한 억제하고, 제조공정에 소요되는 시간을 감소시켜 생산비용을 감소시킬 수 있는 도파관 구조의 패키지 및 그 제조방법을 개시한다. 도파관, 패키지, 반도체 칩,
Int. CL H01L 21/60 (2006.01)
CPC
출원번호/일자 1020020064135 (2002.10.21)
출원인 한국전자통신연구원
등록번호/일자 10-0472681-0000 (2005.02.11)
공개번호/일자 10-2004-0034077 (2004.04.28) 문서열기
공고번호/일자 (20050310) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.10.21)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 장우진 대한민국 대전광역시서구
2 윤형섭 대한민국 대전광역시유성구
3 김해천 대한민국 대전광역시유성구
4 조경익 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2002.10.21 수리 (Accepted) 1-1-2002-0344106-71
2 선행기술조사의뢰서
Request for Prior Art Search
2004.03.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2004.04.13 수리 (Accepted) 9-1-2004-0023319-26
4 의견제출통지서
Notification of reason for refusal
2004.07.22 발송처리완료 (Completion of Transmission) 9-5-2004-0292574-87
5 명세서 등 보정서
Amendment to Description, etc.
2004.09.20 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2004-0427005-17
6 의견서
Written Opinion
2004.09.20 수리 (Accepted) 1-1-2004-0427007-08
7 등록결정서
Decision to grant
2005.02.03 발송처리완료 (Completion of Transmission) 9-5-2005-0058046-04
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1
삭제
2 2
상단 하우징; 및 RF 신호가 입출력되는 도파관 및 상기 도파관 사이에 위치되는 중앙부의 상단에 탑재된 반도체 칩을 포함하는 하단 하우징을 포함하되, 상기 반도체 칩은 상기 도파관을 통해 입출력되는 RF 신호를 전송하는 입력 스트립부 및 출력 스트립부를 포함하고, 상기 반도체 칩과 상기 하단 하우징 사이에 더미 PCB를 포함하며, 상기 상단 하우징과 상기 하단 하우징은 서로 대응되도록 결합된 것을 특징으로 하는 도파관 구조의 패키지
3 3
제 2 항에 있어서, 상기 더미 PCB는 상부가 상기 반도체 칩과 부착되고, 하부가 상기 하단 하우징과 부착된 것을 특징으로 하는 도파관 구조의 패키지
4 4
제 2 항에 있어서, 상기 더미 PCB는 다수의 비아홀을 포함하는 것을 특징으로 하는 도파관 구조의 패키지
5 5
제 2 항에 있어서, 상기 입력 스트립부는, 상기 도파관을 통해 입력되는 RF 신호를 입력받는 프로브; 상기 프로브로 입력되는 RF 신호를 전송하는 마이크로스트립-도파관 전이부; 및 상기 마이크로스트립-도파관 전이부로 전송된 RF 신호를 상기 반도체 칩 내에 구성된 주회로부의 입력패드로 출력하는 마이크로스트립 라인을 포함하는 것을 특징으로 하는 도파관 구조의 패키지
6 6
제 5 항에 있어서, 상기 마이크로스트립 라인과 상기 입력패드는 서로 전기적으로 접속된 것을 특징으로 하는 도파관 구조의 패키지
7 7
제 2 항에 있어서, 상기 출력 스트립부는, 상기 반도체 칩 내에 구성된 주회로부의 출력패드를 통해 출력된 RF 신호를 입력받는 프로브; 상기 프로브로 입력되는 RF 신호를 전송하는 마이크로스트립-도파관 전이부; 및 상기 마이크로스트립-도파관 전이부로 전송된 RF 신호를 상기 도파관을 통해 외부로 출력하는 마이크로스트립 라인을 포함하는 것을 특징으로 하는 도파관 구조의 패키지
8 8
제 7 항에 있어서, 상기 프로브와 상기 출력패드는 서로 전기적으로 접속된 것을 특징으로 하는 도파관 구조의 패키지
9 9
삭제
10 10
(a) 일부에 적어도 2개의 홈을 갖는 상단 하우징을 완성하는 단계; (b) 상기 홈과 대응되도록 도파관을 형성하고, 상기 도파관 사이에 위치되는 중앙부의 상단에 상기 도파관을 통해 입출력되는 RF 신호를 전송하는 입력 스트립부 및 출력 스트립부가 형성된 반도체 칩을 탑재시켜 하단 하우징을 완성하는 단계; (c) 상기 반도체 칩과 상기 하단 하우징 간에 접착제를 이용하여 더미 PCB를 부착하는 단계; 및 (c) 상기 상단 하우징과 상기 하단 하우징을 서로 대응되도록 서로 결합시키는 단계를 포함하는 것을 특징으로 하는 도파관 구조의 패키지 제조방법
11 10
(a) 일부에 적어도 2개의 홈을 갖는 상단 하우징을 완성하는 단계; (b) 상기 홈과 대응되도록 도파관을 형성하고, 상기 도파관 사이에 위치되는 중앙부의 상단에 상기 도파관을 통해 입출력되는 RF 신호를 전송하는 입력 스트립부 및 출력 스트립부가 형성된 반도체 칩을 탑재시켜 하단 하우징을 완성하는 단계; (c) 상기 반도체 칩과 상기 하단 하우징 간에 접착제를 이용하여 더미 PCB를 부착하는 단계; 및 (c) 상기 상단 하우징과 상기 하단 하우징을 서로 대응되도록 서로 결합시키는 단계를 포함하는 것을 특징으로 하는 도파관 구조의 패키지 제조방법
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순번 패밀리번호 국가코드 국가명 종류
1 US20040080377 US 미국 FAMILY

DOCDB 패밀리 정보

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순번 패밀리번호 국가코드 국가명 종류
1 CN1501546 CN 중국 DOCDBFAMILY
2 US2004080377 US 미국 DOCDBFAMILY
국가 R&D 정보가 없습니다.