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플립칩 본딩방법 및 이를 이용한 광모듈

  • 기술번호 : KST2015081069
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 상기 목적을 달성하기 위한 본 발명에 따라 스터드범프를 이용하여 반도체칩을 기판에 본딩하는 플립칩 본딩 방법은, 상기 기판 및 반도체칩 상에, 금속층을 형성하는 제1 단계; 상기 금속층 상면에 솔더층을 형성하는 제2 단계; 상기 기판 또는 상기 반도체칩 상에 형성된 솔더층의 상면에 스터드범프를 형성하는 제3 단계; 상기 기판 또는 반도체칩 상면에 형성된 스터드범프를 코인잉(coining)하는 제4 단계; 상기 코인잉된 스터드범프가 형성된 기판 또는 반도체칩의 스터드범프와, 스터드범프가 형성되지 않은 반도체칩 또는 기판의 솔더층이 접촉되도록 정밀 정렬하는 제5 단계; 및 상기 정밀 정렬된 상태에서 상기 솔더층이 용융될 수 있는 소정의 온도로 가열하면서 압력을 인가하여 상기 기판과 상기 반도체칩을 고정시키는 제6 단계;를 포함하는 것을 특징으로 한다. 플립칩본딩, 광모듈, 반도체칩, 실리콘기판, 스터드범프, 솔더층, V-홈, 광섬유
Int. CL H01L 21/60 (2006.01)
CPC
출원번호/일자 1020050117781 (2005.12.05)
출원인 한국전자통신연구원
등록번호/일자 10-0680997-0000 (2007.02.02)
공개번호/일자
공고번호/일자 (20070209) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2005.12.05)
심사청구항수 6

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 유정희 대한민국 광주 광산구
2 강현서 대한민국 광주 광산구

대리인

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번호 이름 국적 주소
1 특허법인씨엔에스 대한민국 서울 강남구 언주로 **길 **, 대림아크로텔 *층(도곡동)

최종권리자

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번호 이름 국적 주소
1 대한민국(산업통상자원부장관) 세종특별자치시 한누리대
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2005.12.05 수리 (Accepted) 1-1-2005-0709886-74
2 선행기술조사의뢰서
Request for Prior Art Search
2006.11.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2006.12.05 수리 (Accepted) 9-1-2006-0080899-24
4 등록결정서
Decision to grant
2007.01.30 발송처리완료 (Completion of Transmission) 9-5-2007-0058922-54
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1
스터드범프를 이용하여 반도체칩을 기판에 본딩하는 플립칩 본딩 방법에 있어서,상기 기판 및 반도체칩 상에, 금속층을 형성하는 제1 단계;상기 금속층 상면에 솔더층을 형성하는 제2 단계;상기 기판 또는 상기 반도체칩 상에 형성된 솔더층의 상면에 스터드범프를 형성하는 제3 단계;상기 기판 또는 반도체칩 상면에 형성된 스터드범프를 코인잉(coining)하는 제4 단계;상기 코인잉된 스터드범프가 형성된 기판 또는 반도체칩의 스터드범프와, 스터드범프가 형성되지 않은 반도체칩 또는 기판의 솔더층이 접촉되도록 정밀 정렬하는 제5 단계; 및 상기 정밀 정렬된 상태에서 상기 솔더층이 용융될 수 있는 소정의 온도로 가열하면서 압력을 인가하여 상기 기판과 상기 반도체칩을 고정시키는 제6 단계;를 포함하는 것을 특징으로 하는 플립칩 본딩방법
2 2
제1항에 있어서, 제1 단계에서, 상기 금속층은 상기 기판 또는 상기 반도체칩의 상면에 티타늄(Ti), 니켈(Ni), 백금(Pt) 또는 텅스텐(W) 중 적어도 하나를 이용하여 단일층 또는 복합층으로 형성되는 것을 특징으로 하는 플립칩 본딩방법
3 3
제1항에 있어서, 제2 단계는, 상기 금속층 위에 주석(Sn), 인듐(In), 게르마늄(Ge) 또는 실리콘(Si) 중 적어도 하나를 이용하여 하부 솔더층을 형성하는 단계; 및상기 하부 솔더층의 상면에, 표면산화방지 및 솔더층의 기능을 제공하도록 금(Au)을 이용하여 상부 솔더층을 형성시키는 단계를 포함하는 것을 특징으로 하는 플립칩 본딩방법
4 4
제1항에 있어서, 상기 스터드범프는, 금, 알루미늄, 구리 및 은 중 적어도 하나를 이용하여 형성되는 것을 특징으로 하는 플립칩 본딩방법
5 5
제1항에 있어서, 상기 기판에는 V 자 형으로 식각된 V홈이 형성되고, 상기 V홈 상에는 상기 반도체칩과 광신호를 입력 또는 출력하도록 광섬유가 배열되는 것을 특징으로 하는 플립칩 본딩 방법
6 6
제1항 내제 제5항 중 어느 한 항에 따라 제조되는 광모듈
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.