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멀티미디어 시스템용 ＳｏＣ 시스템

  • 기술번호 : KST2015083866
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 멀티미디어 대용량 데이터의 고속 전송 및 프로세서에 의한 주변 장치의 신속한 제어를 가능케 하는 멀티미디어 시스템용 SoC 구조에 관한 것이다. 본 발명에 따른 SoC 시스템은, 프로세서와, 복수개의 주변 장치들과, 물리적으로 분할된 복수의 메모리들과, 상기 프로세서에서 상기 주변 장치들 및 상기 메모리들로 제어 신호를 전송하기 위한 제어 버스와, 상기 프로세서, 상기 주변 장치들 및 상기 메모리들간에 데이터 송수신하기 위한 데이터 버스와, 상기 제어 버스 및 상기 데이터 버스를 상기 프로세서에 연결하기 위한 브리지와, 상기 제어 버스에 연결되며 상기 메모리 각각을 제어하기 위한 복수의 메모리 제어기들과, 상기 데이터 버스 및 상기 제어 버스에 연결되며 상기 주변 장치들과 상기 메모리들간에 데이터 송수신을 제어하기 위한 직접 메모리 액세스(DMA) 제어기와, 상기 DMA 제어기와 상기 메모리 제어기들 사이에 연결되어 동시 다중 메모리 접속을 제공하는 매트릭스 스위치를 포함한다. 시스템 온 칩(SoC), 멀티미디어, 고속 통신
Int. CL G06F 15/78 (2006.01) G06F 13/00 (2006.01)
CPC
출원번호/일자 1020070121656 (2007.11.27)
출원인 한국전자통신연구원
등록번호/일자 10-0951856-0000 (2010.04.01)
공개번호/일자 10-2009-0054793 (2009.06.01) 문서열기
공고번호/일자 (20100412) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2007.11.27)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 천익재 대한민국 대전 중구
2 노태문 대한민국 대전 유성구
3 김종대 대한민국 대전 유성구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2007.11.27 수리 (Accepted) 1-1-2007-0854276-70
2 선행기술조사의뢰서
Request for Prior Art Search		 2008.07.08 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2008.08.12 수리 (Accepted) 9-1-2008-0052213-14
4 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
5 의견제출통지서
Notification of reason for refusal		 2009.09.24 발송처리완료 (Completion of Transmission) 9-5-2009-0396429-64
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2009.11.17 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2009-0704551-72
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2009.11.17 수리 (Accepted) 1-1-2009-0704528-21
8 등록결정서
Decision to grant		 2010.03.30 발송처리완료 (Completion of Transmission) 9-5-2010-0133520-90
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
프로세서와, 복수개의 주변 장치들과, 물리적으로 분할된 복수의 메모리들 - 상기 복수의 메모리들은 데이터 특성 및 통신 요구 대역중 적어도 하나에 기반하여 분리됨-과, 상기 프로세서에서 상기 주변 장치들 및 상기 메모리들로 제어 신호를 전송하기 위한 제어 버스와, 상기 프로세서, 상기 주변 장치들 및 상기 메모리들간에 데이터 송수신하기 위한 데이터 버스와, 상기 제어 버스 및 상기 데이터 버스를 상기 프로세서에 연결하기 위한 브리지와, 상기 제어 버스에 연결되며 상기 메모리 각각을 제어하기 위한 복수의 메모리 제어기들과, 상기 데이터 버스 및 상기 제어 버스에 연결되며 상기 주변 장치들과 상기 메모리들간에 데이터 송수신을 제어하기 위한 직접 메모리 액세스(DMA) 제어기와, 상기 DMA 제어기와 상기 메모리 제어기들 사이에 연결되어 동시 다중 메모리 접속을 제공하는 매트릭스 스위치 를 포함하는 시스템 온 칩(SoC) 시스템
2 2
삭제
3 3
제1항에 있어서, 상기 브리지는 상기 프로세서에 의한 상기 제어 버스 및 상기 데이터 버스의 독립적인 액세스를 허용하는 SoC 시스템
4 4
제1항에 있어서, 상기 제어 버스를 확장시키기 위한 별개의 브리지를 더 포함하고, 상기 별개의 브리지를 통해 확장된 제어 버스를 통해 부가적인 주변 장치 또는 연산 유닛을 연결 및 제어하는 SoC 시스템
5 5
제1항에 있어서, 상기 복수개의 주변 장치 각각은 상기 제어 버스에 접속하기 위한 제어 인터페이스와 상기 데이터 버스에 접속하기 위한 데이터 전송 인터페이스를 포함하는 SoC 시스템
6 6
제1항에 있어서, 상기 DMA 제어기는 독립적으로 동작하는 다수의 DMA 채널을 구비하며, 각 DMA 채널은 DAM 제어를 요구하는 프로세서에 의해 제어되는 SoC 시스템
7 7
제1항에 있어서, 상기 매트릭스 스위치는 상기 데이터 버스 및 상기 DMA 제어기에 연결되어 데이터를 수신하기 위한 복수개의 입력 포트와, 상기 물리적으로 분리된 메모리로 데이터를 출력하기 위해 상기 메모리 제어기 각각에 연결된 복수개의 출력 포트와, 상기 입력 포트를 통해 입력된 데이터를 출력할 출력 포트를 선택하는 중재부를 포함하는 SoC 시스템
8 8
제1항에 있어서, 상기 SoC 시스템은 별개의 프로세서 및 상기 프로세서에 데이터 버스 및 제어 버스를 통해 연결된 복수의 주변 장치를 구비한 서브 시스템을 더 포함하고, 상기 DMA 제어기 및 상기 매트릭스 스위치는 상기 서브 시스템의 상기 데이터 버스 및 상기 제어 버스에 또한 연결되는 SoC 시스템
9 9
제8항에 있어서, 상기 서브 시스템과의 데이터 통신을 위해 상기 복수의 메모리들내에 공유 메모리를 지정하는 SoC 시스템
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1 US07721038 US 미국 FAMILY
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1 US2009138645 US 미국 DOCDBFAMILY
2 US7721038 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 정보통신부 및 정보통신연구진흥원 한국전자통신연구원 IT원천기술개발 유비쿼터스 단말용 부품 모듈