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반도체 소자의 제조 방법

  • 기술번호 : KST2015090427
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 실시예에 따른 반도체 소자 제조 방법은 제 1 도전형의 반도체 기판을 식각하여 제 1 트렌치를 형성하는 것, 상기 제 1 트렌치로부터 연장하는 제 2 트렌치를 형성하는 것, 상기 제 2 트렌치 내벽으로 불순물을 확산하여 상기 제 2 트렌치를 감싸는 제 2 도전형의 불순물 영역을 형성하는 것, 상기 제 2 트렌치 내벽을 덮는 플로팅 절연막과 상기 제 2 트렌치를 채우는 플로팅 전극을 형성하는 것, 및 상기 제 1 트렌치 내벽을 덮는 게이트 절연막과 상기 제 1 트렌치를 채우는 게이트 전극을 형성하는 것을 포함할 수 있다.
Int. CL H01L 21/337 (2006.01) H01L 29/808 (2006.01)
CPC
출원번호/일자 1020120053276 (2012.05.18)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2013-0128996 (2013.11.27) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2017.02.02)
심사청구항수 14

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 나경일 대한민국 대전 유성구

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.05.18 수리 (Accepted) 1-1-2012-0400231-18
2 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2015.01.13 수리 (Accepted) 1-1-2015-0033908-14
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
4 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2017.02.02 수리 (Accepted) 1-1-2017-0110597-16
5 선행기술조사의뢰서
Request for Prior Art Search
2017.07.12 수리 (Accepted) 9-1-9999-9999999-89
6 선행기술조사보고서
Report of Prior Art Search
2017.09.21 발송처리완료 (Completion of Transmission) 9-6-2017-0146804-86
7 등록결정서
Decision to grant
2017.10.17 발송처리완료 (Completion of Transmission) 9-5-2017-0719249-51
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번호 청구항
1 1
제 1 도전형의 반도체 기판을 식각하여 제 1 트렌치를 형성하는 것; 상기 제 1 트렌치로부터 연장하는 제 2 트렌치를 형성하는 것;상기 제 2 트렌치 내벽으로 불순물을 확산하여 상기 제 2 트렌치를 감싸는 제 2 도전형의 불순물 영역을 형성하는 것;상기 제 2 트렌치 내벽을 덮는 플로팅 절연막과 상기 제 2 트렌치를 채우는 플로팅 전극을 형성하는 것; 및상기 제 1 트렌치 내벽을 덮는 게이트 절연막과 상기 제 1 트렌치를 채우는 게이트 전극을 형성하는 것을 포함하는 반도체 소자의 제조 방법
2 2
제 1 항에 있어서,상기 제 2 트렌치를 형성하는 것은,상기 반도체 기판 상에 상기 제 1 트렌치의 내벽을 덮는 보호막을 형성하는 것;상기 제 1 트렌치의 하부면을 덮는 상기 보호막을 제거하여 상기 제 1 트렌치의 하부면을 노출시키는 것; 및상기 제 1 트렌치의 하부면에 노출된 상기 반도체 기판을 식각하는 것을 포함하는 반도체 소자의 제조 방법
3 3
제 2 항에 있어서,상기 불순물 영역을 형성한 후에 상기 제 1 트렌치의 측벽을 덮는 보호막을 제거하는 것을 포함하는 반도체 소자의 제조 방법
4 4
제 1 항에 있어서,상기 불순물 영역을 형성하는 것은,상기 제 2 트렌치 내벽을 덮는 제 2 도전형의 불순물 막을 형성하는 것;상기 불순물 막을 열처리하여 상기 불순물 막에 포함되어 있는 불순물을 상기 제 2 트렌치 주변으로 확산시키는 것을 포함하는 반도체 소자의 제조 방법
5 5
제 4 항에 있어서,상기 불순물 막은 boron(B), aluminum(Al), Gallium(Ga), 및 Indium(In) 중 어느 하나를 포함하는 반도체 소자의 제조 방법
6 6
제 4 항에 있어서,상기 불순물 막은 Nitride(N), Phosphorus(P), Arsenic(As), 및 Antimony(Sb) 중 어느 하나를 포함하는 반도체 소자의 제조 방법
7 7
제 4 항에 있어서,상기 불순물 막은 상기 불순물 영역이 형성된 후에 제거되는 반도체 소자의 제조 방법
8 8
제 1 항에 있어서,상기 반도체 기판의 하부에 제 1 도전형의 드레인 영역 형성하는 것을 더 포함하는 반도체 소자의 제조 방법
9 9
제 8 항에 있어서,상기 불순물 영역 및 상기 플로팅 절연막은 상기 드레인 영역과 접촉되도록 형성되는 반도체 소자의 제조 방법
10 10
제 8 항에 있어서,상기 불순물 영역 및 상기 플로팅 절연막은 상기 드레인 영역과 이격되도록 형성되는 반도체 소자의 제조 방법
11 11
제 8 항에 있어서,상기 반도체 기판 내에 상기 불순물 영역과 접촉되며 상기 제 1 트렌치에 대응되는 깊이를 가지는 채널 영역을 형성하는 것;상기 채널 영역 상에 형성되되, 상기 불순물 영역과 이격되며 상기 제 1 트렌치의 측벽부와 접촉되는 제 1 도전형의 소스 영역을 형성하는 것;상기 채널 영역 상에 상기 제 1 트렌치의 측벽과 이격된 제 2 도전형의 소스 영역을 형성하는 것; 상기 반도체 기판 상에 접촉하는 소스 전극을 형성하는 것; 및상기 반도체 기판 하부의 드레인 영역에 접촉하는 상기 드레인 전극을 형성하는 것을 더 포함하는 반도체 소자의 제조 방법
12 12
제 1 항에 있어서,상기 플로팅 절연막은 상기 게이트 절연막보다 두껍게 형성되는 반도체 소자의 제조 방법
13 13
제 1 항에 있어서,상기 플로팅 절연막은 열 산화 공정(Thermal-oxidation), 및 화학 기상 증착(Chemical Vapor Deposition)방법 중 어느 하나에 의해서 형성되는 반도체 소자의 제조 방법
14 14
제 1 항에 있어서,상기 플로팅 절연막은 산화막, 질화막, 및 산화막과 질화막이 포함된 다층막 중 어느 하나인 반도체 소자의 제조 방법
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2 US8633072 US 미국 DOCDBFAMILY
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1 지식경제부 한국전자통신연구원 정보통신산업원천기술개발사업 BLDC 모터용 고전압/대전류 파워모듈 및 ESD 기술개발