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레일-투-레일 방식의 오차 증폭기를 갖는 전압 레귤레이터

  • 기술번호 : KST2015091277
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 실시 예에 따른 전압 레귤레이터는 기준 전압을 발생하는 기준 전압 발생기, 상기 기준 전압 및 입력 전압의 차이를 비교하여 증폭하는 오차 증폭기, 상기 오차 증폭기로부터 발생되는 출력 전압에 따라 구동 전류의 크기가 달라지는 패스 트랜지스터, 상기 패스 트랜지스터의 출력 전압을 전압 분배하여 상기 오차 증폭기의 입력 전압으로 제공하는 전압 분배기를 포함하되, 상기 오차 증폭기는 한 쌍의 NMOS 및 PMOS 트랜지스터를 이용하여 상기 기준 전압 및 상기 입력 전압을 각각 수신하는 레일-투-레일 구조의 입력단 및 부하의 구동을 위한 전압 버퍼 구조의 출력단으로 구성된다.
Int. CL H02M 3/156 (2006.01.01) G05F 1/56 (2006.01.01) G05F 1/575 (2006.01.01)
CPC H02M 3/156(2013.01) H02M 3/156(2013.01) H02M 3/156(2013.01)
출원번호/일자 1020120139074 (2012.12.03)
출원인 한국전자통신연구원, 단국대학교 산학협력단
등록번호/일자 10-2031199-0000 (2019.10.04)
공개번호/일자 10-2014-0071103 (2014.06.11) 문서열기
공고번호/일자 (20191011) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2017.10.19)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 단국대학교 산학협력단 대한민국 경기도 용인시 수지구

발명자

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번호 이름 국적 주소
1 양일석 대한민국 대전 유성구
2 김종대 대한민국 대전 유성구
3 구용서 대한민국 서울 강남구

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대전광역시 유성구
2 단국대학교 산학협력단 경기도 용인시 수지구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2012.12.03 수리 (Accepted) 1-1-2012-1000930-77
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.01.06 수리 (Accepted) 4-1-2014-0000870-18
3 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
4 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)		 2015.04.28 수리 (Accepted) 1-1-2015-0412637-81
5 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)		 2017.10.19 수리 (Accepted) 1-1-2017-1032908-49
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2017.10.19 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-1032876-76
7 선행기술조사의뢰서
Request for Prior Art Search		 2018.07.12 수리 (Accepted) 9-1-9999-9999999-89
8 선행기술조사보고서
Report of Prior Art Search		 2018.09.11 발송처리완료 (Completion of Transmission) 9-6-2018-0155083-19
9 의견제출통지서
Notification of reason for refusal		 2018.12.28 발송처리완료 (Completion of Transmission) 9-5-2018-0893904-20
10 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2019.02.28 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2019-0215911-14
11 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2019.02.28 수리 (Accepted) 1-1-2019-0215910-79
12 등록결정서
Decision to grant		 2019.07.10 발송처리완료 (Completion of Transmission) 9-5-2019-0498246-10
13 [출원서 등 보정]보정서
[Amendment to Patent Application, etc.] Amendment		 2020.02.26 수리 (Accepted) 1-1-2020-0202517-58
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.10.26 수리 (Accepted) 4-1-2020-5239146-54
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
기준 전압을 발생하는 기준 전압 발생기;상기 기준 전압 및 입력 전압의 차이를 비교하여 증폭하는 오차 증폭기;상기 오차 증폭기로부터 발생되는 출력 전압에 따라 구동 전류의 크기를 달리하여 전압을 출력하는 패스 트랜지스터; 및상기 패스 트랜지스터의 출력 전압을 전압 분배하여 상기 오차 증폭기의 입력 전압으로 제공하는 전압 분배기를 포함하되,상기 오차 증폭기는 상기 기준 전압 및 상기 입력 전압을 각각 수신하는 레일-투-레일 구조의 입력 회로 및 부하의 구동을 위한 전압 버퍼 구조의 출력 회로를 포함하고,상기 입력 회로는,상기 입력 전압이 제공되는 게이트 단자를 갖는 제1 트랜지스터, 및 상기 기준 전압이 제공되는 게이트 단자를 갖는 제2 트랜지스터를 포함하는 제1 차동 증폭단;상기 입력 전압이 제공되는 게이트 단자를 갖는 제3 트랜지스터, 및 상기 기준 전압이 제공되는 게이트 단자를 갖는 제4 트랜지스터를 포함하는 제2 차동 증폭단; 및상기 제1 차동 증폭단에 기준 전류를 제공하는 기준 전류원을 포함하고,상기 제2 차동 증폭단은 미러된 상기 기준 전류를 제공받는 전압 레귤레이터
2 2
제1 항에 있어서,상기 제1 및 제2 트랜지스터는 PMOS이고, 상기 제3 및 제4 트랜지스터는 NMOS이고, 상기 제1 차동 증폭단과 상기 제2 차동 증폭단은 서로 병렬로 연결되는 전압 레귤레이터
3 3
제2 항에 있어서,상기 기준 전류원은,캐스코드 구조로 연결된 복수의 트랜지스터들을 포함하는 전압 레귤레이터
4 4
제1 항에 있어서,상기 기준 전류원은,제1 바이어스 전압이 제공되는 게이트 단자, VDD 전압이 제공되는 일단자, 및 타단자를 갖는 제5 트랜지스터; 및제2 바이어스 전압이 제공되는 게이트 단자, 상기 제5 트랜지스터의 타단자와 연결되는 일단자, 및 상기 제1 차동 증폭단에 상기 기준 전류를 출력하는 타단자를 갖는 제6 트랜지스터를 포함하는 전압 레귤레이터
5 5
제1 항에 있어서,상기 입력 회로는,제1 바이어스 전압이 제공되는 게이트 단자, VDD 전압이 제공되는 일단자, 및 상기 제3 트랜지스터와 연결되는 타단자를 갖는 제5 트랜지스터;상기 제1 바이어스 전압이 제공되는 게이트 단자, 상기 VDD 전압이 제공되는 일단자, 및 상기 제4 트랜지스터와 연결되는 타단자를 갖는 제6 트랜지스터;제2 바이어스 전압이 제공되는 게이트 단자, 및 상기 제5 트랜지스터의 타단자와 연결되는 일단자를 갖는 제7 트랜지스터; 및상기 제2 바이어스 전압이 제공되는 게이트 단자, 상기 제6 트랜지스터의 타단자와 연결되는 일단자, 및 상기 출력 회로와 연결되는 타단자를 갖는 제8 트랜지스터를 더 포함하는 전압 레귤레이터
6 6
제5 항에 있어서,상기 출력 회로는,상기 제8 트랜지스터의 타단자와 연결되는 게이트 단자, 상기 VDD 전압이 제공되는 일단자, 및 타단자를 갖는 제9 트랜지스터;상기 제9 트랜지스터의 타단자와 연결되는 게이트 단자, 상기 오차 증폭기의 출력 단자와 연결되는 일단자, 및 타단자를 갖는 제10 트랜지스터; 및상기 제10 트랜지스터의 타단자와 연결되는 게이트 단자, 상기 출력 단자와 연결되는 일단자, 및 접지되는 타단자를 갖는 제11 트랜지스터를 포함하고,상기 제9 트랜지스터 및 상기 제11 트랜지스터는 동일한 타입의 트랜지스터이고, 상기 제10 트랜지스터는 상기 제9 트랜지스터 및 상기 제11 트랜지스터와 다른 타입의 트랜지스터인 전압 레귤레이터
7 7
제1 항에 있어서,상기 오차 증폭기는,상기 입력 전압의 크기가 상기 기준 전압의 크기보다 큰 경우, VDD 전압을 출력하고,상기 입력 전압의 크기가 상기 기준 전압의 크기보다 작은 경우, VSS 전압을 출력하는 전압 레귤레이터
8 8
제1 항에 있어서,상기 전압 분배기는,상기 패스 트랜지스터와 연결되는 일단자 및 상기 오차 증폭기의 상기 입력 회로에 연결되는 타단자를 갖는 제1 저항; 및상기 제1 저항의 타단자와 연결되는 일단자 및 접지되는 타단자를 갖는 제2 저항을 포함하는 전압 레귤레이터
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 산업통상자원부 한국전자통신연구원 BLDC 모터용 고전압/대전류 파워모듈 및 ESD 기술개발 산업원천기술개발사업(정보통신)