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아날로그 디지털 변환기 및 그것의 전력 절감 방법

  • 기술번호 : KST2015099363
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 아날로그 디지털 변환기는 표본화된 아날로그 입력 신호와 기준 신호 간의 비교 결과를 출력하고, 전력 제어 신호에 응답하여 전력 공급 동작을 제어하는 전처리 증폭기, 비교 결과에 근거하여 디지털 신호를 생성하는 디지털 신호 처리기, 전처리 증폭기의 동작을 제어하기 위한 증폭기 동작 클럭 신호를 생성하는 전력 제어기, 및 증폭기 동작 클럭 신호의 하강 에지의 개수를 카운팅하고, 카운팅된 하강 에지의 개수에 따라 전처리 증폭기의 전력 차단 시점을 검출하는 카운터를 포함하고, 전력 제어기는 카운터의 전력 차단 시점의 검출에 응답하여 전처리 증폭기로 공급되는 전력을 차단하기 위한 전력 제어 신호를 생성한다.
Int. CL H03M 1/12 (2006.01)
CPC
출원번호/일자 1020110095886 (2011.09.22)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2013-0032154 (2013.04.01) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.05.20)
심사청구항수 15

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 남재원 대한민국 대전광역시 서구
2 조영균 대한민국 대전광역시 유성구
3 양일석 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2011.09.22 수리 (Accepted) 1-1-2011-0740244-52
2 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2015.01.14 수리 (Accepted) 1-1-2015-0036848-98
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
4 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2016.05.20 수리 (Accepted) 1-1-2016-0484144-39
5 의견제출통지서
Notification of reason for refusal
2017.02.01 발송처리완료 (Completion of Transmission) 9-5-2017-0083264-41
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.03.29 수리 (Accepted) 1-1-2017-0309070-89
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.03.29 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-0309071-24
8 등록결정서
Decision to grant
2017.06.07 발송처리완료 (Completion of Transmission) 9-5-2017-0397581-30
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
표본화된 아날로그 입력 신호와 기준 신호 간의 비교 결과를 출력하고, 전력 제어 신호에 응답하여 전력 공급 동작을 제어하는 전처리 증폭기;상기 비교 결과에 근거하여 디지털 신호를 생성하는 디지털 신호 처리기;상기 전처리 증폭기의 동작을 제어하기 위한 증폭기 동작 클럭 신호를 생성하는 전력 제어기; 및상기 증폭기 동작 클럭 신호의 하강 에지의 개수를 카운팅하고, 상기 카운팅된 하강 에지의 개수에 따라 상기 전처리 증폭기의 전력 차단 시점을 검출하는 카운터를 포함하고,상기 전력 제어기는 상기 카운터의 전력 차단 시점의 검출에 응답하여 상기 전처리 증폭기로 공급되는 전력을 차단하기 위한 전력 제어 신호를 생성하는 아날로그 디지털 변환기
2 2
제 1 항에 있어서,상기 전력 제어기는 상기 증폭기 동작 클럭 신호의 논리 하이 구간들 각각을 동일한 크기의 시구간을 갖도록 생성하는 아날로그 디지털 변환기
3 3
제 1 항에 있어서,상기 카운터는 상기 하강 에지의 개수가 미리 설정된 개수에 도달할 때에 상기 전처리 증폭기의 전력 차단 시점을 검출하는 아날로그 디지털 변환기
4 4
제 1 항에 있어서,상기 디지털 신호 처리기는상기 비교 결과를 래치하여 디지털 신호를 생성하는 비동기 래치부; 및상기 비동기 래치의 동작을 제어하기 위한 래치 동작 클럭 신호를 생성하는 비동기 클럭 생성부를 포함하는 아날로그 디지털 변환기
5 5
제 4 항에 있어서,상기 비동기 래치부는 상기 디지털 신호에 포함된 하나의 디지털 데이터가 생성될 때, 상기 래치 동작 클럭 신호를 로우 상태로 천이시키기 위한 래치 동작 종료 신호를 생성하는 아날로그 디지털 변환기
6 6
제 5 항에 있어서,상기 전력 제어기는 상기 래치 동작 종료 신호에 응답하여 상기 증폭기 동작 클럭 신호를 논리 하이 상태로 천이시키는 아날로그 디지털 변환기
7 7
제 1 항에 있어서,외부 클럭 신호를 입력받고, 상기 외부 클럭 신호로부터 시스템 클럭 신호를 생성하는 시스템 클럭 생성부를 더 포함하는 아날로그 디지털 변환기
8 8
제 7 항에 있어서,상기 시스템 클럭 생성부는상기 외부 클럭 신호를 사용하여 제 1 시스템 클럭 신호를 생성하는 제 1 시스템 클럭 생성부; 및상기 제 1 시스템 클럭 신호를 미리 결정된 시간 지연 시켜 제 2 시스템 클럭 신호를 생성하는 제 2 시스템 클럭 생성부를 포함하는 아날로그 디지털 변환기
9 9
제 8 항에 있어서,상기 제 2 시스템 클럭 신호은 상기 아날로그 디지털 변환기의 동작을 위한 신호이고, 상기 제 1 시스템 클럭 신호는 상기 전처리 증폭기로 전력 공급을 위한 전력 제어 신호 생성을 위한 신호인 아날로그 디지털 변환기
10 10
제 1 항에 있어서,아날로그 입력 신호를 표본화하여 표본화된 아날로그 신호를 생성하는 입력 신호 표본화기; 및상기 표본화된 아날로그 신호로부터 디지털 신호 생성을 위한 기준 신호를 생성하는 기준 신호 생성기를 더 포함하는 아날로그 디지털 변환기
11 11
제 1 항에 있어서,상기 전처리 증폭기로 전력을 공급하는 전력 공급기를 더 포함하는 아날로그 디지털 변환기
12 12
제 11 항에 있어서,상기 전처리 증폭기는상기 전력 공급기에 연결되고, 상기 전력 제어 신호에 응답하여 상기 전력을 상기 전처리 증폭기로 공급 동작과 차단 동작 중 하나의 동작을 수행하는 스위치를 포함하는 아날로그 디지털 변환기
13 13
아날로그 디지털 변환기의 전력 절감 방법에 있어서,입력된 아날로그 신호와 기준 신호의 비교 결과를 출력하기 위한 전처리 증폭기로 전력을 공급하는 단계;상기 비교 결과에 따라 상기 아날로그 신호로부터 디지털 신호를 생성하는 중에 상기 디지털 신호에 포함된 데이터의 개수가 미리 설정된 개수를 초과하는지 판단하는 단계; 및상기 디지털 신호에 포함된 데이터의 개수가 미리 설정된 개수를 초과하면, 상기 전처리 증폭기로 공급되는 전력을 차단하는 단계를 포함하는 전력 절감 방법
14 14
제 13 항에 있어서,상기 전력을 공급하는 단계는 상기 전력을 공급하는 단계 이후에상기 전처리 증폭기의 동작을 활성화하기 위한 증폭기 클럭 신호를 입력하는 단계를 더 포함하는 전력 절감 방법
15 15
제 14 항에 있어서,상기 전력을 차단하는 단계는상기 증폭기 클럭 신호의 하강 에지의 개수가 미리 설정된 개수에 도달했는지를 카운트하고, 상기 카운트된 하강 에지의 개수가 미리 설정된 개수이면 상기 전처리 증폭기로 공급되는 전력을 차단하는 단계를 포함하는 전력 절감 방법
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국전자통신연구원 정보통신산업원천기술개발사업 BLDC 모터용 고전압/대전류 파워모듈 및 ESD 기술개발