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파워게이팅 회로의 서지전류 저감 방법 및 서지전류 저감된 파워게이팅 회로

  • 기술번호 : KST2015135532
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 파워게이팅 회로의 서지전류 저감 방법이 제공된다. 상기 방법은 회로를 구성하는 다수의 논리 게이트를 연결하는 다수의 간선 중 전하가 로우 레벨 상태인 로우 레벨 간선을 선택하고, 로우 레벨 간선 중 경계 간선을 선택하고, 경계 간선을 경계로 회로를 제1 클러스터 및 제2 클러스터로 분할하고, 제1 및 제2 클러스터에 각각 제1 및 제2 슬립 트랜지스터를 연결하고, 제1 및 제2 슬립 트랜지스터를 순차적으로 턴 온 하는 것을 포함한다.
Int. CL H03K 19/00 (2006.01.01)
CPC H03K 19/0016(2013.01) H03K 19/0016(2013.01) H03K 19/0016(2013.01)
출원번호/일자 1020100011987 (2010.02.09)
출원인 한양대학교 산학협력단, 서울대학교산학협력단
등록번호/일자 10-1127208-0000 (2012.03.08)
공개번호/일자 10-2011-0092522 (2011.08.18) 문서열기
공고번호/일자 (20120329) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.02.09)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한양대학교 산학협력단 대한민국 서울특별시 성동구
2 서울대학교산학협력단 대한민국 서울특별시 관악구

발명자

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번호 이름 국적 주소
1 신현철 대한민국 경기도 안산시 상록구
2 김태환 대한민국 서울특별시 서초구
3 이용호 대한민국 서울특별시 관악구

대리인

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번호 이름 국적 주소
1 특허법인가산 대한민국 서울 서초구 남부순환로 ****, *층(서초동, 한원빌딩)

최종권리자

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번호 이름 국적 주소
1 서울대학교산학협력단 서울특별시 관악구
2 한양대학교 에리카산학협력단 경기도 안산시 상록구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2010.02.09 수리 (Accepted) 1-1-2010-0087441-10
2 보정요구서
Request for Amendment		 2010.02.23 발송처리완료 (Completion of Transmission) 1-5-2010-0016452-63
3 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment		 2010.03.04 수리 (Accepted) 1-1-2010-0140211-15
4 의견제출통지서
Notification of reason for refusal		 2011.07.12 발송처리완료 (Completion of Transmission) 9-5-2011-0384858-60
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2011.09.08 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2011-0702961-90
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2011.09.08 수리 (Accepted) 1-1-2011-0702955-15
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2011.09.27 수리 (Accepted) 4-1-2011-5195109-43
8 등록결정서
Decision to grant		 2011.12.19 발송처리완료 (Completion of Transmission) 9-5-2011-0750778-46
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.01.14 수리 (Accepted) 4-1-2013-5007213-54
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.06.05 수리 (Accepted) 4-1-2014-5068294-39
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.16 수리 (Accepted) 4-1-2015-5022074-70
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.03.17 수리 (Accepted) 4-1-2015-5033829-92
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.05.13 수리 (Accepted) 4-1-2015-5062924-01
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.05.13 수리 (Accepted) 4-1-2019-5093546-10
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.05.23 수리 (Accepted) 4-1-2019-5101798-31
16 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.08.02 수리 (Accepted) 4-1-2019-5154561-59
17 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.08.05 수리 (Accepted) 4-1-2019-5155816-75
18 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.08.06 수리 (Accepted) 4-1-2019-5156285-09
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
회로를 구성하는 다수의 논리 게이트를 연결하는 다수의 간선(edge) 중 상기 간선에 흐르는 전류의 레벨이 로우 레벨 상태인 로우 레벨 간선을 선택하고,상기 로우 레벨 간선 중 경계 간선을 선택하고,상기 경계 간선을 경계로 상기 회로를 제1 클러스터 및 제2 클러스터로 분할하고,상기 제1 및 제2 클러스터에 각각 제1 및 제2 슬립 트랜지스터를 연결하고,상기 제1 및 제2 슬립 트랜지스터를 순차적으로 턴 온 하는 것을 포함하는 파워게이팅 회로의 서지전류 저감 방법
2 2
제 1항에 있어서,상기 로우 레벨 간선을 선택하는 것은 상기 제1 및 제2 슬립 트랜지스터가 턴 온 되었을 때 상기 다수의 간선 중 상기 간선에 흐르는 전류의 레벨이 로우 레벨 상태인 간선을 선택하는 것을 포함하는 파워게이팅 회로의 서지전류 저감 방법
3 3
제 1항에 있어서,상기 로우 레벨 간선 중 경계 간선을 선택하는 것은 상기 로우 레벨 간선 중 상기 제1 및 제2 클러스터 사이에서 데이터 디펜던시를 미형성하는 모든 상기 로우 레벨 간선을 상기 경계 간선으로 선택하는 것을 포함하는 파워게이팅 회로의 서지전류 저감 방법
4 4
제 3항에 있어서,상기 제1 및 제2 클러스터 사이에서 데이터 디펜던시를 미형성하는 모든 상기 로우 레벨 간선을 선택하는 것은 상기 로우 레벨 간선을 이용하여 도시한 그래프에서 최대 클리크(clique)를 찾아 이에 해당하는 상기 로우 레벨 간선을 선택하는 것을 포함하는 파워게이팅 회로의 서지전류 저감 방법
5 5
제 1항에 있어서,상기 제1 및 제2 슬립 트랜지스터를 순차적으로 턴 온 하는 것은 상기 제1 슬립 트랜지스터를 턴 온 함으로써 발생하는 제1 서지전류와 상기 제2 슬립 트랜지스터를 턴 온 함으로써 발생하는 제2 서지전류의 합이 상기 회로의 서지전류 제한값 이하가 되도록 상기 제1 및 제2 슬립 트랜지스터를 순차적으로 턴 온 하는 것을 포함하는 파워게이팅 회로의 서지전류 저감 방법
6 6
제 1항에 있어서,상기 제1 슬립 트랜지스터의 크기와 상기 제2 슬립 트랜지스터의 크기는 상기 회로의 서지전류 제한값에 따라 결정되는 최대 크기 내에서 서로 동일하게 형성되거나 서로 다르도록 형성되는 파워게이팅 회로의 서지전류 저감 방법
7 7
회로를 구성하는 다수의 논리 게이트 및 간선을 분할하여 형성된 제1 및 제2 클러스터;일단이 상기 제1 클러스터에 연결되고 타단이 접지단에 연결되며 게이트 단에 제1 슬립 컨트롤 시그널이 인가되어 턴 온 되는 제1 슬립 트랜지스터; 및일단이 상기 제2 클러스터에 연결되고 타단이 상기 접지단에 연결되며 게이트 단에 제2 슬립 컨트롤 시그널이 인가되어 턴 온 되는 제2 슬립 트랜지스터를 포함하되,상기 제2 슬립 컨트롤 시그널은 상기 제1 슬립 컨트롤 시그널 보다 일정 시간 지연된 시그널인 파워게이팅 회로
8 8
제 7항에 있어서,상기 제1 및 제2 클러스터는 상기 회로를 구성하는 다수의 간선 중 상기 제1 및 제2 슬립 트랜지스터가 턴 온 되었을 때 상기 간선에 흐르는 전류의 레벨이 로우 레벨 상태인 로우 레벨 간선을 구하고, 상기 로우 레벨 간선 중 상기 제1 및 제2 클러스터 사이에서 데이터 디펜던시를 미형성하는 모든 상기 로우 레벨 간선을 경계로 상기 회로를 구성하는 다수의 논리 게이트 및 간선을 분할하여 형성된 파워게이팅 회로
9 9
제 7항에 있어서,상기 일정 시간은 상기 제1 슬립 트랜지스터가 턴 온 되면서 발생하되 시간이 지남에 따라 점차 그 크기가 감소하는 제1 서지전류와 상기 제2 슬립 트랜지스터가 턴 온 되면서 발생하는 제2 서지전류의 합이 상기 파워게이팅 회로의 서지전류 제한값 이하가 되는 시간인 파워게이팅 회로
10 10
제 7항에 있어서,상기 제1 슬립 트랜지스터의 크기와 상기 제2 슬립 트랜지스터의 크기는 상기 회로의 서지전류 제한값에 따라 결정되는 최대 크기 내에서 서로 동일하게 형성되거나 서로 다르도록 형성되는 파워게이팅 회로
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부(정통부) 지식경제부(정통부)(정보통신연구진흥원) 정보통신연구개발사업(IT인력양성지원사업) 고성능 고신뢰도 Multi-core 설계 기술 연구(2차년도)