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가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드 프로세서

  • 기술번호 : KST2015200964
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드 프로세서에 관한 것으로서, 본 발명에서는 4 way SIMD 구조를 채택하며, 여러 개의 RISC 형식의 유닛 명령어를 조합하는 가변 길이 명령어를 채택하고 하나의 유닛 명령어는 엔드(end) 비트와 페이즈(phase bit) 비트를 가지고 있다. 엔드 비트는 명령어의 길이를 지정하기 위해 사용되며, 페이즈 비트는 명령어의 처리를 듀얼(이중)으로 나누어 1 way 당 2 개의 연산기를 동시에 사용할 수 있도록 한다. 따라서 일반적인 SIMD 구조보다 2배의 연산 효율을 가지며 유닛 명령어간의 수식을 통하여 수천의 다양한 명령어를 조합시킬 수 있어 멀티미디어 가속에 특화되어 있다. RISC; 가변 길이 명령어 셋; SIMD; MIMD; dual phase
Int. CL G06F 9/38 (2006.01) G06F 9/30 (2006.01)
CPC G06F 9/3887(2013.01) G06F 9/3887(2013.01)
출원번호/일자 1020080094237 (2008.09.25)
출원인 서경대학교 산학협력단, 광운대학교 산학협력단
등록번호/일자 10-0974939-0000 (2010.08.03)
공개번호/일자 10-2010-0034976 (2010.04.02) 문서열기
공고번호/일자 (20100810) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.09.25)
심사청구항수 6

출원인

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번호 이름 국적 주소
1 서경대학교 산학협력단 대한민국 서울특별시 성북구
2 광운대학교 산학협력단 대한민국 서울특별시 노원구

발명자

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번호 이름 국적 주소
1 이광엽 대한민국 서울특별시 성북구
2 정형기 대한민국 서울특별시 성북구

대리인

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번호 이름 국적 주소
1 특허법인다울 대한민국 서울 강남구 봉은사로 ***, ***호(역삼동, 혜전빌딩)
2 박경훈 대한민국 서울 강남구 봉은사로 ***, ***호(역삼동, 혜전빌딩)(특허법인다울)

최종권리자

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번호 이름 국적 주소
1 서경대학교 산학협력단 대한민국 서울특별시 성북구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2008.09.25 수리 (Accepted) 1-1-2008-0674980-62
2 보정요구서
Request for Amendment		 2008.10.08 발송처리완료 (Completion of Transmission) 1-5-2008-0118011-53
3 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment		 2008.11.06 수리 (Accepted) 1-1-2008-0769164-27
4 선행기술조사의뢰서
Request for Prior Art Search		 2009.03.06 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search		 2009.04.16 수리 (Accepted) 9-1-2009-0025455-57
6 의견제출통지서
Notification of reason for refusal		 2010.01.04 발송처리완료 (Completion of Transmission) 9-5-2010-0003517-92
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2010.02.22 수리 (Accepted) 1-1-2010-0113577-76
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2010.02.22 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2010-0113575-85
9 [복대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Sub-agent] Report on Agent (Representative)		 2010.03.17 무효 (Invalidation) 1-1-2010-0167962-40
10 보정요구서
Request for Amendment		 2010.03.17 발송처리완료 (Completion of Transmission) 1-5-2010-0023942-98
11 [반려요청]서류반려요청(반환신청)서
[Request for Return] Request for Return of Document		 2010.03.22 불수리 (Non-acceptance) 1-1-2010-0177959-92
12 서류반려이유통지서
Notice of Reason for Return of Document		 2010.03.22 발송처리완료 (Completion of Transmission) 1-5-2010-0025411-13
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2010.04.22 수리 (Accepted) 4-1-2010-5071696-13
14 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment		 2010.04.22 수리 (Accepted) 1-1-2010-0260113-19
15 [출원인변경]권리관계변경신고서
[Change of Applicant] Report on Change of Proprietary Status		 2010.04.22 수리 (Accepted) 1-1-2010-0260152-90
16 무효처분통지서
Notice for Disposition of Invalidation		 2010.04.22 발송처리완료 (Completion of Transmission) 1-5-2010-0036429-81
17 서류반려통지서
Notice for Return of Document		 2010.04.23 발송처리완료 (Completion of Transmission) 1-5-2010-0037236-44
18 등록결정서
Decision to grant		 2010.06.08 발송처리완료 (Completion of Transmission) 9-5-2010-0245013-02
19 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2011.01.17 수리 (Accepted) 4-1-2011-5009922-84
20 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2011.08.24 수리 (Accepted) 4-1-2011-5173743-65
21 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.06.24 수리 (Accepted) 4-1-2013-0027747-42
22 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.05.02 수리 (Accepted) 4-1-2014-5054418-32
23 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.05.29 수리 (Accepted) 4-1-2014-5065900-96
24 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.06.03 수리 (Accepted) 4-1-2014-5067673-62
25 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.06.05 수리 (Accepted) 4-1-2015-5074994-12
26 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2016.05.09 수리 (Accepted) 4-1-2016-5056854-41
27 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2017.03.27 수리 (Accepted) 4-1-2017-5046666-19
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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다양한 명령어 처리가 가능한 가변 길이 명령어 셋을 갖는 듀얼 페이즈(dual phase) 심드(SIMD) 프로세서로서, 복수 개 리스크(RISC) 형식의 유닛 명령어를 구비하고, 상기 유닛 명령어에는 다른 유닛 명령어와 동시에 실행되는지 여부를 표시하는 엔드(end) 비트와, 듀얼 페이즈 명령어 수행 여부를 표시하는 페이즈(phase) 비트를 구비하고, 상기 엔드 비트에 따라 명령어 셋의 길이가 가변되고, 상기 페이즈 비트를 이용하여 듀얼 페이즈 처리가 가능한 것을 특징으로 하고, 상기 유닛 명령어에는 연산의 종류를 표시하는 연산자 비트, 데스티네이션(destination) 비트, 소스 비트 및 소스 선택 비트와 쓰기 마스크 비트를 포함하는 메인 연산 유닛 명령어와, 연산의 종류를 표시하는 연산자 비트, 연산자 마스크 비트, 소스 비트 및 소스 선택 비트와 소스 마스크 비트를 포함하는 서브 연산 유닛 명령어가 포함되는 것을 특징으로 하고, 상기 소스 마스크 비트를 이용하여 2차 페이즈의 소스 오퍼랜드(operand)를 1차 페이즈의 소스 오퍼랜드로 오버 라이드(override)하는 것을 특징으로 하는 가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드 프로세서
4 4
다양한 명령어 처리가 가능한 가변 길이 명령어 셋을 갖는 듀얼 페이즈(dual phase) 심드(SIMD) 프로세서로서, 복수 개 리스크(RISC) 형식의 유닛 명령어를 구비하고, 상기 유닛 명령어에는 다른 유닛 명령어와 동시에 실행되는지 여부를 표시하는 엔드(end) 비트와, 듀얼 페이즈 명령어 수행 여부를 표시하는 페이즈(phase) 비트를 구비하고, 상기 엔드 비트에 따라 명령어 셋의 길이가 가변되고, 상기 페이즈 비트를 이용하여 듀얼 페이즈 처리가 가능한 것을 특징으로 하고, 상기 유닛 명령어에는 연산의 종류를 표시하는 연산자 비트, 연산자 마스크 비트, 소스 비트 및 소스 선택 비트와 소스 마스크 비트를 포함하는 서브 연산 유닛 명령어가 포함되는 것을 특징으로 하고, 상기 소스 마스크 비트를 이용하여 2차 페이즈의 소스 오퍼랜드(operand)를 1차 페이즈의 소스 오퍼랜드로 오버 라이드(override)하는 것을 특징으로 하는 가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드 프로세서
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제 3항 또는 제 4항에 있어서, 각 페이즈에서 메인 연산 명령어만 존재할 경우 데스티네이션이 소스 오퍼랜드가 되는 것을 특징으로 하는 가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드 프로세서
6 6
복수 개의 리스크(RISC) 형식의 유닛 명령어로 실행되는 가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드(SIMD) 프로세서로서, 듀얼 페이즈(dual phase) 단위로 분류하여 유닛 명령어가 실행되고, 각 페이즈는 메인 유닛 명령어와 서브 유닛 명령어로 최대 두 개의 유닛 명령어로 구성되어 동시 실행되고, 상기 유닛 명령어는 엔드(end) 비트와 페이즈(phase) 비트를 구비하는 익스텐드(extend) 필드와, 사용 명령어 종류를 걸정하는 마이크로 오퍼레이션(MO) 필드와, 마이크로 오퍼레이션을 수식하는 마이크로 오퍼레이션 옵션(MO_Option) 필드와, 소스를 특정하는 소스(SRC) 필드와, 소스와 목적지를 수식하고 소스의 컴퍼넌트 순서를 특정하는 오퍼랜드 옵션 필드(Operand_Option)를 구비되고, 상기 메인 유닛 명령어는 상기 마이크로 오퍼레이션 옵션 필드에 목적지를 특정하고, 상기 소스 필드에 첫 번째 소스를 특정하고 오퍼랜드 옵션 필드에 쓰기 마스크(write mask)를 특정하고, 상기 서브 유닛 명령어는 상기 마이크로 오퍼레이션 옵션 필드에 마이크로 오퍼레이션 마스크를 특정하고 소스 필드에 두 번째 소스를 특정하고, 상기 메인 유닛 명령어만 존재할 경우 메인 유닛 명령어의 목적지가 동시에 두 번째 소스로 특정하고 서브 유닛 명령어에 의한 오퍼레이션 마스크 처리가 시행되지 않는 것을 특징으로 하는 듀얼 페이즈 심드 프로세서
7 7
제 6항에 있어서, 수식 명령어는 페이즈 비트가 ‘0’으로 표시되는 페이즈 1차에서만 사용 가능하고, 제어 명령어는 페이즈 비트가 ‘1’로 표시되는 페이즈 2차에서만 사용 가능하며, 페이즈 1차의 수식 명령어가 페이즈 2차의 제어 명령어의 주소 확장이나 실행 여부를 결정하는 것을 특징으로 하는 가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드 프로세서
8 8
제 6항에 있어서, 연산 명령어는 페이즈 비트 값에 무관하게 모든 페이즈에서 사용 가능 하고, 연산 메인 유닛 명령어만 존재할 경우 모든 컴퍼넌트에 연산 메인 유닛 명령어의 마이크로 오퍼레이션을 적용하고, 연산 서브 유닛 명령어가 존재할 경우 상기 마이크로 오퍼레이션 필드의 마스크 비트를 통해 해당 컴퍼넌트를 서브 연산 명령어의 마이크로 오퍼레이션으로 대체하지만, 연산 메인 유닛 명령어의 쓰기 마스크(write mask)에 따라 마이크로 오퍼레이션의 실행 여부가 제약되는 특징을 갖는 가변 길이 명령어 셋을 갖는 듀얼 페이즈 심드 프로세서
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순번 연구부처 주관기관 연구사업 연구과제
1 서울특별시 광운대학교 산학협력단 서울시 산학연 협력사업(2005년 기술기반구축사업) 나노SoC 산업육성을 위한 산학협력 혁신 클러스터