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전송 라인으로 신호를 전송하기 위한 드라이버;상기 전송 라인의 전압 레벨이 기준값 이상인지를 감지하는 감지부; 및상기 감지부에 의해 상기 전송 라인의 전압 레벨이 기준값 이상이라고 판단되는 경우에 상기 드라이버로부터 상기 전송 라인으로의 전류 흐름을 차단하는 차단부를 포함하는 송신 회로
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제 1항에 있어서,상기 송신 회로는 활성화 신호에 응답해 활성화/비활성화되는송신 회로
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제 2항에 있어서,상기 감지부는상기 활성화 신호의 비활성화시에 차단 신호를 비활성화하는 비활성화부; 및상기 활성화 신호의 활성화시에 상기 전송 라인의 전압 레벨에 응답해 상기 차단 신호를 활성화하는 활성화부를 포함하는 송신 회로
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제 3항에 있어서,상기 활성화부는상기 전송 라인에 게이트단과 드레인단이 연결된 제1트랜지스터; 및상기 제1트랜지스터의 소스단 레벨에 따라 상기 차단 신호를 활성화 레벨로 구동하기 위한 제2트랜지스터를 포함하는송신 회로
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제 4항에 있어서,상기 활성화부는상기 활성화 신호의 비활성화시에 상기 제2트랜지스터가 오프되도록 제어하기 위한 제3트랜지스터를 더 포함하는송신 회로
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제 3항에 있어서,상기 차단부는상기 차단 신호에 응답해 상기 드라이버로부터 상기 전송 라인으로의 전류 전달을 차단하는 스위치를 포함하는송신 회로
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제 2항에 있어서,상기 드라이버는상기 활성화 신호의 활성화시에 상기 신호의 레벨에 응답해 상기 전송 라인으로 전류를 공급하기 위한 풀업 드라이버; 및상기 활성화 신호의 활성화시에 상기 신호의 레벨에 응답해 상기 전송 라인으로부터 전류를 싱킹하기 위한 풀다운 드라이버를 포함하는송신 회로
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전송 라인의 전압 레벨에 응답해 출력 노드를 풀다운 구동하는 제1NMOS 트랜지스터;상기 출력 노드의 전압 레벨에 응답해 상기 전송 라인과 프리차지 노드를 연결하는 제1PMOS 트랜지스터;상기 프리차지 노드에 연결된 하나 이상의 캐패시터;상기 출력 노드의 전압 레벨에 응답해 제어 노드를 풀업 구동하기 위한 제2PMOS 트랜지스터;상기 프리차지 노드의 전압 레벨에 응답해 상기 전송 라인과 상기 제어 노드를 전기적으로 연결하기 위한 제2NMOS 트랜지스터; 및상기 제어 노드의 전압 레벨에 응답해 상기 출력 노드를 풀업 구동하기 위한 제3PMOS 트랜지스터를 포함하는 수신 회로
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제 8항에 있어서,상기 제2PMOS 트랜지스터로 공급되는 전류량을 제한하기 위한 클램핑 소자를 더 포함하는 수신 회로
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제 8항에 있어서,상기 출력 노드의 신호를 반전해 출력 신호를 생성하기 위한 인버터를 더 포함하는 수신 회로
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전송 라인;상기 전송 라인으로 신호를 송신하기 위한 송신 회로; 및상기 전송 라인으로 전송된 신호를 수신하기 위한 수신 회로를 포함하고,상기 송신 회로는상기 전송 라인으로 신호를 전송하기 위한 드라이버;상기 전송 라인의 전압 레벨이 기준값 이상인지를 감지하는 감지부; 및상기 감지부에 의해 상기 전송 라인의 전압 레벨이 기준값 이상이라고 판단되는 경우에 상기 드라이버로부터 상기 전송 라인으로의 전류 흐름을 차단하는 차단부를 포함하는송/수신 시스템
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제 11항에 있어서,상기 송신 회로는 활성화 신호에 응답해 활성화/비활성화되는송/수신 시스템
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제 12항에 있어서,상기 감지부는상기 활성화 신호의 비활성화시에 차단 신호를 비활성화하는 비활성화부; 및상기 활성화 신호의 활성화시에 상기 전송 라인의 전압 레벨에 응답해 상기 차단 신호를 활성화하는 활성화부를 포함하는송/수신 시스템
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제 13항에 있어서,상기 활성화부는상기 전송 라인에 게이트단과 드레인단이 연결된 제1트랜지스터; 및상기 제1트랜지스터의 소스단 레벨에 따라 상기 차단 신호를 활성화 레벨로 구동하기 위한 제2트랜지스터를 포함하는송/수신 시스템
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제 14항에 있어서,상기 활성화부는상기 활성화 신호의 비활성화시에 상기 제2트랜지스터가 오프되도록 제어하기 위한 제3트랜지스터를 더 포함하는송/수신 시스템
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제 13항에 있어서,상기 차단부는상기 차단 신호에 응답해 상기 드라이버로부터 상기 전송 라인으로의 전류 전달을 차단하는 스위치를 포함하는송/수신 시스템
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제 11항에 있어서,상기 수신 회로는상기 전송 라인의 전압 레벨에 응답해 출력 노드를 풀다운 구동하는 제1NMOS 트랜지스터;상기 출력 노드의 전압 레벨에 응답해 상기 전송 라인과 프리차지 노드를 연결하는 제1PMOS 트랜지스터;상기 프리차지 노드에 연결된 하나 이상의 캐패시터;상기 출력 노드의 전압 레벨에 응답해 제어 노드를 풀업 구동하기 위한 제2PMOS 트랜지스터;상기 프리차지 노드의 전압 레벨에 응답해 상기 전송 라인과 상기 제어 노드를 전기적으로 연결하기 위한 제2NMOS 트랜지스터; 및상기 제어 노드의 전압 레벨에 응답해 상기 출력 노드를 풀업 구동하기 위한 제3PMOS 트랜지스터를 포함하는송/수신 시스템
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제 17항에 있어서,상기 수신 회로는상기 제2PMOS 트랜지스터로 공급되는 전류량을 제한하기 위한 클램핑 소자를 더 포함하는송/수신 시스템
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제 17항에 있어서,상기 수신 회로는상기 출력 노드의 신호를 반전해 출력 신호를 생성하기 위한 인버터를 더 포함하는송/수신 시스템
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제 12항에 있어서,상기 활성화 신호는 클럭인송/수신 시스템
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