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클록 주파수 체배기 및 이를 포함하는 클록/데이터 복원 회로(CLOCK MULTIPLIER AND CLOCK/DATA RECOVERY CIRCUIT COMPRISING THE SAME)

  • 기술번호 : KST2015231111
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 일 실시예에 따른 클록 주파수 체배기는 각각이 서로 다른 위상을 갖는 적어도 하나의 클록 신호를 입력받아 체배된 클록 신호를 출력하는 적어도 하나의 캐패시터를 포함하고, 상기 적어도 하나의 캐패시터는 상기 적어도 하나의 클록 신호를 입력받는 제1 노드; 및 상기 제1 노드를 통해 입력된 클록 신호에 대응하여 체배된 클록 신호를 출력하는 제2 노드를 포함한다.
Int. CL H03B 19/00 (2014.01) H03L 7/08 (2006.01)
CPC H03K 5/00006(2013.01) H03K 5/00006(2013.01) H03K 5/00006(2013.01) H03K 5/00006(2013.01) H03K 5/00006(2013.01)
출원번호/일자 1020140075916 (2014.06.20)
출원인 고려대학교 산학협력단
등록번호/일자
공개번호/일자 10-2015-0146064 (2015.12.31) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2014.06.20)
심사청구항수 13

출원인

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번호 이름 국적 주소
1 고려대학교 산학협력단 대한민국 서울특별시 성북구

발명자

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번호 이름 국적 주소
1 김철우 대한민국 서울특별시 성북구
2 김자영 대한민국 서울특별시 성북구

대리인

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번호 이름 국적 주소
1 홍성욱 대한민국 서울특별시 강남구 역삼로 ***(역삼동) 동아빌딩 *층(주식회사에스와이피)
2 심경식 대한민국 서울시 강남구 역삼로 *** 동아빌딩 *층(에스와이피특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 고려대학교 산학협력단 서울특별시 성북구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2014.06.20 수리 (Accepted) 1-1-2014-0579569-55
2 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2014.07.10 수리 (Accepted) 1-1-2014-0649544-90
3 선행기술조사의뢰서
Request for Prior Art Search
2015.08.10 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search
2015.10.08 수리 (Accepted) 9-1-2015-0065730-32
5 의견제출통지서
Notification of reason for refusal
2015.10.15 발송처리완료 (Completion of Transmission) 9-5-2015-0709941-80
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2015.12.14 수리 (Accepted) 1-1-2015-1222004-78
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2015.12.14 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2015-1222014-24
8 의견제출통지서
Notification of reason for refusal
2016.04.29 발송처리완료 (Completion of Transmission) 9-5-2016-0315304-76
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2016.06.13 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2016-0565653-90
10 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.06.13 수리 (Accepted) 1-1-2016-0565634-22
11 등록결정서
Decision to grant
2017.01.16 발송처리완료 (Completion of Transmission) 9-5-2017-0037967-17
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.10.10 수리 (Accepted) 4-1-2019-5210941-09
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
각각이 서로 다른 위상을 갖는 복수의 클록 신호를 입력받아 체배된 클록 신호를 출력하는 복수의 캐패시터를 포함하고,상기 복수의 캐패시터는상기 클록 신호를 입력받는 제1 노드; 및상기 제1 노드를 통해 입력된 클록 신호에 대응하여 체배된 클록 신호를 출력하는 제2 노드를 포함하되,상기 복수의 캐패시터 중 하나의 제1 캐패시터는 번갈아 가면서 스위칭되도록 VDD와 VSS에 선택적으로 연결되고, 나머지 절반의 제2 및 제3 캐패시터는 상기 VDD와 상기 VSS에 각각 연결됨으로써, 상기 제1 캐패시터의 스위칭에 따라 상기 제1 노드에서 상기 클록 신호의 위상이 트랜지션(transition)이 일어날 때마다 상기 제2 노드에서 트랜지션이 일어나는 특성에 기초하여 상기 체배된 클록 신호를 생성하는 것을 특징으로 하는 클록 주파수 체배기
2 2
제1항에 있어서,상기 복수의 캐패시터는상기 제2 노드 각각이 하나의 공통 라인으로 서로 연결되고, 상기 공통 라인을 통해 상기 체배된 클록 신호를 출력하는 것을 특징으로 하는 클록 주파수 체배기
3 3
삭제
4 4
제1항에 있어서,상기 제2 노드에 접속되어 상기 체배된 클록 신호의 전압 레벨을 조절하는 스위치부를 더 포함하는 것을 특징으로 하는 클록 주파수 체배기
5 5
제4항에 있어서,상기 스위치부는바이어스 전압에 원하는 클록의 공통 레벨(common level) 전압을 인가하여 상기 체배된 클록 신호의 전압 레벨을 공통 레벨로 조절하는 것을 특징으로 하는 클록 주파수 체배기
6 6
제4항에 있어서,상기 스위치부는MOSFET(Metal Oxide Semiconductor Field Effect Transistor)을 포함하는 것을 특징으로 하는 클록 주파수 체배기
7 7
제1항에 있어서,상기 제1 노드에 입력되는 클록 신호는다중 위상을 가지는 전압 제어 발진기(VCO)의 출력 신호인 것을 특징으로 하는 클록 주파수 체배기
8 8
입력 데이터와 샘플링 데이터의 위상 차이 및 주파수 차이에 기초하여, 각각이 서로 다른 위상을 갖는 복수의 클록 신호를 생성하는 클록 신호 발생부; 및상기 복수의 클록 신호를 입력받아 체배된 클록 신호를 출력하는 복수의 캐패시터를 구비하는 클록 주파수 체배기를 포함하고,상기 복수의 캐패시터는상기 클록 신호를 입력받는 제1 노드; 및상기 제1 노드를 통해 입력된 클록 신호에 대응하여 체배된 클록 신호를 출력하는 제2 노드를 포함하되,상기 복수의 캐패시터 중 하나의 제1 캐패시터는 번갈아 가면서 스위칭되도록 VDD와 VSS에 선택적으로 연결되고, 나머지 절반의 제2 및 제3 캐패시터는 상기 VDD와 상기 VSS에 각각 연결됨으로써, 상기 제1 캐패시터의 스위칭에 따라 상기 제1 노드에서 상기 클록 신호의 위상이 트랜지션(transition)이 일어날 때마다 상기 제2 노드에서 트랜지션이 일어나는 특성에 기초하여 상기 체배된 클록 신호를 생성하는 것을 특징으로 하는 클록/데이터 복원 회로
9 9
제8항에 있어서,상기 복수의 캐패시터는상기 제2 노드 각각이 하나의 공통 라인으로 서로 연결되고, 상기 공통 라인을 통해 상기 체배된 클록 신호를 출력하는 것을 특징으로 하는 클록/데이터 복원 회로
10 10
삭제
11 11
제8항에 있어서,상기 클록 주파수 체배기는상기 제2 노드에 접속되어 상기 체배된 클록 신호의 전압 레벨을 조절하는 스위치부를 더 구비하는 것을 특징으로 하는 클록/데이터 복원 회로
12 12
제11항에 있어서,상기 스위치부는바이어스 전압에 원하는 클록의 공통 레벨(common level) 전압을 인가하여 상기 체배된 클록 신호의 전압 레벨을 공통 레벨로 조절하는 것을 특징으로 하는 클록/데이터 복원 회로
13 13
제11항에 있어서,상기 스위치부는MOSFET을 포함하는 것을 특징으로 하는 클록/데이터 복원 회로
14 14
제8항에 있어서,상기 클록 신호 발생부는상기 입력 데이터와 상기 샘플링 데이터의 위상 차이를 검출하는 위상 검출기;상기 입력 데이터와 상기 샘플링 데이터의 주파수 차이를 검출하는 주파수 검출기;상기 위상 차이 및 주파수 차이에 기초하여 전압 제어 발진기(VCO)의 제어 전압을 생성하는 전하 펌프;상기 제어 전압에 기초하여 상기 복수의 클록 신호를 출력하는 전압 제어 발진기를 포함하는 것을 특징으로 하는 클록/데이터 복원 회로
15 15
제14항에 있어서,상기 복수의 클록 신호 및 상기 체배된 클록 신호를 다중화 처리하는 멀티플렉서; 및상기 멀티플렉서에 클록 선택 신호를 인가하여, 상기 멀티플렉서의 출력 신호를 선택적으로 상기 위상 검출기 및 상기 주파수 검출기에 출력하도록 하는 클록 선택 제어기를 더 포함하는 것을 특징으로 하는 클록/데이터 복원 회로
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.