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대기전력 저감모드를 가지는 클록생성회로 및 이를 이용한 플라이백 컨버터(CLOCK GENERATING CIRCUIT OF REDUCING MODE THE STANDBY POWER AND FLYBACK CONVERTER THEREOF)

  • 기술번호 : KST2016005070
  • 담당센터 : 부산기술혁신센터
  • 전화번호 : 051-606-6561
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 대기전력 소비를 최소화하기 위한 게이트 오프구간을 최대한 늘리고, 전자기기의 종류에 적합한 슬립모드 주파수를 용이하게 조절할 수 있도록 하는 대기전력 저감모드를 가지는 클록생성회로에 관한 것으로, 외부로부터 대기전력을 저감하기 위한 슬립모드 신호를 입력받으면 기설정된 듀티비에 따라 다발성 묶음 주파수를 생성하여 트랜지스터의 게이트를 대기전력 저감모드로 구동시키는 클록생성회로에 있어서, 기설정된 주기로 분주된 제1클록을 제공하는 메인클록부와; 상기 제1클록을 이용하여 상기 제1클록의 주파수보다 낮은 주파수를 생성 및 제공하는 보조클록부와; 상기 제1클록의 주파수에 따라 기설정된 제1비트부터 상기 제1비트보다 큰 제2비트까지 카운팅 연산하는 스텝카운터와; 셋(Set) 입력은 상기 제1멀티플렉서의 출력과 연결되고 리셋(Reset) 입력은 상기 스텝카운터의 출력과 연결되어, 상기 스텝카운터의 제2비트까지 카운팅되는 경우 리셋 동작하는 래치부; 및 상기 제1클록 및 상기 래치부의 출력에 따라 다발성 묶음 주파수를 출력하는 출력부;를 포함하는 것을 기술적 요지로 한다.
Int. CL H03K 3/78 (2006.01) H02M 3/28 (2006.01)
CPC H03K 5/1565(2013.01) H03K 5/1565(2013.01) H03K 5/1565(2013.01)
출원번호/일자 1020140078091 (2014.06.25)
출원인 한국전기연구원
등록번호/일자 10-1623887-0000 (2016.05.18)
공개번호/일자 10-2016-0000666 (2016.01.05) 문서열기
공고번호/일자 (20160524) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2014.06.25)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 한국전기연구원 대한민국 경상남도 창원시 성산구

발명자

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번호 이름 국적 주소
1 김기현 대한민국 경상남도 창원시 성산구
2 김형우 대한민국 경상남도 창원시 성산구
3 서길수 대한민국 경상남도 창원시 의창구
4 이경호 대한민국 경상남도 창원시 진해구

대리인

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번호 이름 국적 주소
1 특허법인부경 대한민국 부산광역시 연제구 법원남로**번길 **, *층 (거제동, 대한타워)

최종권리자

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번호 이름 국적 주소
1 한국전기연구원 경상남도 창원시 성산구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2014.06.25 수리 (Accepted) 1-1-2014-0595467-72
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.04 수리 (Accepted) 4-1-2015-0006987-25
3 선행기술조사의뢰서
Request for Prior Art Search		 2015.08.10 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2015.10.08 수리 (Accepted) 9-1-2015-0065724-68
5 의견제출통지서
Notification of reason for refusal		 2015.10.15 발송처리완료 (Completion of Transmission) 9-5-2015-0710979-38
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2015.11.16 수리 (Accepted) 1-1-2015-1110724-84
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2015.11.16 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2015-1110734-30
8 등록결정서
Decision to grant		 2016.03.28 발송처리완료 (Completion of Transmission) 9-5-2016-0226524-48
9 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment		 2019.05.28 수리 (Accepted) 1-1-2019-0546522-31
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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외부로부터 대기전력을 저감하기 위한 슬립모드 신호를 입력받으면 기설정된 듀티비에 따라 다발성 묶음 주파수를 생성하여 트랜지스터의 게이트를 대기전력 저감모드로 구동시키는 클록생성회로에 있어서,기설정된 주기로 분주된 제1클록을 제공하는 메인클록부;상기 제1클록을 이용하여 상기 제1클록의 주파수보다 낮은 복수개의 주파수를 생성하는 클록디바이더와, 주파수 선택 신호의 입력에 따라 상기 복수개의 주파수 중 어느 하나의 주파수를 선택하여 선택된 주파수의 제2클록을 출력하는 제1멀티플렉서로 이루어지는 보조클록부;상기 제1클록의 주파수에 따라 기설정된 제1비트부터 상기 제1비트보다 큰 제2비트까지 카운팅 연산하는 스텝카운터;셋(Set) 입력은 상기 제1멀티플렉서의 출력과 연결되고 리셋(Reset) 입력은 상기 스텝카운터의 출력과 연결되어, 상기 스텝카운터의 제2비트까지 카운팅되는 경우 리셋 동작하는 래치부; 및상기 제1클록 및 상기 래치부의 출력에 따라 다발성 묶음 주파수를 출력하는 출력부;를 포함하는 것을 특징으로 하는 대기전력 저감모드를 가지는 클록생성회로
2 2
삭제
3 3
제1항에 있어서,상기 묶음 주파수의 다발수는 상기 스텝카운터의 기설정된 비트수에 의해 조절되는 것을 특징으로 하는 대기전력 저감모드를 가지는 클록생성회로
4 4
교류전류를 직류전류로 변환하는 정류부와, 상기 정류부에서 변환된 직류전류를 부하단에 필요한 직류전원으로 변압하는 변압부와, 상기 변압부로 흐르는 직류전류를 스위칭하는 트랜지스터를 포함하는 플라이백 컨버터에 있어서,상기 변압부의 1차측 보조권선 전압을 샘플링하여 출력전압을 감지하는 샘플홀드부;상기 샘플홀드부의 출력단에 연결된 저항 및 비교기로 이루어진 에러엠프의 출력값을 이용하여 슬립모드를 판단하는 슬립모드 판별부; 및제1항 또는 제3항 중 어느 한 항에 따른 대기전력 저감모드를 가지는 클록생성회로;를 포함하는 것을 특징으로 하는 플라이백 컨버터
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 산업통상자원부 코스텔(주) 에너지자원융합원천기술개발 정보가전기기 전력절감형 칩형 전원장치 및 HiNA(High Network Availability) 개발