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주파수 합성기에 있어서, 일정한 주파수의 다중 위상 저 잡음 신호를 생성하는 서브 샘플링 위상 고정 루프; 및상기 서브 샘플링 위상 고정 루프로부터 다중 위상 저 잡음 신호가 전달되면 입력되는 n-비트의 주파수 제어 신호(FCW)에 기초하여 상기 다중 위상 저 잡음 신호에 대한 분수배의 주파수를 출력하는 플라잉 가산기를 포함하되,상기 플라잉 가산기는상기 주파수 제어 신호 및 n-비트의 레지스터 출력 신호를 합산하여 n-비트의 가산기 출력 신호를 출력하는 n-비트 가산기; 상기 가산기 출력 신호를 입력받아 클록 신호에 따라 상기 레지스터 출력 신호를 출력하는 레지스터; 상기 레지스터 출력 신호 중 상위 m-비트의 값을 먹스 선택 신호로 출력하는 트렁케이션부; 상기 먹스 선택 신호에 따라 상기 다중 위상 저 잡음 신호 중 하나의 위상 신호를 먹스 출력 신호로 출력하는 제1 먹스; 및 상기 먹스 출력 신호에 기초하여 상기 클록 신호를 선택하는 제2 및 제3 먹스 및 제1 및 제2 래치를 포함하여,반복적으로 출력되는 상기 먹스 출력 신호에 따라 디더링된 주파수 성분을 시간에 대해 평균을 냄으로써 분수배의 출력 주파수를 합성하는 것을 특징으로 하는 서브 샘플링 위상 고정 루프 회로 기반의 분수배 주파수 합성기
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제1항에 있어서, 상기 서브 샘플링 위상 고정 루프는주파수를 고정시키는 주파수 고정 루프;위상을 고정시키는 위상 고정 루프; 및상기 주파수 고정 루프와 위상 고정 루프의 출력 신호에 의거하여 4상태의 위상을 발생시키는 전압 제어 발진기를 포함하는 것을 특징으로 하는 서브 샘플링 위상 고정 루프 회로 기반의 분수배 주파수 합성기
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제2항에 있어서, 상기 주파수 고정 루프는 입력 신호와 피드백 신호의 위상차에 기초하여 업 신호(UP) 및 다운 신호(DOWN)를 생성하는 위상 주파수 검출기;상기 업 신호(UP) 및 다운 신호(DOWN)에 기초하여 전하 펌프 출력 신호를 생성하는 전하펌프; 및상기 위상 주파수 검출기의 출력단과 상기 전하펌프의 입력단에 연결되어, 미리 설정된 기준 이상의 위상차에 기초하여 발생된 업 신호(UP) 및 다운 신호(DOWN)만을 상기 전하 펌프로 전달하는 데드존 생성기를 포함하는 것을 특징으로 하는 서브 샘플링 위상 고정 루프 회로 기반의 분수배 주파수 합성기
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제2항에 있어서, 상기 위상 고정 루프는 입력신호와 피드백 신호 및 반전 피드백 신호에 기초하여, 빠른 속도의 발진기 출력 신호를 느린 입력 신호로 샘플링한 후 상기 입력신호와의 위상 차이를 직류값(SAMP, SAMN)으로 산출하는 서브 샘플링 위상 검출기;상기 서브 샘플링 위상 검출기에서 산출된 직류의 위상차(SAMP, SAMN)를 변환하여 상기 전압 제어 발진기로 전달하는 서브 샘플링 전하펌프; 및루프 이득을 조절하기 위해 상기 서브 샘플링 전하펌프의 작동 시간을 제어하는 펄서를 포함하는 것을 특징으로 하는 서브 샘플링 위상 고정 루프 회로 기반의 분수배 주파수 합성기
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주파수 합성 방법에 있어서, 일정한 주파수의 다중 위상 저 잡음 신호를 생성하는 단계; 및n-비트의 주파수 제어 신호(FCW)에 기초하여 상기 다중 위상 저 잡음 신호에 대한 분수배의 주파수를 출력하는 단계를 포함하되,상기 분수배의 주파수를 출력하는 단계는상기 주파수 제어 신호 및 n-비트의 레지스터 출력 신호를 합산하여 n-비트의 가산기 출력 신호를 출력하는 단계;상기 가산기 출력 신호를 클록 신호에 따라 상기 레지스터 출력 신호로 출력하는 단계;상기 레지스터 출력 신호 중 상위 m-비트의 값을 먹스 선택 신호로 출력하는 단계;상기 먹스 선택 신호에 따라 상기 다중 위상 저 잡음 신호 중 하나의 위상 신호를 먹스 출력 신호로 출력하는 단계;상기 먹스 출력 신호에 기초하여 상기 클록 신호를 선택하는 단계; 및반복적으로 출력되는 상기 먹스 출력 신호에 따라 디더링된 주파수 성분을 시간에 대해 평균을 냄으로써 분수배의 출력 주파수를 합성하는 단계를 포함하는 것을 특징으로 하는 서브 샘플링 위상 고정 루프 회로 기반의 분수배 주파수 합성 방법
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